DC常用命令及脚本

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1、利用DC进行综合设计(2012-03-2517:45:10)转载▼标签：dc综合杂谈DC的综合术语用于设计的ASIC的EDA工具往往是一套很复杂的软件，包括大量的工具和文档。同时，每个公司都有自己的一套术... 一、预备知识1.1、DC的综合术语用于设计的ASIC的EDA工具往往是一套很复杂的软件，包括大量的工具和文档。同时，每个公司都有自己的一套术语。只有理解了这些术语的含义才能很好的掌握这些工艺。1设计和设计对象设计是实现一定逻辑功能的电路的描述。设计对象就是在设计中被DC命令、属性和约束操作或控制的对象。常用的设计中包括元件、网络、端口、引脚和时

2、钟。另外，一个设计可能包括某个相同子设计或库元件的多个例化。这时候被例化的设计或库元件称作参考。在一个设计中查找某个对象的命令：find，这是在DC命令中很常用的命令。如：列出当前设计的所有端口（ports）:Dc_shell>findportORfind(port,”*”)列出所有包含”DW”字母的元件：dc_shell>find(cell,”*DW*”)列出cba_core库中的AN2门的所有接脚：dc_shell>find(pin,cba_core/AN2Read–formatvhdl./src/rtl/timer_tugw.vhdRead–fo

3、rmatvhdl./src/rtl/test_top.vhd  Check_error–vIf(dc_shell_status==1){exit1}   Current_designtest_topLink  Check_error–vIf(dc_shell_status==1){exit1}   Includepass0/constraint/test_top.con Check_error–vIf(dc_shell_status==1){exit1}  Set_max_area0.0000  Set_flattenfalse  Echo”***do

4、ingfullcompileforthepartition‘test_top’***”Shdate;Compile–map_effortmedium Check_error–vIf(dc_shell_status==1){exit1}   Shdate;Check_designCompile_top_acs_partion=tureCompile_top_all_paths=true Echo”***doingboundarycompileforthepartition‘test_top’***”Shdate;Compile–topUniquify C

5、heck_error–vIf(dc_shell_status==1){exit1}   Shdate;Current_designtest_topWrite–formatdb–hierarchy–outputpass0/db/test_top.dbWrite–formatverilog–hierarchy–outputpass0/db/test_top.vWrite–formatvhdl–hierarchy–outputpass0/db/test_top.vhdReport_timing>pass0/report/test_top.timReport_

6、area>pass0/report/test_top.areaReport_constraints>pass0/report/test_top.cstrReport_qor>pass0/report/test_top.qorReport_constraints–all_violators–verbose>pass0/report/test_top.vio quit脚本文件可以使用任何一个文本编辑工具产生或修改，也可以在dc_shell中执行write_scirpt命令产生。如，下面的命令就是将设计的属性和约束等信息保存到名为test.scr的脚本文件。

7、Dc_shell>write_>test.scr脚本文件的语法应该符合dc_shell命令的语法。DC提供了一个语法检查工具和一个上下文检查工具，他们可以检查脚本文件的语法和脚本文件的错误，并提供相应的错误信息。语法检查工具检查脚本文件的语法，但是不执行其中的命令。语法检查实现的功能包括：检查预先定义的命令参数是否正确，检查必须的参数是否存在、文件重定向问题、检查引用文件中的命令的语法、按照dc_shell正常的使用方式执行赋值。要使用语法检查，我们必须对该功能进行使能，此后每次引用或执行脚本前就会首先进行语法检查。在dc_shell中使能语法检查功能

8、的方法如下：Dc_shell>syntax_checktrueSyntaxcheckon.上下