EDA技术实验5-7(2012)

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1、《EDA技术》随课实验内容指导（二）移通学院电子信息工程系2012年5月重邮移通学院《EDA技术》课程实验内容指导——编写人：张家波《EDA技术》实验五——VHDL语言并行语句的高级应用一、实验目的1、掌握；二、实验内容及要求1、同步；三、设计提示（课堂讲解）1、讲解；2、对本次实验内容加以简单解释和提示；5.1多进程程序设计1.设计一个时钟频率可调的计数电路，用两个进程实现：进程P1用来对时钟信号的频率进行调节，时钟信号的分频值在10~100内可以任意设定；进程P2用来控制计数器的计数，假定其模值为16。2.输入输出信号分别为：输入—

2、—clk,rst分别为系统时钟和清零信号；输出——Q[3..0]为计数器的计数端输出，Co为计数器的分频端输出。3.设计文件命名为lianxi51.vhd，要求对其进行仿真，并根据仿真结果指出该电路的功能；5.2函数调用设计1.在VHDL程序中定义一个函数fun1(data:INstd_logic_vector)，其功能为：对输入信号data[3..0]进行七段译码，函数的返回值为std_logic_vector(6downto0)。主程序调用该函数，对一个四位二进制数进行七段译码显示。2.输入输出信号分别为：输入——X[3..0]为四

3、位二进制信号；输出——Led[6..0]数码管的各段输出信号。3.设计文件命名为lianxi52.vhd，对设计文件进行语法检查、项目编译，无误后加以仿真验证设计是否正确；4.参考设计程序（略）5.3元件例化语句的应用设计1.在上述两题5.1、5.2题的基础上，用元件例化语句将两个模块连接起来，构成一个频率可调的自动计数并进行七段译码显示的电路。两元件之间的连接图如下：重庆邮电大学移通学院★电子信息工程系第6页共7页重邮移通学院《EDA技术》课程实验内容指导——编写人：张家波1.输入输出信号分别为：输入——clk，rst分别为时钟信号和

4、复位信号；输出——Led[6..0]数码管的各段输出信号，Co为计数器的分频输出端。2.设计文件命名为lianxi53.vhd对设计文件进行语法检查、项目编译，无误后加以仿真验证设计是否正确；3.参考设计程序（略）重庆邮电大学移通学院★电子信息工程系第6页共7页重邮移通学院《EDA技术》课程实验内容指导——编写人：张家波《EDA技术》实验六——VHDL语言综合设计一、实验目的1、熟练运用Maxplus开发工具，进行复杂的逻辑电路设计；2、掌握在同一题目中综合运用多种描述方法（原理图和VHDL语言），进行大型的数字逻辑电路设计；3、掌握复

5、杂系统的仿真分析方法。二、实验内容及要求1、四位全加器的设计（必做，具体要求见后）；2、补充设计题：数字钟设计（选做，具体要求见后）。三、设计提示（课堂讲解）1、举例演示并说明将设计文件变为其默认符号的操作方法及用途；2、讲解综合设计的一般思路和方法（模块化的设计）；3、讲解复杂系统的仿真分析方法。6.1四位全加器的设计1、设计要求：先用原理图或VHDL语言描述一位的全加器fulladd1，并生成默认符号，然后由四个一位的全加器fulladd1通过级联构成四位的全加器fulladd4。2、总体设计文件命名为lianxi61.gdf或fu

6、lladd4.gdf。3、对设计文件进行语法检查、项目编译，无误后加以仿真验证设计是否正确，并指出该程序所实现的功能。4、参考设计程序（略）5、6.2数字钟设计1、设计要求：综合运用原理图法及VHDL语言设计一个具有分、秒显示的数字钟电路，显示装置为两个7段数码管；2、总体设计文件命名为lianxi62.*。3、对设计文件进行语法检查、项目编译，无误后加以仿真验证设计是否正确，并指出该程序所实现的功能。4、参考设计程序（略）重庆邮电大学移通学院★电子信息工程系第6页共7页重邮移通学院《EDA技术》课程实验内容指导——编写人：张家波6.3

7、简易电子计算器设计1、设计要求：综合运用原理图法及VHDL语言设计一个四位二进制数的加、减、乘、除功能的简易计算器。2、输入输出信号分别为：输入——X[3..0],Y[3..0]均为四位二进制信号；输出——Result[3..0]为运算的结果，Co为运算过程中产生的进位或借位信号。3、总体设计文件命名为lianxi62.*。4、对设计文件进行语法检查、项目编译，无误后加以仿真验证设计是否正确，并指出该程序所实现的功能。5、参考设计程序（略）重庆邮电大学移通学院★电子信息工程系第6页共7页重邮移通学院《EDA技术》课程实验内容指导——编写

8、人：张家波《EDA技术》实验七——PROTEL99电路设计工具的使用一、实验目的1、掌握PROTEL99SE开发工具的使用技巧，能用其画给定的电路图及其PCB图；2、学会网络表的生成和使用方法；3、掌握PR