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时间:2019-07-25
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1、常用逻辑部件一、逻辑门二、三态门三、驱动器四、锁存器五、三态锁存器重点掌握三态门,锁存器的作用在数字电路中实现逻辑运算的电路,简称逻辑门或门电路。例与门、或门、非门、与非门、或非门逻辑门有两种输出状态:高电平(逻辑1)低电平(逻辑0)一、逻辑门(门电路)逻辑门的表示方法:ABY&ABY≥1AY1逻辑门国家标准符号旧教材使用符号ABYABYYA与门Y=A∧B或门Y=A∨B非门Y=A逻辑门国家标准符号旧教材使用符号异或门Y=A∨B与非门Y=A∧B或非门Y=A∨BABY≥1ABY&ABY=1ABYABYABY二、三态门而三态门有三种输出状态:高电平
2、(逻辑1)低电平(逻辑0)高阻态(浮空状态、断开状态)工作状态AYEN高电平低电平高阻态一般逻辑门只有两种输出状态:高电平低电平高电平低电平AY三态门比逻辑门增加了一个控制端EN(又称使能端),当控制端有效时,三态门处于工作态,否则处于高阻态。三态门AYEN高电平低电平高阻态逻辑门高电平低电平AYENAY00001110高阻11高阻AYENAYEN功能表ENAY10011100高阻01高阻三态门控制端高电平有效控制端低电平有效高阻态的特点处于高阻状态的三态门,其输出端既不会有电流流出,也不会有电流流入,如果与总线相连,此时三态门电路仍连在总线
3、,但电气上与总线处于断开状态,对总线上的信号无影响上。总线AYENAYENAYENAYEN用于增强总线的负载能力。三、驱动器(缓冲器)数据总线DB控制总线CB地址总线AB存储器I/O接口输入设备I/O接口输出设备CPU单向(用于地址、控制总线的驱动)双向(用于数据总线的驱动)普通驱动器三态驱动器数据总线DB控制总线CB地址总线AB存储器I/O接口输入设备I/O接口输出设备CPU1G2G单向三态驱动器74LS244Y3~Y0Y7~Y4A3~A0A7~A4含两个4位三态驱动器功能表1GA3~0Y3~000001110高阻11高阻2GA7~4Y7~
4、400001110高阻11高阻GDIR双向三态驱动器74LS245Y7~Y0A7~A0功能表GDIR00AY01AY10高阻11高阻OET双向三态驱动器8286B7~B0A7~A0OET00AB01AB10高阻11高阻四、锁存器(触发器)组合逻辑电路和时序逻辑电路组合逻辑电路中,输出信号仅与输入信号当时的状态有关,与电路在此之前的状态无关。时序逻辑电路中,输出信号不仅与输入信号当时的状态有关,还与电路在此之前的状态有关。组合逻辑电路例:逻辑门、三态门、驱动器等。YAB与ABY输出信号Y的状态仅与输入信号A、B当时的状态有关,与A、B过去的状态
5、无关。DQCPD触发器时序逻辑电路例:触发器输出信号Q的状态不仅与输入信号D当时的状态有关,还与Q过去的状态有关。CPDQ以D触发器为例DQCPR输入端D输出端Q触发端CP清0端R当R=0时,不论D、CP为何值,Q=0触发器是时序逻辑电路常用的基本单元。D触发器、J-K触发器、R-S触发器D触发器的特点:当触发信号有效时,输出Q随输入D变化,即Q=D;当触发信号无效时,即变成非触发信号后,输出Q不随输入D变化,而保持非触发信号前的状态,Q=Q0将非触发信号前的状态Q0锁存在Q中,故触发器又称为锁存器D触发器DQCP触发信号:高电平CPDQ按触
6、发信号的不同,触发器分为:上升沿触发下降沿触发高电平触发低电平触发边沿触发电平触发CP1.上升沿触发方式CPDQCPCPDQ0011其它×Q0(不变)2.下降沿触发方式CPDQCPCPDQ0011其它×Q0(不变)3.高电平触发方式CPDQCPCPDQ100111其它×Q0(不变)4.低电平触发方式CPDQCPCPDQ000011其它×Q0(不变)五、三态锁存器具有三态和锁存功能的驱动器三态锁存器74LS373D0Q0D7Q7OEG功能表OEGDQ010001110其它×Q0(不变)1××高阻OE高阻控制G触发控制三态锁存器8282DI0DO
7、0DI7DO7OESTB功能表OESTBDIDO0000110其它×Q0(不变)1××高阻OE高阻控制STB触发控制第二节有关概念介绍一、主频,外频,倍频系数二、T状态三、总线周期四、指令周期五、时序六、时序图一、主频,外频,倍频系数CPU是在时钟信号的控制下工作时钟信号是一个按一定电压幅度,一定时间间隔发出的脉冲信号CPU所有的操作都以时钟信号为基准CPU按严格的时间标准发出地址,控制信号,存储器、接口也按严格的时间标准送出或接受数据.这个时间标准就是由时钟信号确定。CLKCPU的主频或内频指CPU的内部工作频率。主频是表示CPU工作速度的
8、重要指标,在CPU其它性能指标相同时,主频越高,CPU的速度越快CPU的外频或系统频率指CPU的外部总线频率。倍频系数指CPU主频和外频的相对比例系数。8088/8
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