原创modelsim

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1、如何使用ModelSim-Altera作電路模擬?(SOC)(QuartusII)(ModelSim)Abstract在QuartusII雖然可以用VectorWaveform的方式作電路模擬，不過這僅限於簡單的模擬，該如何用ModelSim-Altera配合testbench來做較複雜的電路模擬呢?Introduction使用環境：QuartusII7.2SP3+ModelSim-Altera6.1g在(筆記)如何設計邊緣檢測電路?(SOC)(Verilog)，我們使用了QuartusII內建的vectorw

2、aveform來模擬，可以使用GUI介面來指定波形，非常方便，對於小電路來說，這種拖拖拉拉的方式還算順手，但大電路還是得靠Verilog來寫testbench，然後配合ModelSim做模擬。本篇使用(筆記)如何設計邊緣檢測電路?(SOC)(Verilog)的上升沿檢測電路(posedgedetectioncircuit)，並加上testbench搭配ModelSim-Altera做模擬。Step1：posedge_detection_tb.v/Verilog1/*2(C)OOMusou2008http://o

3、omusou.cnblogs.com34Filename:posedge_detection_tb.v5Compiler:ModelSim-Altera6.1g6Description:testbenchofposedge_detection.v7Release:07/09/20081.08*/910`timescale1ns/10ps11moduleposedge_detection_tb;1213regclk;14regrst_n;15regi_data_in;16wireo_rising_edge;171

4、8posedge_detectionu0(19.clk(clk),20.rst_n(rst_n),21.i_data_in(i_data_in),22.o_rising_edge(o_rising_edge)23);2425parameterclkper=100;26initialbegin27clk=1'b0;28end2930alwaysbegin31#(clkper/2)clk=~clk;32end3334initialbegin35rst_n=1'b1;36i_data_in=1'b0;3738#75;

5、39i_data_in=1'b1;4041#100;42i_data_in=1'b0;4344#125;45i_data_in=1'b1;4647#75;48i_data_in=1'b0;4950#175;51i_data_in=1'b1;5253#25;54i_data_in=1'b0;55end5657endmodule使用testbench描述出如下在vectorwaveform中的波形Step2：設定QuartusII使用ModelSim-Altera模擬Assignments->Settings->C

6、ategory：EDAToolSettings->Simulation：Toolname：ModelSim-Altera選取Rungate-levelsimulationautomaticallyaftercompilationFormatforoutputnetlist：VerilogTimescale：1usStep3：設定testbench在同一頁的NativeLinksettings選擇Compiletestbench，按下TestBenches..加入posedge_detection_tb.v。比較

7、詭異的是，Testbenchname、Toplevelmoduleintestbench與Designinstancenameintestbench無法自己抓到，必須自己填。Step4：編譯並模擬Processing->StartCompilationSeeAlso(筆記)如何設計邊緣檢測電路?(SOC)(Verilog)(原創)如何解決在QuartusII無法使用ModelSim-Altera模擬的問題?(SOC)(QuartusII)(ModelSim)(原創)如何做functionalsimulation

8、?(SOC)(QuartusII)(ModelSim)(筆記)如何使用ModelSim作前仿真與後仿真?(SOC)(ModelSim)作者资料：真OO无双我的主页个人资料我的闪存与我联系00(请您对文章做出评价)Feedback#1楼回复引用2008-07-0919:45by刘晓[未注册用户]网上找不到nios2gcc.tar.bz2请先生将这个发到我邮箱里好吗？感激不尽！！我邮箱：l