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1、2010届毕业生毕业论文题目:基于FPGA的综合计时系统设计院系名称：信息科学与工程学院专业班级：电子信息科学与技术06级01班学生姓名：高洪扬学号：20064360113指导教师：焦素敏教师职称：副教授2010年6月2日II摘要随着电子技术的飞速发展,基于FPGA的设计向高集成度高速度和低价位方向不断迈进，其应用领域不断扩大。而基于FPGA的综合计时系统则是电子数字计时的一大发展。利用VHDL硬件描述语言结合FPGA器件设计一个具有基本计时和调整时间功能的计时系统，将会达到集成度高，开发简单，设计更加灵活多变，计时精确而且成本较低的特点。本文通过使用VHD
2、L语言设计了一个综合性的计时系统，能实现年、月、日、时、分、秒及星期的计数等综合计时功能，同时将计时结果用15个七段数码管显示，并且可通过两个设置键，对计时系统的有关参数进行调整。综合计时电路可分为计秒电路、计分电路、计时电路、计日电路、计月电路、计年电路、计星期电路等7个子模块，这7个子模块都具有预置、计数、和进位功能。本设计中对于系统的各种控制时钟信号，可通过分频电路对一个给定的合适频率信号进行分频来产生。在显示控制电路的设计中，显示部分利用动态扫描显示的原理，既简化了显示译码驱动电路的设计，又节约了硬件的I/O口，同时还减少了系统的驱动电流及功耗等；在
3、调整控制电路的设计中，简化了预置值的设计，利用状态机非常简洁地实现了各种调整状态的循环变化。关键词：FPGA，VHDL，计时系统，电路IIITitleDesignofanintegratedtimingsystembasedonFPGAAbstractWiththerapiddevelopmentofelectronictechnology,FPGA-baseddesigntohighspeedandlow-costhighlyintegratedintothedirectionofconstantlyexpandingitsapplicationareas
4、.TheFPGA-basedintegratedelectronicdigitaltimingsystemisamajordevelopmenttime.UsingVHDLhardwaredescriptionlanguagetodesignacombinationofFPGAdeviceshaveabasicfunctionoftimeandadjustmenttimetimingsystem,willreachhighintegration,developmentofsimpledesignismoreflexible,time-accurateandl
5、owcostcharacteristicsInthispaper,usingtheVHDLlanguagedesigntimeingsystem,acomprehensivesystemtoachievetheyear,month,day,hour,minuteandsecondweeksofcountingandtimingfunctionssuchasintegrated,whiletimingtheresultsof15seven-segmentdigitaldisplay,andcanbesetbytwokeysystemparametersonth
6、etimingadjustment.Timingcircuitintegratedcircuitcanbedividedintotheseconds,scoringcircuit,timingcircuit,namely,onthecircuit,monthlycircuit,namely,inthecircuit,namely,7-weekcircuitsub-module,whichhasapreset7sub-module,counting,andcarryfunction.Thedesignofthevariouscontrolsforthesyst
7、emclocksignal,byfrequencycircuitsuitableforagivenfrequencysignalfrequencytoproduce.Inthedisplaycontrolcircuitdesign,thedisplaypartoftheprincipleofdynamicscanningshowednotonlysimplifiesthedisplaydecoderdrivercircuitdesign,butalsosavethehardwareI/Oport,whilealsoreducingthesystem'sdri
8、vecurrentandpowerconsumpti
