EDA课程设计--数字式竞赛抢答器

EDA课程设计--数字式竞赛抢答器

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1、EDA课程设计——数字式竞赛抢答器一、系统设计要求在许多比赛活动中,为了准确、公正、直观地判断出第一抢答者,通常设置一台抢答器,通过数显、灯光及音响等各种手段批示出第一抢答者。同时,还可以设置计分、犯规及奖惩记录等各种功能。本设计的具体要求是:1、设计制作一个可容纳四组参赛者的数字智力抢答器,每组设置一个抢答按钮供抢答者使用。2、抢答器具有第一信号鉴别和锁存功能,使除第一抢答者外的按钮无作用。3、设置一个主持人“复位”按钮。4、主持人复位后,开始抢答,第一信号鉴别锁存电路得到信号后,有指示灯显示抢答组别,

2、扬声器发出2~3秒的音响。5、设置一个计分电路,每组开始预置100分,由主持人记分,答对一次加10分,答错一次减10分。二、系统设计方案根据系统设计要求可知,系统的输入信号有:各组的抢答按钮A、B、C、D,系统清零信号CLR,系统时钟信号CLK,计分复位端RST,加分按钮端ADD,减分按钮端ACC,系统的输出信号有:四个组抢答成功与否的指示灯控制信号输出口LEDA、LEDB、LEDC、LEDD,四个组抢答时的计时数码显示控制信号若干,抢答成功组别显示的控制信号若干,各组计分动态显示的控制信号若干。本系统应

3、具有的功能有:第一抢答信号的鉴别和锁存功能;抢答计分功能;各组得分的累加和动态显示功能。 根据以上的分析,我们可将整个系统分为三个主要模块:抢鉴别模块QDJB;抢答计分模块JFQ;显示译码模块YMQ,对于需显示的信息,需增加或外接译码器,进行显示译码。考虑到FPGA的可用接口及一般EDA实验开发系统的输出显示资源的限制,这里我们将组别显示和计时显示的译码器内设,而将各组的计分显示的译码器外接。  系统的工作原理如下:当主持人按下使能端CLR时,抢答器开始工作,A、B、C、D四个抢答者谁最先抢答成功则此选手

4、的台号灯(LEDA—LEDD)将点亮,并且主持人前的组别显示数码将显示出抢答成功者的台号;扬声器发出2~3秒的音响。接下来主持人提问,若回答正确,主持人按加分按钮ADD,若回答错误,主持人按减分按钮ACC,抢答计分模块JFQ将给对应的组加分或者减分,并将该组的总分显示在对应的选手计分数码管JF2_A~JF0_A、JF2_B~JF0_B、JF2_C~JF0_C、JF2_D~JF0_D、上。完成第一轮抢答后,主持人清零,接着重新开始,步骤如上。三、主要VHDL源程序与系统模块1.抢答鉴别电路QDJB的VHDL

5、源程序和模块--QDJB.VHDLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYQDJBISPORT(CLR:INSTD_LOGIC;A,B,C,D:INSTD_LOGIC;A1,B1,C1,D1:OUTSTD_LOGIC;STATES:OUTSTD_LOGIC_VECTOR(3DOWNTO0));ENDENTITYQDJB;ARCHITECTUREARTOFQDJBISCONSTANTW1:STD_LOGIC_VECTOR:="0001";CONSTANTW2:

6、STD_LOGIC_VECTOR:="0010";CONSTANTW3:STD_LOGIC_VECTOR:="0100";CONSTANTW4:STD_LOGIC_VECTOR:="1000";BEGINPROCESS(CLR,A,B,C,D)ISBEGINIFCLR='1'THENSTATES<="0000";ELSIF(A='1'ANDB='0'ANDC='0'ANDD='0')THENA1<='1';B1<='0';C1<='0';D1<='0';STATES<=W1;ELSIF(A='0'ANDB

7、='1'ANDC='0'ANDD='0')THENA1<='0';B1<='1';C1<='0';D1<='0';STATES<=W2;ELSIF(A='0'ANDB='0'ANDC='1'ANDD='0')THENA1<='0';B1<='0';C1<='1';D1<='0';STATES<=W3;ELSIF(A='0'ANDB='0'ANDC='0'ANDD='1')THENA1<='0';B1<='0';C1<='0';D1<='1';STATES<=W4;ENDIF;ENDPROCESS;ENDA

8、RCHITECTUREART;图1抢答鉴别电路的模块2.计分器电路JFQ的VHDL源程序--JFQ.VHDLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;ENTITYJFQISPORT(RST:INSTD_LOGIC;ADD:INSTD_LOGIC;ACC:INSTD_LOGIC;CHOS:INSTD_LOGIC_VECTOR(3DOW

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