基于fpga的usb3.0中扰码及解扰码电路设计

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1、‘、．ｒ．，．，１．．‘；，矿；：．１，，？．？－■．＇密级：保密期限；＾竣乂遂硕±学位论文基于ＦＰＧＡ的ＵＳＢ３．０中扰码及解扰码电路设计ＴｈｅＤｅｓｉｇｎｏｆＳｃｒａｍｂｌｅｒａｎｄＤｅｓｃｒａｍｂｌｅｒＧｒｃ山ｔｉｎＵＳＢ３．０ｂａｓｅｄｏｎＦＰＧＡ学号Ｐ１４３０１１３５姓名陈浩学位类别工程硕±学科专业集成电路工程（工程领域）柯导明教授／博导指导教师马验高级工程师完成时间２０１６年３月独

2、创性声明本人声巧所星交的学位论文是本人在导师指导下进行的研究工作及取得的研究成果。据我所知，除了义中特别加Ｗ标注和致谢的地方外，论文中不包含其他人已经发表或撰写过的研究成果，也不包含为获得安徽大学或其他教育机构的学位或证书而使用过的材料一同工作的同志对本研究所做的任何贡献均已。与我在论文中作了明确的说明并表示谢意。学位论文作者签名：签字曰期：年ｋ月曰、学位论文版权使用授权书本学位论文作者完全了解安徽大学有关保留、使用学位论文的规定，有权保留并向国家有关部口或机构送交论文的复印件和磁盘，允许论文被

3、查阅和借阅。本人授权安徽大学可Ｗ将学位论文的全部或部分巧容编入有关数据库进行检索，可Ｗ采用影印、缩印或扫描等复制手段保存、汇编学位论文。（保密的学位论文在解密后适用本授权书）学位论文作者签名：导师签名：巧毒＾々签宇日期：月日签字日期：之年月Ｉ日Ｗ）《ｋ，ｍｍ＿摘要ＵＳＢ２．０（ＵｎｉｖｅｒｓａｌＳｅｒｉａｌＢｕｓ２．０，通用串行总线）接口广泛应用于计算机。ＵＳＢ２．０和外部设备连接随着传输数据文件的不断增大，现有的的传输速率已２００８ＩｔｅｌＩＩＮＥＣ经无法满足海量数据文件的

4、传输带宽要求。年，ｎ、、等公司推一一ＵＳＢ３代Ｕ沈标准．０ＵＳＢ２．０出了新，其传输速率是的十倍，最大传输带宽可达５Ｇｂｐｓ。ＵＳＢ３．０向下完美兼容ＵＳＢ２．０，而且比ＵＳＢ２．０传输效率更高、功耗更ＵＳＢ３０低。现在越来越多的计算机和电子设备配置了．接口。本文的主要内容是利用阳ＧＡ来设计悅Ｂ３．０物理层中扰码和解扰码电路。论文首先介绍了课题的研巧背景Ｗ及本文所要设计的扰码和解扰码电路的研究现ＵＳＢ３状，然后分析了Ｕ涨３．０的总体架构和．０物理层的主要功能模块。由于论文ＦＰＧＡＡＡ采用

5、来设计扰码电路，论文还对ＦＰＧ相关内容进行了介绍，包括评Ｇ的结构特点和评ＧＡ设计电路的流程－。ＵＳＢ３０ＦＰＧＡ特本文根据．物理层中扰码及解扰妈电路设计要求，结合点和设计原则，使用Ｖｅｒｉｌｏｇ设计了ＲＴＬ级并行扰码电路和解扰码电路，并对设计进行ＦＰＧＡ苍片中ＦＰＧＡ内嵌逻辑分了功能仿真验证，最后将电路下载进行测试，利用析仪ＳｉｇｎａｌＴａｐ实时测试电路调试结果，验证结果符合设计预期。关键词：阳Ｂ３．０；物理层：扰码：评ＧＡＩＡｂｓｔｒａｃｔＡｂｓｔｒａｃｔＵＳＢ２．０ｕｎｉｖｅｒ

6、ｓａｌｓｅｒｉａｌｂｕｓ２．０ｉｎｔｅｒｆａｃｅｉｓｗｉｄｅｌｕｓｅｄｉｎｃｏｎｎｅｃｔｉｎｔｈｅ（）ｙｇｃｏｍｕｔｅｒｗｔｅｒｒａｅｖｃｅ．ｔｔｃｒｅａｓｎｏｆａｔａｔｒａｎｓｍｅｄｔｅｐｉｈｐｉｐｈｅｌｄｉＷｉｈｈｅｉｎｉｇｄｆｉｌｅｓｉｔ，ｈｅｘｉｓｔｉｎｇｔｒａｎｓｍｉｓｓｉｏｎｒａｔｅｏｆＵＳＢ２．０ｈａｓｂｅｅｎｕｎａｂｌｅ化ｍｅｅｔｔｈｅｂａｎｄｗｉｄｔｈｒｅｕｒｅｍｅｎｔｓｏｆｍａｓｓｉｖｅａｔａｌｅｔｒａｎｓｅ．Ｉｎ２Ｉｎｔｅｃｒｏ

7、ｓｏａｎｄｏｔｈｅｒｑｉｄｆｉｆｅｒｅ！００８，ｌ，Ｍｉｆｔ，ＮＥＣｏｔ－ｃｏｍａｎｉｅｓｉｎｌｉｎｔｒｏｄｕｃｅｄａｎｅｗｅｎｅｒａｔｉｏｎｏｆＵＳＢｓｔａｎｄａｒｄＵＳＢ３．０ｉｔｓｐｊｙｇ，化ａｎｓｍｉｓｓｉｏｎｒａｔｅｉｓｔｅｎｔｉｍｅｓａｓｍｕｃｈａｓｔｈｅＵＳＢ２．０ｔｈｅｍａｘｉｍｕｍｔｒａｎｓｍｉ巧ｉｏｎ，ｂａｎｄｗｉｄｔｈｉｓｕｐ１：ｏＳＧｂｐｓ．ＵＳＢ３．ＧｉｓｐｅｒｆｅｃｔｌｙｃｏｍｐａｔｉｂｌｅｗｉｔｈＵＳＢ２．０，

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