准确的soc 混合模式模拟

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1、準確的SoC混合模式模擬準確的SoC混合模式模擬張永嘉Yeong-JarChang林詠捷Yung-ChiehLin何榮基Jung-ChiHo羅珮文Pei-WenLuo設計自動化部摘要是發展功能更強大的類比模擬器，如FastSPICE，考慮共通性的電路，在重複性高的隨著類比混合訊號（Analog/Mixed-Signal）電路上，改善尤為顯著；二是撰寫類比電路的設計電路日趨複雜，常用之模擬工具SPICE和AnalogBehaviorModel，但因設計多樣化，要在FastSPICE在模擬速度與設計容量上已經不敷考量模擬準確度的

2、情況下，把類比電路參數化並SoC的需求。電子設計自動化（ElectronicDesign不容易，而且設計者認為門檻高，學習不易，不Automation,EDA）進而發展出數位模擬器過AnalogBehaviorModel仍是未來可能的趨勢（Verilog）與類比模擬器（SPICE）共同模擬的之一。設計驗證環境，稱為混合模式模擬（Mixed-Mode在改善數位電路的模擬速度與設計容量方Simulation），以改善目前遇到的窘境。然而這面，混合模式模擬則為目前最佳且必要的解法。種混合模式模擬，並非傳統的混合訊號模擬，它要將數位

3、模擬器與類比模擬器結合起來成為同需要處理不同模擬器之間的訊號，在準確度與便一個模擬環境是很困難的一件事，這是因為數位利性方面不易掌握，目前仍然受到IC設計者的電路與類比電路的模擬技術差異很大。數位電路質疑，因此在使用率上並不十分普及。透過本文主要的模擬技術在於event的scheduling，而event的介紹，讀者將對混合模式模擬的技術有更進一所指的是訊號從一個狀態轉成另外一個狀態。在步的認知，對於提高模擬準確度，也有實質上的Verilog中，訊號的狀態分成0，1、X、Z四種。幫助。一個event可以觸發其他event在某

4、一個時間之後發生，而這些時序資訊，便是透過SDFAnnotation1.前言所達成，也就是說，數位電路透過VerilogSimulationModel，並且配合SDF的時序資訊表混合訊號電路設計，常會遇到Verilog設計現其電路行為。和SPICE設計需要共同模擬的問題。過去一般的而類比電路主要的模擬技術在於解電路方程作法，會將Verilog設計轉出SPICE設計，然後式，來計算電壓或電流的數值。電路透過主動元利用SPICESimulator進行Transistor-Level的電件或被動元件的拓撲（Topology），並且

5、配合複路模擬。隨著混合訊號設計日趨複雜，有兩種做雜的SPICEModel來表現其電路行為。由於解方法可以改善類比電路的模擬速度與設計容量，一程式的計算時間相當耗時，許多加速SPICE120系統晶片002期AccurateMixed-ModeSimulationforSoCSimulation的技術也就陸續被提出[1]，這就是大是Verilog的event，當D2A介面元件收到一個0家常聽到的FastSPICE。事實上，模擬速度與模→1的event時，便會依照Modeling的方式，將擬準確度有著相對的利害關係；為了加速模擬，

6、連續的電壓值由輸出端送到電路模擬器。勢必會犧牲一些準確度。因此，就模擬的準確度、速度、和可處理的電路大小來說，邏輯與電路模擬器便有顯著的差異，其應用的範疇也就有所不同。因此，我們可以將各種模擬方式之應用做個總結：假設把混合訊號電路分為smalldsmalla、smalldBigA、BigDsmalla、以及BigDBigA四種類型，其中的A或a代表類比（Analog）設計，D或d代表數位（Digital）設計，則一般EDA圖一D2A介面元件業界的建議如下表：同樣的情形也發生在A2D（Analogto表一混合模式模擬器應用範疇

7、Digital）介面。電路模擬器的運算結果，若要順smalldsmallaSPICESimulation利地傳給邏輯模擬器，則需要A2D介面元件將smalldBigAFastSPICESimulationSPICE的連續電壓值轉成Verilog的Event。其行Mixed-ModeSimulationBigDsmalla為如圖二所示，A2D介面元件的輸入端是SPICESPICE+VerilogCo-Simulation的連續電壓值，當A2D介面元件收到一個由Mixed-ModeSimulationBigDBigAFastSP

8、ICE+VerilogCo-SimulationGND轉成VDD的TransitionCurve時，便會依照Modeling的方式，將Verilog一個0→1的event為了轉換不同模擬器（Verilog和SPICE）之由輸出端送到邏輯模擬器。間的模擬資料，混合模式模擬器有一個重要的特徵，