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时间:2017-11-20
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1、基于VHDL汉明码编译码器的设计与实现目录摘要1第一章绪论31.1研究背景与选题意义31.2研究目标与主要工作31.3论文的内容安排4第二章汉明码及汉明码编译原理42.1纠错编码的基本原理42.1.1分组码基本原理42.1.2分组码的码重和码距52.2汉明码编译原理8第三章VHDL语言与集成环境103.1EDA概念103.2Max+pluxII简介113.3VHDL语言123.3.1基本介绍123.3.2VHDL语言设计的特点123.3.3VHDL语言优势13第四章汉明码编译系统模块设计与实现144.1汉明码编译原理设计144.2系统模块设计144
2、.2.116位比特序列产生与分组模块144.2.2编码模块164.3.3加错模块164.3.4译码与分组模块17第五章系统仿真、调试和结果分析185.116位序列产生与分组模块仿真185.1.1仿真图185.1.2结果分析195.2编码模块仿真195.2.1仿真图195.2.2结果分析195.3加错模块195.3.1仿真图195.3.2结果分析205.4译码与分组串行模块仿真205.4.2结果分析205.5系统仿真205.5.1顶层图205.5.3结果分析25第六章总结25参考文献26附录程序:28山东轻工业学院2011届本科生毕业设计(论文)摘要
3、在通信系统中,要提高信息传输的有效性,我们将信源的输出经过信源编码用较少的符号来表达信源消息,这些符号的冗余度很小,效率很高,但对噪声干扰的抵抗能力很弱。为了提高信息传输的准确性,我们引进了差错控制技术。而该技术采用可靠的,有效的信道编码方法来实现的。纠错码是一种差错控制技术,目前已广泛应用于各种通信系统和计算机系统中,纠错编码主要用于数字系统的差错控制,对于保证通信、存储、媒体播放和信息转移等数字传递过程的质量有着重要意义,是通信、信息类科知识结构中不可缺少的一部分。本文章主要研究了基于VHDL语言的(7,4)汉明码的设计。整个设计包括四个模块:
4、16位序列产生和分组模块,编码模块,加错模块,译码模块。其中加错模块是为了模拟信道干扰人为的给数据添加一位错误,然后通过MAX+plusII10.2软件进行仿真和调试,从而验证了(7,4)汉明码具有纠正一位错码的能力。关键词:编码译码MAX+plusII32山东轻工业学院2011届本科生毕业设计(论文)ABSTRACTInthecommunicationssystem,toenhancetheeffectivenessofinformationtransmission,wewillsourcetheoutputaftersourcecodingwi
5、thfewersymbolstoexpressthesourceofthenewsletter,theredundancyofthesesymbolsisverysmall,veryefficient,butthenoiseweakresistancetointerference.Inordertoimprovetheaccuracyofinformationtransmission,weintroduceerrorcontroltechniques.Thetechnologyusesareliableandeffectivemethodofcha
6、nnelcodingtoachieve.Error-correctingcodeisanerrorcontroltechniqueshavebeenwidelyusedinvariouscommunicationssystemsandcomputersystems,mainlyusedforerror-correctingcodingerrorsindigitalcontrolsystems,toensurecommunication,storage,mediaplayersanddigitaltransmissionofinformationtr
7、ansferthequalityoftheprocessofgreatsignificance,isthecommunications,information-typeknowledgestructureofsubjectsanindispensablepart.Thisarticleintroducesasystematicerror-correctingcodesindigitalsystemsintheuseanddevelopment,aswellasthebasicprinciplesoferror-correctingcodesandm
8、eaningofcommonlyusederror-correctingcodesandclassifiedbriefin
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