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时间:2018-11-20
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1、利用FPGA解决TMS320C54x与SDRAM的接口问题[利用FPGA解决TMS320C54x与SDRAM的接口问题]摘要:介绍了如何利用FPGA设计TMS320C54x系列芯片与TMS62812ASDRAM之间的接口,利用FPGA解决TMS320C54x与SDRAM的接口问题。这种接口方法适合于需要外扩大容量存储器的应用场合。关键词:FPGATMS320C54xSDRM接口在DSP应用系统中,需要大量外扩存储器的情况经常遇到。例如,在数码相机和摄像机中,为了将现场拍摄的诸多图片或图像暂存下来,需要将DSP处理后的数据转移
2、到外存中以备后用。从目前的存储器市场看,SDRAM由于其性能价格比的优势,而被DSP开发者所青睐。DSP与SDRAM直接接口是不可能的。FPGA(现场可编程门阵列)由于其具有使用灵活、执行速度快、开发工具丰富的特点而越来越多地出现在现场电路设计中。本文用FPGA作为接口芯片,提供控制信号和定时信号,来实现DSP到SDRAM的数据存取。1SDRAM介绍本文采用的SDRAM为TMS626812A,图1为其功能框图。它内部分为两条,每条1M字节,数据宽度为8位,故存储总容量为2M字节。所有输入和输出操作都是在时钟CLK上升沿的作用
3、下进行的,刷新时钟交替刷新内部的两条RAM。TMS626812A主要有六条控制命令,它们是:条激尖/行地址入口、列地址入口/写操作、列地址入口/读操作、条无效、自动刷新、自动刷新,电子通信论文《利用FPGA解决TMS320C54x与SDRAM的接口问题》(..)。SDRAM与TMS320C54x接口中用到的命令主要有:MRS、DEAC、ACTV、S626812A的具体说明可以查看其数据手册。2SDRAM与TMS320C54x之间的通用接口图2是DSP与SDRAM的通用接口框图,图中DSPI/F代表TMS320C54x端接口单
4、元,SDRAMTL代表SDRAM端接口控制单元。SDRAM被设置成一次性读写128个字节,而DSP一次只读写一个字节,因而建立了两个缓冲区B0、B1来缓存和中转数据。B0、B1大小都为128字节,而且映射到DSP中的同一地址空间。尽管B0、B1对应于同一地址空间,但对两个缓冲区不能在同一时刻进行合法访问。实际上,当B0被DSP访问时,B1就被SDRAM访问,反之也成立。若DSP向B1写数据,SDRAM就从B0读数据;而当SDRAM的数据写到B0中时,DSP就从B1读数据。两者同时从同一缓冲区读或写都将激发错误。上边所述的数据
5、转移方式有两种好处:一是加速了TMS320C54x的访问速度,二是解决了二者之间的时钟不同步问题。3FPGA中的硬件设计TMS320C54x为外部存储器的扩展提供了下列信号:CLK、CS、AO~A15、D0~D15、RATRB、ISTRB、IS,而SDRAM接收下列信号:CLK、CKE、CS、CQM、之间加上控制逻辑,以便将从DSP过来的信号解释成SDRAM能够接收的信号,图3是用FPGA设计的顶层硬件接口图。图中主要由三个模块:DSP-IQ、DMA-BUF和SD-CMD。其中DSP-IO是DSP端的接口,用来解码TMS32
6、0C54x发送的SDRAM地址和命令。DMA-BUF代表缓冲区BO、B1。SD_CMD模块用来产生SDRAM访问所需的各种信号。DSP_IO模块又包括IO_DMA、DSP_BUF和DSP_READ。IO_DMA产生SDRAM的命令信号,即图3中的DSP_RDY、DSP_SD_RS320C54x与SDRAM的接口问题2 第2篇S320C54x与SDRAM的接口问题3 第3篇浅谈利润管理的合理性 〖预览〗由于现实不成熟的社会经济环境及人们对假账的深恶痛绝,“利润管理”被习惯上理解为非善意的利润操纵。的确在现阶段“利润管理成
7、为一个很消极的词汇,但是凡事都有它的另一面,利润管理也有它的合理性,就象纳税筹划与偷税一样,虽然其目的都是为了节约税费支出,但其实现目的的手段截然不同:前者合法合理,是一种较高水平的理财行为;而后者是以违法和不合理的手段来实现的,承担着较大的法律风险,是一种愚昧的理财行为。 一、利润管理“度”的把握 利润管理是一个中性的概念,其“褒”与“贬”的分水岭就是一个“度”,在这个“度”内是合理的利润管理行为,应该被人们所接受;超过这个“度”就是利润操纵,就应受到惩罚或谴责。这个“度”如何把握是这一行为性质判断的钥匙。借鉴国外学者
8、的研究成果,结合我国企业利润管理行为的现实特征,笔者认为利润管理的“度”应从以下两个方面来把握。 (1)法律制度框架。法律制度是规范企业的经营行为,是企业经营的游戏规则,企业的任何行为都应在符合规则的前提下进行。企业利润管理行为的“度”就是法律制度的框架,在法律、制度、准则允许的范围内所
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