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时间:2018-11-17
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1、第三章MC9S12单片机的内核及片上资源§3-1内核结构及引脚§3-2内部寄存器§3-3堆栈§3-4内部存储器§3-5复位及时钟§3-6中断§3-7最小系统设计内容提要:3.1、MC9S12DG128片上资源MC9S12系列单片机是以速度更快的CPU12内核为核心的单片机系列典型的HC12总线频率为8MHz,而典型的S12总线速度为25MHz总线速度是指CPU执行一条指令的速度。128KFlash,8KRAM,2KEEPROM、2个SCI、2个SPI、1个IIC、2个CAN、16路10位ADC、8路PWM、8路16位定时/计数器、支持单线B
2、DM调试内核外设3.2、内部结构及引脚内核结构—存储器以MC9S12DP256为例256KFLASH12KRAM4KEEPROMMC9S12DG128拥有128K的FLASH,8K的RAM,2K的EEPROM。电压调整模块及相关引脚电压调整模块给内核供电2.5V给电压调整模块及I/O供电5VVREGEN引脚上拉使能电压调整模块,VDD1.2,VDDPLL使用内部2.5V电源VREGEN引脚接地(一般不采用本方式)禁止模块,VDD1.2,VDDPLL接外部2.5V电源VDDR、VSSR:电压调整模块及I/O供电,分别接电源和地,之间要接去耦电
3、容VDD1.2和VSS1.2:用2对引脚为内核供电,之间要接去耦电容使用5v供电的端口有VDDR(41引脚)接+5V VSSR(40引脚)接地 内部电压调整器供电端VDDX(107引脚)接+5V VSSX (106引脚)接地IO驱动供电端VDDA(83引脚)接+5V VSSA(86引脚)接地AD转换器供电端使用2、5v供电的端口有(内部电压调整器开启时不必进行外部供电)VDDPLL(43引脚)接+2.5V VSSPLL(45引脚)接地 锁相环供电端VDD1(13引脚)接+2.
4、5V VSS1(14引脚)接地 内部电源供电端1VDD2(65引脚)接+2.5V VSS2(66引脚)接地 内部电源供电端2此外还有VRH (84引脚) VRL (85引脚) AD转换器参考电压(不得大于5V)时钟和锁相环及相关引脚EXTAL、XTAL:接外部振荡器RESET:接外部复位,低电平有效XFC:接锁相环滤波电容VDDPLL、VSSPLL:锁相环供电引脚。使能电压调整模块(VREGEN上拉)时,该引脚直接去耦电容。模式选择及相关引脚R/W:读写
5、信号,指示总线上数据方向LSTRB:总线模式下低位字节(奇地址)选通ECLK:内部总线时钟输出,一般在宽扩展模式下地址锁存用BKGD(MODC)、MODB(PE6)、MODA(PE5):模式选择NOACC/XCLKS:当前外部总线操作无效模式选择和PORTE复用TEST:保留脚,接地XIRQ:非屏蔽中断IRQ:可屏蔽中断模式选择地址数据总线PORTA和PORTB作为扩展模式下的数据和地址复用总线,寻址达到64K范围窄模式下:PORTA为8位数据总线宽模式下:PORTA、PORTB为16位数据总线PTK为扩展存储器超过64K时用,不扩展时作为
6、普通I/O口。MCU片上集成了十余个I/O接口,其中有通用并行I/O口(一般每口8个外部引脚)以及SCI、PWM、ADC、I2C、CAN等专用子系统。PTA、PTB、PTE、PTH、PTJ、PTS、PTP、PTK、AD0、AD1接口。复位后所有I/O引脚默认设置为通用I/O输入,当专用子系统激活后,自动变更为专用功能。A/B:在扩展方式下为地址数据分时复用总线;在单芯片模式下为通用I/O。ATD模块及相关引脚VRH、VRL:参考高压和参考低压,一般接5V(隔离)和GND(单点共地)。VDDA、VSSA:A/D模块电源引脚。AN0-AN7:模
7、拟量输入引脚,8个通道。作普通I/O时,只能输入,不能输出。定时器及相关引脚IOC0-7:输入捕获:捕获外部有效边沿输出比较:输出一定宽度的脉冲作为普通I/O口时,为PORTT,输入输出。SPI、PWM及相关引脚2个SPI口MISO:主机输入/从机输出MOSI:主机输出/从机输入SCK:同步时钟(主机提供,从机接受)SS:从机选择(1-主机,0-从机)PWM0-7:PWM模块8个通道作为普通I/O:PORTP异步串行口及相关引脚2个SCI:RXD:数据接收TXD:数据发送1个SPI1个BDLC4(5)个CAN:RXCAN接收、TXCAN发送
8、作为普通I/O使用:PORTS,PORTM中断I/O口作为普通并行I/O口:PORTJ、PORTHPJ口和PH口可以作为中断口:可选择上升或者下降沿中断;PJ6和PJ7与I2C和
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