《数字逻辑》课程设计

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1、课程设计报告课程名称：设计题目：姓名：系：专业：年级：学号：指导教师：职称：20年月日9评语：评定指标等级评分成绩1．设计方案正确，具有可行性、创新性（20分）优良中差2．独立进行实验工作；能运用所学知识和技能去发现与解决实际问题；能正确、科学地分析和处理实验数据；测试结果准确。（40分）优良中差3．能够按时提交课程设计，并按照要求演示课程实习内容，态度认真（20分）优良中差4．文档符合标准，有条理，文笔通顺，格式正确。课程实习有自己的收获、体会、感受（20分）优良中差评定结果符合总成绩（100分）不符合成绩：指导教师签字：任务下达日期：2012年12月17日

2、评定日期：9目录1课程设计题目名称…………………………………………………………41.1……………………………………………………………………………41.2……………………………………………………………………………41.3……………………………………………………………………………41.4……………………………………………………………………………42课程设计的要求……………………………………………………………42.1……………………………………………………………………………42.2……………………………………………………………………………42.3…………………………

3、…………………………………………………43课程设计的内容……………………………………………………………43.1……………………………………………………………………………43.2……………………………………………………………………………53.3……………………………………………………………………………53.4……………………………………………………………………………73.5……………………………………………………………………………84总结…………………………………………………………………………94.1……………………………………………………………………………94

4、.2……………………………………………………………………………95参考文献……………………………………………………………………99课程设计题目名称1.课程设计的目的1．在学完了《数字电子技术基础》课程的基本理论，基本知识后，能够综合运用所学理论知识、拓宽知识面，提高动手能力，提高分析问题和解决问题的能力。2．熟悉集成电路的引脚安排，掌握各芯片的逻辑功能及使用方法了解面包板结构及其接线方法，了解数字钟的组成及工作原理。3.学习各种元件的用途和使用方法，培养独立思考、查找资料和设计数字电路的能力。4.学习书写课程设计的能力，掌握清晰的电路设计思路，了解电路设计的功

5、能。2.课程设计的要求1．输入10HZ的时钟；2．能显示时、分、秒，24小时制；3．时和分有校正功能。3.课程设计内容总述：设计时钟的总体分为：各电路模块的设计，单元电路的设计，电路的测试，电路的校验，电路的仿真。3.1总体方案的设计（1）频率的选择，选择频率的10hz的，如图如下：（2）计数器秒信号经秒计数器.分计数器.时计数器之后，分别得到“秒”个位十位，“分”个位十位，以及“时”个位十位输出信号，然后送至显示电路，以便实现用数字显示时.分.秒的要求。“秒”和“分”计数器应为六十进制，而“时”计数器为二十四进制。采用计数器74LS160N来实现时间计数单元

6、的计数功能。（3）组合成数字钟9数字总系统的组成由两个六十进制和二十四进制电路构成的数字钟。（4）校正电路数字钟应具有分校正功能，把开关调至一端时，直接由信号发生器产生的信号，构成正确的数字时钟电路。调至另一端时，实现校正电路功能。3.2各模块设计（1）60进制电路的设计，电路图如下所示：（2）24进制电路图的设计，电路图：（3）校正电路的设计：3.3单元电路的设计（1）秒信号经秒计数器.分计数器.时计数器之后，分别得到“秒”个位十位，9“分”个位十位，以及“时”个位十位输出信号，然后送至显示电路，以便实现用数字显示时.分.秒的要求。“秒”和“分”计数器应为六

7、十进制，而“时”计数器为二十四进制。采用计数器74LS160N来实现时间计数单元的计数功能。①．小时的设计电路：②．分钟，秒钟的设计电路：（2）组合成电路图如下：数字总系统的组成由两个六十进制和二十四进制电路构成的数字钟。9（3）校正电路图如下：数字钟应具有分校正功能，把开关调至一端时，直接由信号发生器产生的信号，构成正确的数字时钟电路。调至另一端时，实现校正电路功能。3.4总体电路图和工作过程（1）总电路图：该电路图，由24进制和60进制的电路组成，其中用到了显示管6个，74LS160N六块，频率发生器两个，74LS10D一个，74LS20D两个，开关两个，

8、导线若干。连接电路图，测试结果的准确性