基于fpga的数字秒表设计

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1、基于FPGA的数字秒表设计摘要：该设计是用于体育比赛的数字秒表，基于II9.0sp2软件下应用VHX语言编写程序,采用ALTRA公司Cyclonell系列的EP2C8C?08芯片进行了计算机仿真，并给出了相应的仿真结果。本设计有效的克服了传统的数字秒表的缺点采用ECA技术采取自上而下的设计思路。绘制出了具体的逻辑电路，最后又通过硬件上对其进行调试和验证。该电路能够实现很好的计时功能,计时精度高，最长计时时间可达一个小时。关键字：数字秒表；ECA;FPG;VhCL;QuartusIIThedesign

2、ofdigitalstopwatchbasedonFPGAAbstract：ThisdesignisadigitalstopwatchwhichisusedforathleticcontestsandisbasedonFPGAusingVHDLlanguagetowriteprograminQuartusIIsoftware,adoptingEP2C8Q208chipofCyclonellseriesofALTRAcompanyforcomputersimulationandatthesametime

3、showingthecorrespondingsimulationresult.Thisdesigneffectivelyovercomesthetraditionaldigitalstopwatchweaknessesandtakesatop-downapproachtodesign.Drawoutaparticularlogiccircuits,andfinallypassthecircuitstothehardwaretodebugandverifyit.Thiscircuitisabletoc

4、arryoutexcellenttimingfunction,hashightimingprecision,andthelongesttimingtimecouldreachanhour.KeyWords:Digitalstopwatch；EDA；FPGA；VHDL；MAXPlusII引言数字秒表是tl常生活屮比较常见的电子产仏，其设计也是EDA技术屮最基木的设计实验之一［1当今社会是数字化的社会，是数字集成电路广泛应用的社会。数字集成电路木身在不断进行更新换代，随着微电了技术的发展，设计与制造集成

5、电路的任务已不完全由半导体厂商来独立承担。系统设计师更愿意自己设计专业集成电路(ASIC)芯片,而且希望设计周期尽可能短，最好在实验室里就能设计出合适的ASIC芯片并且立即投入实际应用之中，因而出现了现场可编程器件[2](FPLD)。现场可编程门阵列(FPGA)即属其屮应用最广泛的一种。超高速硬件描述语言VHDL,是对数字系统进行抽象的行为与功能描述到具体的内部线路结构描述，利用EDA工具可以在电子设计基于FPGA的数字秒表设计摘要：该设计是用于体育比赛的数字秒表，基于II9.0sp2软件下应用VHX

6、语言编写程序,采用ALTRA公司Cyclonell系列的EP2C8C?08芯片进行了计算机仿真，并给出了相应的仿真结果。本设计有效的克服了传统的数字秒表的缺点采用ECA技术采取自上而下的设计思路。绘制出了具体的逻辑电路，最后又通过硬件上对其进行调试和验证。该电路能够实现很好的计时功能,计时精度高，最长计时时间可达一个小时。关键字：数字秒表；ECA;FPG;VhCL;QuartusIIThedesignofdigitalstopwatchbasedonFPGAAbstract：Thisdesignis

7、adigitalstopwatchwhichisusedforathleticcontestsandisbasedonFPGAusingVHDLlanguagetowriteprograminQuartusIIsoftware,adoptingEP2C8Q208chipofCyclonellseriesofALTRAcompanyforcomputersimulationandatthesametimeshowingthecorrespondingsimulationresult.Thisdesign

8、effectivelyovercomesthetraditionaldigitalstopwatchweaknessesandtakesatop-downapproachtodesign.Drawoutaparticularlogiccircuits,andfinallypassthecircuitstothehardwaretodebugandverifyit.Thiscircuitisabletocarryoutexcellenttimingfunc