8位全加器课程设计

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1、硬件技术课程设计课题名称8位全加器的设计与实现组名组员班级1201专业计算机科学与技木指导教师计算机学院2014年12月课题四、8位全加器的设计与实现一、设计任务及要求：1.设计和实现8位全加器，并完成编译、综合、适配、仿真和在GW48-CP++实验平台上，实验测试，即选择电路模式N0.1;键2、键1输入8位加数；键4、键3输入8位被加数;数码管6和数码管5显示加和；D8显示进位COUT。2.请画出时序仿真图3.进行必要的数裾测试2014年12月10日二、成绩:设计报告调试答辩合计指导教师签名：2014年月日目录一、

2、设计目的1二、设计内容1三、实验原理图1半加器原理图11位全加器原理图14位全加器原理图28位全加器原理图2锁引脚图3四、设计与说明3五、时序仿真4六、实验步骤5七、设计总结8八、参考文献88位全加器的设计与实现一、设计目的1、掌握运用MAX+plusII原理图编辑器进行层次电路系统设计的方法。2、进一步熟悉利用MAX+plusII进行电路系统设计的一般流程。3、掌握8位全加器原理图输入设计的基本方法及过程。二、设计内容一个8位企加器可以由8个1位全加器构成，加法器间的进位可以以串行方式实现，即将低位加法器的进位输出

3、emit与相邻的尚位加法器的最低进位输入信号cin相连接。而一个1位全加器则可由实验一包装元件入库得到。三、实验原理图半加器原理图：4位全加器原理图:AOOnnnn:B)典JL□owrb4^ITa2TT：^=ES(=^-^..v...v»••••••••••••••»•»•••••••••:油i=Hf^xjMessageOof16ForKelp,pressFIAJ*JI:h5l3•»•••-combnsvndnhsiancouttxnstmon«ncoutbinsvnoninstl«ncovibnsun6nmsi2

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