可编程逻辑实验报告

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1、西安邮电大学可编程逻辑实验报告系别电院学号05114121成绩班级光电1104班姓名教师签字实验名称用原理图输入法设计门电路一：实验目的1.掌握PLD芯片的基本使用方法，熟悉EDA软件MAX+PLUSⅡ操作。2.学会利用软件方针和硬件实现对数字电路的逻辑功能进行验证和分析。3.能够利用CPLD器件开发具有基本与非逻辑功能的数字电路。二：实验所用仪表及主要器材PC，EDA软件MAX+PLUSⅡ。三：实验原理简述（原程序、真值表、原理图）及实验测量记录（数据、仿真波形图及分析、原程序分析、硬件测试实分析）实验一：用原理图输入法实现F

2、=和F=AB+CD逻辑电路，要求原理图输入、编译并仿真。(1)F=ABF001011101110真值表仿真结果图(2)F=AB+CD真值表ABCDF00000000100010000111010000101001100011111000010010101001011111001110111110111111仿真结果图西安邮电大学可编程逻辑实验报告系别电院学号05114121成绩班级光电1104班姓名雷晓丹教师签字实验名称用文本输入法设计门电路一：实验目的1.进一步熟悉MAX+plusII软件，学习用文本输入法设计电路。2.进一步

3、熟悉CPLD数字电路设计流程。3.学习初步的VHDL程序设计方法。二：实验所用仪表及主要器材PC，可编程逻辑电路板，下载线，USB电源线，双踪示波器，数字万用表，导线若干三：实验原理简述（原程序、真值表、原理图）及实验测量记录（数据、仿真波形图及分析、原程序分析、硬件测试实分析）实验二：用VHDL实现或非门、同或门。(1)或非门F=真值表ABF001010100110原程序libraryieee;useieee.std_logic_1164.all;entitynor2isport(a,b:instd_logic;y:outst

4、d_logic);end;architecturerel_1ofnor2isbeginy<=anorb;end;仿真结果图(2)同或门F=真值表ABF001010100111原程序libraryieee;useieee.std_logic_1164.all;entityxnor2isport(a,b:instd_logic;y:outstd_logic);end;architecturerel_1ofxnor2issignalh:std_logic;beginh<=axorb;y<=noth;end;仿真结果图实验三：（1）多数

5、表决电路设计：当输入A、B、C、D有3个或3个以上为1时输出F为1；输入为其他状态时输出为0。真值表ABCDF00000000100010000110010000101001100011111000010010101001011111000110111110111111原程序libraryieee;useieee.std_logic_1164.all;entitytext6isport(a:instd_logic_vector(3downto0);y:outstd_logic);end;architecturereloftext

6、6isbeginprocess(a)begincaseaiswhen"0000"=>y<='0';when"0001"=>y<='0';when"0010"=>y<='0';when"0011"=>y<='0';when"0100"=>y<='0';when"0101"=>y<='0';when"0110"=>y<='0';when"0111"=>y<='1';when"1000"=>y<='0';when"1001"=>y<='0';when"1010"=>y<='0';when"1011"=>y<='1';when"1100

7、"=>y<='0';when"1101"=>y<='1';when"1110"=>y<='1';when"1111"=>y<='1';whenothers=>y<='Z';endcase;endprocess;end;仿真结果图（2）代码转换电路设计：要求输入为8421BCD码，输出为余3码。代码转换电路代码转换表数字输入（8421BCD码）输出（余3码）数字输入（8421BCD码）输出（余3码）X3X2X1X0Y3Y2Y1Y0X3X2X1X0Y3Y2Y1Y001234000000010010001101000011010001

8、0101100111567890101011001111000100110001001101010111100原程序useieee.std_logic_1164.all;entitydaimaisport(a:instd_logic_vector(3downto