10数字逻辑实验指导书

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1、实验报告要求本课程实验报告要求用电子版。每位同学用自己的学号+班级+姓名建一个文件夹（如2010xxxxxxx网络3班张三），再在其中以“实验x”作为子文件夹，子文件夹中包括WORD文档实验报告（名称为“实验x实验报告”，格式为实验名称、实验目的、实验内容，实验内容中的电路图用EWB中电路图复制粘贴）和实验中完成的各EWB文件（以其实验内容命名）。25实验一电子电路仿真方法与门电路实验一、实验目的1．熟悉电路仿真软件EWB的使用方法。2．验证常用集成逻辑门电路的逻辑功能。3．掌握各种门电路的逻辑符号。4．了解集成电路的外引线排列及其使用方法。5.掌握用EWB设计新元件的方法

2、。二、实验内容1．用逻辑门电路库中的集成逻辑门电路分别验证二输入与门、或非门、异或门和反相器的逻辑功能，将验证结果填入表1.1中。注：与门型号7408，或门7432，与非门7400，或非门7402，异或门7486，反相器7404.表1.1门电路逻辑功能表输入输出与门或门与非门或非门异或门反相器BAL=ABL=A+B000110112用逻辑门电路库中的独立门电路设计一个8输入与非门，实现，写出逻辑表达式，给出电路图，并验证逻辑功能填入表1.2中。表1.28输入与非门逻辑功能表输入输出LABCDEFGH11111111011111110011111100011111000011

3、11000001110000001100000001000000003.用逻辑门电路库中的独立门电路设计一个与或非门，实现，写出逻辑表达式，给出电路图，并验证逻辑功能填入表1.2中。表1.28输入与非门逻辑功能表输入输出LABCDEFGH11111111011111110011111100011111000011110000011100000011000000010000000025实验二组合逻辑电路设计实验目的1.掌握组合逻辑电路的设计方法2.掌握全加器的逻辑功能3.掌握数据选择器的逻辑功能及用数据选择器实现逻辑函数的方法4.掌握七段显示数码管的原理及显示译码器的设计方法

4、。实验内容1.用逻辑门电路库中的独立门电路设计一个全加器电路，写出各输出端的逻辑表达式，给出电路图并验证其逻辑功能填入表2.1中。表2.1全加器逻辑功能表输入输出ABCi-1SCo00000010101001011001001100110110101111112.用数据选择器74151和适当的门电路实现全加器的逻辑功能，给出电路图并验证其逻辑功能与表2.1比较结果是否一致。3.用逻辑门电路库中的独立门电路设计一个十六进制共阴极7段显示译码器，其译码输出真值表如表2.2所示，写出各输出端的逻辑表达式，给出其电路图，并用EWB仿真验证其功能。2525实验三编码器及其应用实验目的

5、掌握优先编码器的逻辑功能，学会编码器的级联扩展应用。实验内容1.验证优先编码器4532的逻辑功能，给出接线电路图，并按表3.1输入编码信号，将各输出端测试结果填入表3.1中。表3.1优先编码器4532逻辑功能表输入输出EII7I6I5I4I3I2I1I0Y2Y1Y0GSEO0╳╳╳╳╳╳╳╳10000000011╳╳╳╳╳╳╳101╳╳╳╳╳╳1001╳╳╳╳╳10001╳╳╳╳100001╳╳╳1000001╳╳10000001╳1000000012.用2片4532级联扩展实现16线-4线编码器的逻辑功能，画出逻辑电路图，给出EWB接线电路图，并验证其逻辑功能填入表3.2

6、。设编码输入信号为A15~A0，编码输出信号为L3~L0。表3.216线-4线优先编码器逻辑功能表输入输出EIA15A14A13A12A11A10A9A8A7A6A5A4A3A2A1A0L3L2L1L0GSEO0╳╳╳╳╳╳╳╳╳╳╳╳╳╳╳╳1000000000000000011╳╳╳╳╳╳╳╳╳╳╳╳╳╳╳1001╳╳╳╳╳╳╳╳╳╳╳╳╳100001╳╳╳╳╳╳╳╳╳╳╳100000010╳0╳╳╳╳╳╳10000000010╳╳╳╳╳╳100000000001╳╳╳╳╳10000000000001╳╳╳1000000000000001╳100000000000000

7、0125实验四译码器及其应用实验目的掌握译码器的逻辑功能、级联扩展方法及实现逻辑函数的方法实验内容1.验证3-8译码器74138的逻辑功能，给出接线电路图，并按表4.1输入编码信号，将各输出端测试结果填入表4.1中。表4.13-8译码器74138逻辑功能表输入输出0XXXXX11XXXX1X1XXX1000001000011000101000111001001001011001101001112.用2片74138级联扩展实现4线-16线译码器的逻辑功能，画出逻辑电路图，给出EWB接线电路图，并验证其逻辑功能填入表4