第三十六页译文

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1、第三十六页译文：表19.地址映射定义A2-0寄存器0保持寄存器0。转移至32位目标寄存器的7-0位。第0位是此32位寄存器的最低有效位。1保持寄存器1。转移至32位目标寄存器的15-8位。2保持寄存器2。转移至32位目标寄存器的23-16位。3保持寄存器3。转移至32位目标寄存器的31-24位。第0位是此32位寄存器的最高有效位。4目标地址寄存器。第四个时钟之后紧跟着一个对寄存器的写操作，保持寄存的内容被转移到目标寄存器。所有被写入到此寄存器的8位被解码到目标寄存器地址。目标寄存器映射配置将在字的控制部分中的表给出。5选择数据源以便读取。见微处理器读取部分如果一个十六进制数(

2、0018D038)H需要被加载到控制字0，则表20详细说明将采取的步骤。表20.处理器写序列实例步骤A(2:0)C(7:0)备注100000111000在WR上升沿加载38到总寄存器(7:0)位。200111010000在WR上升沿加载D0到总寄存器(15:8)位。301000011000在WR上升沿加载18到总寄存器(23:16)位。401100000000在WR上升沿加载00到总寄存器(31:24)位。510000000000在配置控制寄存器0加载入0018D0386等4个时钟周期。图42.32位字控制的控制寄存器装载微处理器读取微处理器读同时使用读取和写入程序，以便从P

3、DC获取数据。写入操作必须在位置5处完成，以便选取读取的数据来源。读取源是由置于C(7:0)低三位的值确定的。特定的阅读代码的输出用置于A(2:0)的读取地址选中。RD下降沿时输出被送至C(7:0)。如果读取地址等于111，读取码则被忽略，并且在输出那一部分表22中提到的状态位被送至C(7:0)。这是为了使用户可以迅速获取状态位。见图43的时序图，假设输入电平探测器有一个十六进制值(321AF5)H，表21将详细说明采取的步骤。图43.读控制寄存器使用等于5的锁码，读取地址和读取码表21.处理器读取序列步骤A(2:0)C(7:0)步骤1101100读写码，从100至地址5，W

4、R拉高以产生上升沿200011111000(F4)HRD降低，读AGC的LSB位300100011010(1A)HRD拉高再降低，读AGC的NLSB位401000110010(32)HRD拉高再降低，读AGC的MSB位第三十七页译文：表22.地址映射定义读取码C2-0状态类型读取地址A(2:0)0缓冲RAMI和Q000-ILSB001-IMSB010-QLSB011-QMSB见输出部分1缓冲RAM输出(

5、r

6、andf)000-MAGLSB(7-0)001-MAGMSB(15-8)010-PHASELSB(7-0)011-PHASEMSB(15-8)2缓冲频率000-FREQL

7、SB001-FREQMSB3未用4输入电平探测器输入AGC000-输入AGCLSB(0-7)001-输入AGCNLSB(8-15)010-输入AGCMSB(16-23)5AGC数据和时序误差AGC（必须写至位置10出以采样）000-AGCLSB(被乘法器用到的第3线性控制字节的低8位)mmmmmmmmLSB001-AGCLSB(4个移位控制位及前3个线性控制位)控制字节oeeeemmmMSB。它产生线性控制尾数的11比特位。010-时序误差LSB，不稳定011-时序误差MSB，不稳定6未用7未用任意状态111-(6:0)状态位，当输出为先入先出缓冲RAM输出方式时，由（6:4

8、）FIFO组成(3)空标志，指明FIFO为空且读指针不能前进（高电平激活）(2)满标志，指明FIFO为满且新采样不能写入（高电平激活）(1)准备位,FIFO模式下输出缓冲已到达设置好的起始端或者一定数目的样本已经置于采样状态（低电平激活）(0)综合位，在输入电平探测器完成并准备开始读（高电平激活）应用合成滤波反映实例如图44，在这个例子中，共收到大约25MHz的波段，它包含124200kHz频分多路复用（PDC）全频道。PDC的设计目标是调整并筛选出一个单一的200kHzPDC信道，在基带处理器上基带采样以270.8Kbps的比特率通过。图44.接收信号频谱射频/中频注意事项

9、PDC的输入频率取决于A/D转换器的选择，射频/中频频率，带宽的影响和转换器的采样速率。如果A/D转换器有足够的带宽，在数字化过程中欠采样技术可以用于中频/射频频率的降频，使用的PDC来处理频率较低的输入信号的别名。例如，70MHz中频可以在40MHz采样，由此产生的10MHz信号别名可以经PDC处理，执行理想的降频/调节和滤波。如果IF信号小于1/2的采样频率，那么标准过采样技术可以用来处理信号。这两个技术，只有欠采样技术允许部分降频转换功能仅仅通过采样被带入数字域，这种情况下，我们假定采样频率可以保