数字逻辑专题实验报告

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1、数字逻辑专题实验实验报告基于CPLD／FPGA的出租车计费器的设计数字逻辑实验——基于CPLD／FPGA的出租车计费器一.实验题目设计一个基于CPLD／FPGA的出租车计费器，并实现如下功能：1.A计数器对百米脉冲进行累加，并输出实际公里数的BCD码给译码动态扫描模块。每计满500送出一个脉冲给B计数器。同时可以设置起步公里数。2.B计数器实现步长可变(即单价可调)的累加计数，每500米计费一次。可以设置起步价格、每公里价格等。3.译码／动态扫描将路程与计费的数值译码后用动态扫描的方式驱动数码管显示。4.数码管显示将公里数

2、和计费金额分别用三位LED数码管显示(两位整数，1位小数)。二.实验目的1.学会综合运用组合逻辑、时序逻辑设计数字系统电路的方法2.学会使用EDA软件（MAX+PLUSII）设计调试电路的方法3.掌握CPLD（复杂可编程逻辑器件）技术的层次化电路设计4.掌握计数器、加法器、寄存器、锁存器及各种门的综合应用18数字逻辑实验——基于CPLD／FPGA的出租车计费器一.系统设计方案1.系统设计总体图图1系统设计总体图2.系统整体输入输出定义1）10hz_input_by_wheet系统从这里输入出租车前进时轮胎上传感器发出的信号

3、，本系统中假设出租车每前进一米，该输入收到一个脉冲。2）1khz系统从这里输入1kHz信号，作为数码管的扫描信号。3）resetreset信号输入为0时，表示出租车空驶；为1时表示出租车上有乘客。4）abcdefg及led1-6系统结果输出端，分别连接实验装置中数码管的abcdefg输入及各数码管的控制输入。18数字逻辑实验——基于CPLD／FPGA的出租车计费器1.系统各模块功能简介1）Output_per100_inputs基本计数模块。每输入100个脉冲时，输出一个脉冲，即每100米输出一个脉冲。2）Distance

4、_counter_output出租车路程计算及输出模块。每100米输入一个脉冲之后，自动按BCD码输出计价器中十公里位、公里位、百米位需要显示的数字。3）After_2km_output_per500m控制计费器模块什么时候开始计费。当出租车上乘客后，计费器只输出初始价，当车行进到2公里（可设置其他数值）时，计费器才开始按每公里的单价累加计费。此需要模块每100米输入一个脉冲，同时还要车行进到2公里时输入一个买脉冲。4）Price_counter_output出租车计费及输出模块。需要两公里之后每500米输入一个脉冲，自动

5、按BCD码输出计价器中十元位、元位、角位需要显示的数字。5）Display_to_6led将路程及计费模块输出的数字显示到数码管中的模块，输入BCD码的各位，输出为数码管显示时需要的信号。18数字逻辑实验——基于CPLD／FPGA的出租车计费器1.各模块功能图及输入输出分析图1）Output_per100_inputsa模块功能图图2output_per100_inputs模块功能图此模块使用74162作为主要元件，经过实验，我发现将RCO接在高位计数器的ENT端后，虽然进位不会错，但是仍然为每输入99次输出一个脉冲，达不

6、到实际要求。故此处从另外一个思路进行设计：当所有的数字都是0的时候，输出一个脉冲。同时为了控制第一个脉冲的输出时间，避免在开始计数前所有输出位都是0的时候output_per100inputs输出脉冲，通过一个JKFF2控制。当输出行进10米时，JKFF2的Q输出才变为1，这时output_per100inputs才能输出脉冲，准确的控制了输出。18数字逻辑实验——基于CPLD／FPGA的出租车计费器a输入输出分析图图3output_per100inputs模块输入输出分析图1从图中可以看到，在reset为0及刚刚变为1时

7、，output_per100inputs并没有输出脉冲，符合需要。图4output_per100inputs模块输入输出分析图2从图中可以看到，在distance_10m,distance_1m输出都为9（即99米）时，output_per100inputs并没有进位，当再输入一个脉冲即到达100米后，output_per100inputs立刻输出一个脉冲，完成了在到达100米时输出一个脉冲的功能，准确无误。而此处如果为每99米输出一个脉冲的话，对后续里程及价格计算将会有很大影响。18数字逻辑实验——基于CPLD／FPGA

8、的出租车计费器1）Distance_counter_outputa模块功能图图5Distance_counter_output模块功能图将前一个模块每一百米输出一个脉冲的信号接在此模块的input_per100m输入端，输出即为可以直接用于显示输出的十进制BCD码十公里、公里、百米数字。此模块仍使用74