基于fpga和dsp的被动雷达信号分选处理器的设计

基于fpga和dsp的被动雷达信号分选处理器的设计

ID:15344136

大小:778.28 KB

页数:4页

时间:2018-08-02

基于fpga和dsp的被动雷达信号分选处理器的设计_第1页
基于fpga和dsp的被动雷达信号分选处理器的设计_第2页
基于fpga和dsp的被动雷达信号分选处理器的设计_第3页
基于fpga和dsp的被动雷达信号分选处理器的设计_第4页
资源描述:

《基于fpga和dsp的被动雷达信号分选处理器的设计》由会员上传分享,免费在线阅读,更多相关内容在学术论文-天天文库

1、20现代电子技术2011年第34卷基于FPGA和DSP的被动雷达信号分选处理器的设计王丽(中国空空导弹研究院,河南洛阳471009)摘要:介绍了基于DSP和FPGA的末制导雷达信号处理机分选软硬件的设计及实现,该系统以一片DSP为主处理器,配合FPGA及其他外围电路用于实现雷达信号的分选跟踪。由于采用DSP+FPGA,不仅很好地实现了实时性,而且系统集成度高,可靠性好,易于修改,使用灵活,因此具有较强的实用价值和参考价值。关键词:信号分选;被动雷达;脉冲描述字;脉冲重复频率中图分类号:TN957.52-34文献标识码:A文章编号:1004-373X(2011)23-0020

2、-03DesignofDigitalSignalClassificationProcessorinPassiveRadarSystemBasedonFPGAandDSPWANGLi(ChinaAviationMissileAcademy,Luoyang471009,China)Abstract:ThehardwareandsoftwaredesignofsignalclassificationprocessorinpassiveradarbasedonDSPandFPGAareintroduced.ThesystemusedDSPasmainprocessor,combin

3、edFPGAwithotherperipheralcircuitstorealizedradarsig-nalclassificationandtracking.Thereal-timeperformanceisachieved,andthesystemhashighintegrityandreliabilitybyusingDSPandFPGA.Thesystemiseasytobemodifiedandflexible,whichhaspracticalvalueandreference.Keywords:signalclassification;passiverada

4、r;PDW;PRI本功能是处理数字系统传来的数据,用各种信号处理方0引言法完成目标的实时检测、截获、跟踪和识别等,输出处理雷达信号处理机的被动工作模式是一种基于对敌结果。为了适应各种应用要求,信号处理算法复杂,对方目标雷达的信号进行检测和分析、从中获得敌方雷达信号处理机的处理能力提出了很高的要求。目标信息的系统。这种工作模式下,雷达本身不发射任整个信号分选处理系统框图如图1所示。整个系何电磁波,而是通过接收和处理敌方目标雷达的电磁辐统以一片DSP为主处理器,配合FPGA及其他外围电射信号,提取目标雷达的频域、空域和时域信息来对目路设计出用于实现雷达信号分选跟踪的处理器。其中

5、,标实施信号分选、定位、跟踪和识别。信号的分选是提DSP主要用于实现整个分选算法,并与飞控系统(设取单部雷达脉冲序列,来实现对目标的跟踪。被动工作备)进行通信及数据交换,同时给跟踪器装载相关参数;模式使末制导雷达具有掩蔽自己、不受敌方干扰、探测FPGA主要负责系统中的译码电路、信号预分选中信号距离远、目标识别能力强等一系列特点。实际电磁环境参数的测量、缓冲存储读取,根据DSP装订的参数装订中,单部雷达信号重频和载频的跳变给脉冲序列的实时滤波器,滤掉不符合目标特征的脉冲,然后进行采样和精确提取带来了很大难度。同时,如何保证在没有装定分选,及信号跟踪器中根据DSP装订的参数装订

6、滤波目标情况下的目标跟踪,也是电子对抗要研究的课题。器,滤掉不符合目标特征的脉冲然后进行跟踪,并输出基于此,本文介绍了基于DSP和FPGA的末制导雷达跟踪波门;SDRAM则用于存储由分选硬件得到的原始信号处理机的分选软硬件设计方法及实现。脉冲参数,弥补DSP存储空间不够的问题;FLASH芯1硬件设计片用于存储上电给DSP加载的程序代码。1.2FPGA及其外围电路1.1系统简介信号处理机系统作为雷达信号处理系统的核心,基FPGA采用Xilinx公司的XC4VLX25SF363,它是Virtex-4系列中的一款针对高性能逻辑设计应用的芯收稿日期:2011-06-13片。它包含了

7、24192个逻辑单元,10752个Slices,168个第23期王丽:基于FPGA和DSP的被动雷达信号分选处理器的设计21分布式RAM和最大1296KB的嵌入式块RAM。FP-给DSP,经过DSP分选之后,将要跟踪的雷达参数装载GA的外部配置PROM芯片为XCF08P,它的容量为至FPGA,实现对雷达的跟踪。8Mb,封装为VO48/VOG48或FS48/FSG48,这里为了FPGA的程序主要包括以下几个部分:数据的传输节省空间采用了BGA封装FSG48,支持串行和并行配与译码模块,数据锁存模块,参数测量模块,FI

当前文档最多预览五页,下载文档查看全文

此文档下载收益归作者所有

当前文档最多预览五页,下载文档查看全文
温馨提示:
1. 部分包含数学公式或PPT动画的文件,查看预览时可能会显示错乱或异常,文件下载后无此问题,请放心下载。
2. 本文档由用户上传,版权归属用户,天天文库负责整理代发布。如果您对本文档版权有争议请及时联系客服。
3. 下载前请仔细阅读文档内容,确认文档内容符合您的需求后进行下载,若出现内容与标题不符可向本站投诉处理。
4. 下载文档时可能由于网络波动等原因无法下载或下载错误,付费完成后未能成功下载的用户请联系客服处理。