《数字电子技术》黄瑞祥 第五章习题答案

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1、第五章习题答案5-1分析题5-1图所示电路，画出时序图和状态图，起始状态Q0Q1Q2Q3=0001。解：状态图：CPQ0Q1Q2Q30000111000201003001040001时序图：CPQ0Q1Q2Q35-2分析题5-2图所示电路，画出电路的状态图。解：状态图:CPQ0Q1Q2000011002010300140005-3JK触发器组成5-3图所示电路。分析该电路为几进制计数器，并画出电路的状态图。解：状态图：CPQ1Q2Q3000011002010311040015000该电路为五进制计数器5-4JK触发器促成如图5-4图所示的电路。（1）分析该电路为几进制计数器，画出状态图。（2）

2、若令K3=1，电路为几进制计数器，画出其状态图。解：（1）CPQ1Q2Q301234567000100010110001101011000为7进制计数器(2)CPQ1Q2Q3012345000100010110001100为4进制计数器5-5试画出题5-5图（a）所示电路中B,C端的波形。输入端A,CP波形如题5-5图(b)所示，触发器的起始状态为零。12345678910111213141516171819CPAQ0Q1BC5-6分析题5-6图所示电路，画出电路的状态图，说明电路能否自启动。解：状态图：CPQ1Q2Q3Z012345670100001010111001111000110001

3、00101000101000该电路能够自启动5-7分析题5-7图所示电路，画出电路的状态图，说明电路能否自启动。CPQ4Q3Q2Q10123456701010101010101010100000001100111011110011110111101001000010011100101000011010110110110001110000101101001011100011111111110由状态图可见，电路图能够自启动5-8画出题5-8图所示电路的状态图和时序图，简要说明电路的基本功能。解：状态图：功能分析：根据状态图可知：电路为三位格雷码发生器。5-9画出题5-9图所示的状态图和时序图。解：

4、状态图：时序图：5-10如题5-10图所示，FF0为下降沿触发的JK触发器，FF1为上升沿触发的D触发器，试对应给定的RD，CP,J,K的波形，画出Q0,Q1的波形。5-11试用下降沿触发的JK触发器设计一个同步时序电路，要实现的状态图如题5-11图所示。解：电路图：5-12试用上升沿触发的D触发器和与非门设计一个同步时序电路，要实现的状态图如题5-12图所示。解：电路图如下：5-13试用下降沿触发的边沿型JK触发器和与非门，设计一个按自然态序进行的七进制同步加法计数器。解：电路图：5-14试用上升沿触发的边沿型D触发器和与非门，设计一个按自然态序进行计数的十进制同步加法计数器。解：电路图：5

5、-15试用JK触发器设计一个同步十进制计数器，要实现的状态图如题5-15图所示。解：电路图如下：5-16试设计一个具有如题5-16图所示功能的计数器电路，图中M为控制变量。M=0，计数器为8421码六进制加法；M=1，计数器为循环码六进制计数。解：电路图如下：5-17试用JK触发器设计一个同步2421（A）码的十进制计数器，电路的状态图如题5-17图所示。解：电路图如下：5-18试用JK触发器设计一个同步余3循环码十进制减法计数器，电路的状态图如题5-18图所示。解：电路图如下：5-19用JK触发器设计一个步进电机用的三相六状态脉冲分配器。如果用1表示线圈导通，用0表示线圈截止，则三个线圈AB

6、C的状态图如题5-19图所示。在正转时输入端G为1，反转时为0。解：电路图如下：5-20用JK触发器设计一个按自然态序进行计数的同步加法计数器，要求当控制信号M=0时为六进制，M=1时为十二进制。解：电路图实现如下：5-21分析题5-21图所示各电路，画出它们的状态图和时序图，指出各是几进制计数器。解：状态图：时序图：5-22试分析题5-22图所示电路，指出各计数器的计数长度M是多少？并画出相应的状态图。解：74161为异步清零，同步置数的4位同步二进制加法计数器（a）为13进制同步加法计数器，状态转换图如下：（b）为9进制加法计数器，状态转换图如下：（c）为15进制计数器，状态转换图如下：（

7、d）为7进制计数器，状态转换图如下：5-23试分析题5-23图所示电路的计数长度为多少，采用的是哪种接法。分别画出（Ⅰ）和（Ⅱ）的状态图。若电路作为分频器使用，则芯片（Ⅱ）的CO端输出的脉冲和时钟CP的分频比为多少？题5-23图解：（Ⅰ）为7进制同步加法计数器，其状态图如下：（Ⅱ）为5进制同步加法计数器，其状态图如下：两片74160计数器之间采用异步接法。若电路作为分频器使用，则芯片（Ⅱ）的CO端