第6章-时序逻辑电路

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1、6时序逻辑电路6.1.1已知一时序电路的状态表如表题6.1.1所示，A为输入信号，试作出相应的状态图。解：由状态图的概念及已知的状态表，可画出对应的状态图，如图题解6.1.1所示。6.1.2已知状态表如表题6.1.2所示，输入为X1X0，试作出相应的状态图。解：根据表题6.1.2所示的状态表，作出对应的状态图如图题解6.1.2所示。316.1.2已知状态图如图题6.1.3所示，试列出它的状态表。解：按图题6.1.3列出的状态表如表题解6.1.3所示。6.1.5图题6.1.5所示是某时序电路的状态图，设电路的初始状态为01，当序列A=100110（自左至

2、右输入）时，求该电路输出Z的序列。解：由图题6.1.5所示的状态图可知，当初态为01，输入信号的序列A=100110时，该时序电路将按图题解6.1.5所示的顺序改变状态，因而对应的输出序列为Z=011010。316.1.6已知某时序电路的状态表如表题6.1.6所示，输入A，试画出它的状态图。如果电路的初始状态在b，输入信号A一次是0、1、0、1、1、1、1，试求出其相应的输出。解：根据表题6.1.6所示的状态表，可直接画出与其对应的状态图，如图题解6.1.6（a）当从初态b开始，依次输入0、1、0、1、1、1、1信号时，该时序电路将按图题解6.1.6（

3、b）所示的顺序改变状态，因而其对应的输出为1、0、1、0、1、0、1。6.2同步时序逻辑电路的分析6.2.1试分析图题6.2.1（a）所示时序电路，画出其状态表和状态图。设电路的初始状态为0，试画出6.2.1（b）所示波形作用下，Q和Z的波形图。31解：由所给电路图可写出该电路的状态方程和输出方程，分别为其状态表如表题解6.2.1所示，状态图如图题解6.2.1（a）所示，Q和Z的波形图如图题解6.2.1（b）所示。6.2.2试分析图题6.2.2（a）所示时序电路，画出其状态表和状态图。设电路的初始状态为0，画出在图题6.2.2（b）所示波形作用下，Q和

4、Z的波形图。解：由所给电路可写出该电路的状态方程和输出方程31其状态表如表题解6.2.2所示，状态图如图题解6.2.2（a）所示，Q和Z的波形图如图题解6.2.2（b）所示。6.2.3试分析图题6.2.3所示时序电路，画出状态图。31解：由图题6.2.3所示电路写出其状态方程组和输出方程，分别为其状态表如表题解6.2.3所示，状态图如图题解6.2.3所示。316.2.3分析图题6.2.4所示电路，写出它的激励方程组、状态方程组和输出方程，画出状态表和状态图。解：该电路的激励方程组为状态方程组为输出方程为根据状态方程组和输出方程可列出状态表，如表题解6.

5、2.4所示，状态图如图题解6.2.4所示。316.2.5分析图题6.2.5所示同步时序电路，写出各触发器的激励方程、电路的状态方程组和输出方程组，画出状态表和状态图。解：由图题6.2.5所示电路可写出各触发器的激励方程为该电路的状态方程组为31输出方程为根据状态方程组和输出方程列出该电路的状态表，如表题解6.2.5所示，状态图如图题解6.2.5所示。316.2.6试画出图题6.2.6（a）所示时序电路的状态图，并画出对应于CP的Q1、Q0和输出Z的波形，设电路的初始状态为00。解：该电路中的激励方程组为状态方程组和输出方程分别为根据状态方程组和输出方程

6、可列出该电路的状态表，如表题解6.2.6所示，状态图如图题解6.2.6（a）所示。图题解6.2.6（b）所示是Q1、Q0及Z的波形图。316.3同步时序逻辑电路的设计6.3.1用JK触发器设计一同步时序电路，其状态如表题6.3.1所示。解：所要设计的电路有4个状态，需要用两个JK触发器实现。（1）列状态转换真值表和激励表由表题6.3.1所示的状态表和JK触发器的激励表，可列出转换真值表和对各触发器的激励信号，如表题解6.3.1所示、31（1）求激励方程组和输出方程由表题解6.3.1画出各触发器J、K端和电路输出端Y的卡诺图，如图题解6.3.1（a）所示

7、。从而，得到化简得激励方程组。和输出方程根据激励方程组和输出方程可画出电路图，如图题解6.3.1（b）所示。316.3.2某同步时序电路的状态图如图题6.3.2所示，试写出用D触发器设计时的最简激励方程组。31解：由图题6.3.2所示状态图可知，实现该同步时序需要用三个D触发器。（1）根据状态图列出完全的状态转换真值表，如表题解6.3.2所示。其中，状态图中未包含的状态为不出现的状态，其次态可用无关项×表示。（2）画出3个触发器的激励信号D2、D1、D0的卡诺图。由于D触发器的特性方程为=D,所以可由状态转换真值表直接画出这3个卡诺图，如图题解6.3.

8、2所示。（2）由卡诺图得到最简激励方程组6.3.3试用上升沿触发的JK触发器设计一同步时序电路