基于65nm的低功耗设计与等价性验证

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1、代号10701学号1086190653分类号TN4密级公开题（中、英文）目基于65nm的低功耗设计与等价性验证LowPowerDesignandEquivalentCheckBasedon65nm作者姓名贺京指导教师姓名、职务汤晓燕教授学科门类工程学科、专业集成电路工程提交论文日期二○○三年一月AB西安电子科技大学学位论文独创性声明秉承学校严谨的学风和优良的科学道德，本人声明所呈交的论文是我个人在导师指导下进行的研究工作及取得的研究成果。尽我所知，除了文中特别加以标注和致谢中所罗列的内容以外，论文中不包含其他人已经发表或撰写过的研究成果；也不包含为获得西安电子科技大学或其它教育机构

2、的学位或证书而使用过的材料。与我一同工作的同志对本研究所做的任何贡献均已在论文中做了明确的说明并表示了谢意。申请学位论文与资料若有不实之处，本人承担一切法律责任。本人签名：日期：西安电子科技大学关于论文使用授权的说明本人完全了解西安电子科技大学有关保留和使用学位论文的规定，即：研究生在校攻读学位期间论文工作的知识产权单位属西安电子科技大学。学校有权保留送交论文的复印件，允许查阅和借阅论文；学校可以公布论文的全部或部分内容，可以允许采用影印、缩印或其它复制手段保存论文。同时本人保证，毕业后结合学位论文研究课题再撰写的文章一律署名单位为西安电子科技大学。（保密的论文在解密后遵守此规定）

3、本学位论文属于保密，在年解密后适用本授权书。本人签名：导师签名：日期：日期：摘要摘要随着移动通讯技术的发展和手机用户的快速拓展，低功耗技术已经广泛的应用于手机芯片设计中。传统的低功耗设计方法已经不能满足日益俱进的低功耗需求。为了能够更加积极的降低功耗，本文采用了一种新的低功耗设计方法：静态多电压设计方法。静态多电压设计方法抛弃了传统的单电源模式，在整个设计中将设计明确的划分为多个电压域，UPF在综合过程中，作为低功耗指导插入低功耗元件，实现低功耗设计。在整个电路的运行过程中，芯片各个部分的电压都可以根据需要来降低工作电压或者直接切断电源用以降低功耗。本文参考AccelleraUPF

4、v1.0标准，依照ARM总线外围电路的低功耗意图，完成了ARM总线外围电路UPF的设计。在超大规模集成电路设计在中，传统的门级仿真时间过长，测试向量无法覆盖整个设计，形式验证应运而生。本文采用Cadence公司的Conformal工具，基于RTL、UPF的综合结果，在现有的两种验证方法的基础上提出一种新的方法。这种新的方法解决了打平的验证方法无法解决的验证间断点，而且大大的缩短了验证时间(由两天节省到了三个小时)，不仅满足了项目的时间需求，也节省了工具的使用费用。同时，为了消除UPF与CPF之间的兼容问题，本文提出了一种简单而有效的方法：在综合网表中所有的穿通信号上插入缓冲单元。这

5、一方法很好的消除了UPF与CPF的矛盾，使得验证结果更为准确。关键词：低功耗UPFCPF等价性验证LECABSTRACTABSTRACTWiththedevelopmentofmobilecommunicationtechnologyandincreasingrequirementofmobilephone,lowpowertechnologyhasalreadybeenadoptedtoSoCinmobilephonefield.Inthisthesis,anewlowpowertechnologywhichisnamedmulti-voltagetechnologyisused

6、toreducepowerconsumption.Thetraditionalone-powerconceptionisabandonedinmulti-voltagetechnology.Thewholedesignisdividedintoseveralpartswhichiscalledpowerdomaininmulti-voltagetechnology.UPFisusedtodescribepowerconceptionofdesignandguidesynthesistooltoinsertlow-powercells.Inmulti-voltagetechnolog

7、y,Powersupplycouldbeadjustedineachpartofdesign.AccordingtoAccelleraUPFv1.0standards,UPFbasedondesignpowerconceptionofARMBusperipheralscircuitwasdesigned.InVLSI,testingworkalwayscostslotsoftimebyusingthetraditionalgate-simulation,designc