汽车尾灯控制verilog语言

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1、郑州科技学院EDA（电子设计自动化）设计报告题目汽车尾灯控制设计学生姓名专业班级09电科一班学号200931021所在系电气工程学院任课教师完成时间2012年12月25日目录1．设计的基本要求12．系统组成及原理图13．各组成模块原理及程序23.1时钟分频模块23.2汽车尾灯主控模块33.3左边灯控制模块43.4右边灯控制模块54．仿真分析64.1分频模块仿真及分析64.2汽车尾灯主控模块仿真及分析64.3左边灯控制模块仿真及分析74.4右边灯控制模块仿真及分析84.5整个系统仿真及分析85．心得体会9汽车尾灯控制器设计1．设计的基本要求设汽车尾部左右两侧各有3盏指示灯（转弯

2、灯、刹车灯、雾灯），根据现代交通规则，汽车尾灯控制器应满足以下基本要求1.汽车正常行驶时指示灯都不亮。2.汽车转弯时，对应侧的转弯灯亮。3.汽车刹车时，两侧的刹车灯亮。4.汽车在夜间或大雾天行驶时，两侧雾灯一直亮2．系统组成及原理图汽车尾灯控制器就是一个状态机的实例。当汽车正常行驶时所有指示灯都不亮；当汽车向右转弯时，汽车右侧的指示灯RD1亮；当汽车向左侧转弯时，汽车左侧的指示灯LD1亮；当汽车刹车时，汽车右侧的指示灯RD2和汽车左侧的指示灯LD2同时亮；当汽车在夜间行驶时，汽车右侧的指示灯RD3和汽车左侧的指示灯LD3同时一直亮。通过设置系统的输入信号：系统时钟信号CLK，

3、汽车左转弯控制信号LEFT，汽车右转弯控制信号RIGHT，刹车信号BRAKE，夜间行驶信号NIGHT和系统的输出信号：汽车左侧3盏指RD1、RD2、RD3实现以上功能。系统的整体组装设计原理如图1所示。图1系统的整体组装设计原理93．各组成模块原理及程序汽车尾灯控制器有4个模块组成，分别为：时钟分频模块、汽车尾灯主控模块，左边灯控制模块和右边灯控制模块，以下介绍各模块的详细设计。3.1时钟分频模块整个时钟分频模块的工作框图如图3.1所示。CLKCPSZ图3.1时钟分频模块工作框图时钟分频模块由Verilog程序来实现，下面是其中的一段Verilog代码：//分频模块alway

4、s@(posedgeclock)beginif(a_temp==9999)beginf1=~f1;a_temp<=0;endelsea_temp<=a_temp+1;endalways@(posedgeclock)//1hzbeginif(b_temp==9999999)beginf2=~f2;b_temp<=0;endelseb_temp<=b_temp+1;end9always@(posedgef2)beginif(temp0<2)temp0<=temp0+1;elsetemp0<=0;endalways@(posedgef2)begini<=~i;end3.2汽车尾灯主

5、控模块汽车尾灯主控模块工作框图如图3.2所示。LEFTLPRIGHTRPBRAKELRNIGHTBRAKE_LEDNIGHT_LEDCTRL.图3.2主控模块工作框图汽车尾灯主控模块由Verilog程序来实现，下面是其中的一段Verilog代码：modulelight(clock,turnl,turnr,ordinary,brake,lightr,lightl);inputclock,turnl,turnr,ordinary,brake;outputlightr,lightl;reg[2:0]lightr;reg[2:0]lightl;integertemp0;9intege

6、ra_temp;integerb_temp;regf1,f2,i;3.3左边灯控制模块左边灯控制模块的工作框图如图3.4所示。CLKLPLEDLLRLEDBBRRAKELEDNNIGHTLC图3.3左边灯控制模块的工作框图左边灯控制模块由Verilog程序来实现，下面是其中的一段Verilog代码：always@(posedgef1)beginif(turnl==1&&turnr==0)begincase(temp0)0:beginlightl<=3'b100;lightr<=3'b000;end1:beginlightl<=3'b010;lightr<=3'b000;end

7、2:beginlightl<=3'b001;lightr<=3'b000;endendcaseendelseif(brake==1)begincase(i)0:beginlightl<=3'b111;9lightr<=3'b111;end1:beginlightl<=3'b000;lightr<=3'b000;endendcaseend3.4右边灯控制模块右边灯控制模块的工作框图如图3.4所示。CLKRPLEDRLRLEDBBRRAKELEDNNIGHTRC图3.4右边灯控制模块的工作框图右边灯控制模块