数字逻辑实验报告

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1、实验二一、实验目的1.理解一位全加器的工作原理2.理解一位比较器的工作原理3.掌握bcd码的应用4.进一步熟悉Quartus软件的使用，了解设计的全过程，二、实验内容1.试用4位全加器7483和4位比较器7485实现一位8421bcd码全加器。2.采用画原理图的方法设计4位全加器7483和4位比较器7485实现一位8421bcd码全加器。3.三、实验步骤创建一个新的工程，不能存到u盘，画出两个7483四位全加器，画出一个比较器7485。因为是由四位全加器实现8421BCD码，所以有功能表知道，当四位全加器的和小于等于9的时候，7483的值和8421BCD码的值，当大于

2、他的时候，四位全加器的值应该加上六，当四位全加器的值产生进位的时候，或是A>B的时候8421BCD码的值比它的值还要加六。四位全加器首先根据底层元件创建当前工程的全加器，根据全加器设计四位加法器与比较器，画出如下图：四、实验现象说明功能仿真的波形图起始时A4A3A2A1=0111，B4B3B2B1=1101，俩数相加，得到D1D2D4D8=10100，因为产生了进位，所以应该给他加上六，得到11010。同理，当A4A3A2A1=1010，B4B3B2B1=0011，俩数相加，得到D1D2D4D8=1101，因为大于9，所以应该给他加上六，得到10011.当A4A3A2

3、A1=0110，B4B3B2B1=0010，俩数相加，得到DCD1D2D4D8=01000，因为小于9，得到输出为01000.当A4A3A2A1=1101，B4B3B2B1=1001，俩数相加，得到DCD1D2D4D8=10110，因为产生了进位，所以应该给他加上六，得到11100.当A4A3A2A1=0011，B4B3B2B1=1100，俩数相加，得到DCD1D2D4D8=01111，因为大于9，所以应该给他加上六，得到10101.五、实验体会与收获通过本次的实验是我对原理图的画法，有了更深的了解与掌握，使我彻底的明白了7485比较器的使用鱼7483全加器的工作原理

4、，本来对Quartus掌握不熟练地我，现在应经自己能进行编程了，通过本次的实验，我更能将7483全加器与7485比较器结合起来，进行编程与连线。说明发现问题以及解决的方法特别提醒：不要将项目所在的文件夹设在计算机已有的安装目录下，更不要将项目文件夹直接放在Quartus安装目录中。当编译不有问题的时候，我会谦虚的请教蔡哥，用心去编程，不要着急，更不要慌忙！