串行数据发送电路设计报告

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1、串行数据发送电路设计报告1.功能描述同步串行数据发送电路SSDT的基本功能是将并行数据转换成串行数据并进行同步发送。系统写入和读出时序完全兼容Intel8086时序。系统以同步信号开始连续发送四个字节，在发送中出现5个1时插入一个0，在四个数据发送结束而下一次同步没有开始之前，发送7FH，这时中间不需要插入零。2.状态图描述图1：状态机示意图图1是设计使用的状态机，由三个状态组成：在RST有效时，系统进入FREE状态，这个状态可以写入数据，但不会发送数据，TXD输出为0。当FS有效时，系统从FREE进入TRAN状态，这个状态下

2、，传送四个字节，在需要时插入零。在THR为空时可以进行写操作。四个数据传送完成以后进入IDLE状态，发送7FH。直到下一个FS有效进入TRAN状态为止。3.RTL级的结构图图2是系统的RTL结构图。主要使用的寄存器有：THR：数据保持寄存器。THR_EMPTY：数据保持寄存器的状态寄存器。TSR：数据移位寄存器。TSR_NUM：数据移位寄存器位数计数器。TXD：发送寄存器TXD_SHIFT：发送寄存器备份寄存器。IDLER：开始放置7FH的移位寄存器。组合逻辑如图所示。以上各个寄存器以及组合逻辑的详细说明见第4小结的实现说明。

3、图2：系统RTL结构图4.实现说明THR是一个8位的寄存器，这个寄存器通过00端口可写，同时它的状态通过00端口可读。在每一次没有数据并且没有发送完四个时可写入这个寄存器，同时在每一次有数据并且TSR没有数据时可读这个寄存器的内容到TSR。TSR是一个具有移位功能的，只有在TRAN的状态下，才会移位。也就是将寄存器左移，寄存器的高位移出，低位补零。这个移位寄存器带有一个移位Enable端口，当计数记满五个一时，停止移位。IDLER是一个空闲移位器，这个移位器的初始值是7E，它只有在空闲状态下才会移位。这是一个循环移位寄存器，一

4、直进行的是左移操作。另外还有一个空标志寄存器，就是THR_EMPTY，这个寄存器用来标志THR是否为空，它可以同过00端口读出。TSR有一个8位的位数备份寄存器TSR_NUM，负责记录向外输出的位数是否完成一个字节。在TSR的第一次移位时，将打入到这个寄存器，然后每一次TSR移位，这个寄存器右移一次。有这个寄存器可以给出TSR的空标志寄存器。TSR的空标志TSR_EMPTY是一个组合逻辑，它由TSR_NUM的8位作8输入与门产生。TXD有一个移出备份寄存器TXD_SHIFT，这个寄存器保留TXD移出的5位数据，每一次向TXD打

5、入数据时，就向最高位打入TXD中的数据，同时右移，这个寄存器在任何时候都进行这种操作，但是只在TRAN时5位全1时才会算成是需要插入零。TXD是发送寄存器，每一个时钟都经过一个三选一将数据打入。CS是一个片选标志，只有党A0为0时这个标志才会有效。电路中需要一个计数器，记下当前处理的是第几个字节。这就是BYTE_NUM。在FS=0时它的初始值是1。表明处理的是第一个字节的位。当TSR_EMPTY为1并且INSERT_ZERO为0时就开始加一。只在TRAN的状态下计数。5.详细设计以下表1是设计的输入输出描述。表中描述了各种信号

6、的名称、有效状态、功能等等。表1：端口信号说明信号名输入输出有效状态功能说明CLK2MIN-始终2.048MFSIN低同步信号RSTIN低复位信号CSIN低片选信号WRIN低写有效信号RDIN低读有效信号A0IN低地址D_ININ-数据输入D_OUTOUT-数据输出TXDOUT-数据发送6.仿真及其结果仿真主要考虑的功能点：（1）连续两次发送4个字节的数据是否正确，也就是FS两次有效的情况。（2）在一个发送周期中，插入0在一个字节的中间是否正确。比如FEH。（3）在一个发送周期中，插入0在一个字节的末尾是否正确。比如3FH。（

7、4）在一个发送周期中，插入0在第四个字节的末尾是否正确。比如3FH。（5）对00端口进行读操作的时序以及结果是否正确。（6）对00端口进行写操作的时序以及结果是否正确。（7）在发送7FH得过程中不插入0是否正确。仿真程序见文件SSDT_TB.vhd。使用Modelsim7.0仿真出来的结果见下图所示：图3：一个字节中间需要插入0的时序图4：一个字节末尾需要插入0的时序图5：传送最后需要插0的时序图6：两字节连接需要插0的时序图7：传送最后不需查0的时序图8：两次FS之间的转换时序7.综合及其结果使用synplify工具进行综合

8、，最后综合的结果如下：图9：综合和的门级报告图10：综合的时序报告8.报告结果由以上报告，本设计完成了系统要求的所有功能，最后仿真综合的结果符合要求。