计算机组成原理课程设计---逻辑加与减法指令在基本模型机的设计与实现

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1、本科生课程实习逻辑加与减法指令在基本模型机的设计与实现课程名称计算机组成原理学生姓名学生学号所在专业计算机科学与技术所在班级日期2011/6/23指导教师职称成绩6目录1设计背景与设计目标12设计仪器13设计原理13.1微程序控制电路13.2微指令格式14实验步骤………………………………………………………………………………….24.1按照基本模型机的通路框图设计微程序流程图…………………………………..34.2微指令格式变成二进制代码………………………………………………………..34.3连接实验线

2、路……………………………………………………………………….44.4微程序内容………………………………………………………………………......44.5运行程序……………………………………………………………………………..55实验结果分析…………………………………………………………………………….56课程设计心得体会……………………………………………………………………….57参考文献…………………………………………………………………………………5附加实验原理图……………………………………………………

3、………………………66逻辑加与减法指令在基本模型机的设计与实现一．设计背景与设计目标通过计算机组成原理理论课和几次实验的学习，尝试设计五条机器指令，并编写相应的微程序，完成由基本单元电路构成一台基本模型机，再经过调试指令和模型机使其在微程序的控制下自动产生各部件单元的正常工作控制信号。在设计基本模型机的实验过程中，个别部件单元的控制信号是人为模拟产生的，而本课程设计将能在微程序控制下自动产生各部件单元控制信号，实现特定指令的功能。这里，计算机数据通路的控制将由微程序控制器来完成，CPU从内存中取出

4、一条机器指令到指令执行结束的一个指令周期，全部由微指令组成的序列来完成，即一条机器指令对应一条微程序。本课程设计要求增加两条机器指令，我组选择：或OR（逻辑加），SUB（减法）二．设计仪器TDN—CM+计算机组成原理教学实验系统一台，排线若干；PC机一台。三．设计原理1.微程序控制电路微程序控制器的组成见图1-13。其中控制存储器采用3片2816E2PR0M，具有掉电保护功能。微命令寄存器18位，用两片8D触发器（74LS273）和一片4D（74LS175）触发器组成。微地址寄存器6位，用三片上升

5、沿触发的双D触发器（74LS74）组成，它们带有清“0”端和置“1”端。在不判别测试的情况下，T2时刻打入微地址寄存器的内容即为下一条微指令地址。当T4时刻进行测试判别时，转移逻辑满足条件后输出的负脉冲通过强置端将某一触发器设置为“1”状态，完成地址修改。在该实验电路中，在CONTROLUNIT有一个编程开关，它具有三种状态：WRITE（编程）、READ（校验）、RUN（运行）。当处于“编程状态”时，实验者可根据微地址和微指令格式将微指令二进制代码写入到控制存储器2816中。当处于“校验状态”时，

6、可以对写入控制存储器中的二进制代码进行验证，从而可以判断写入的二进制代码是否正确。当处于“运行状态”时，只要给出微程序的入口微地址，则可根据微程序流程图自动执行微程序。图中微地址寄存器输出端增加了一组三态门74LS245，目的是隔离触发器的输出，增加抗干扰能力，并用来驱动微地址显示灯2.微指令格式微指令字长24位，其控制位顺序如下：表1-2微指令结构图微程序242322212019181716151413121110987654321控制信号S3S2S1S0MCNWECELDPCABPuA5uA4

7、uA3uA2uA1uA0A字段B字段P字段151413控制信号121110控制信号987控制信号000000000001LDRi001RS_B001P1010LDDR10100106011LDDR2011011100LDIR100299_B100P4101LOAD101ALU_B101110LDAR110PC_B110其中uA5一uA0为6位的后续微地址，A、B、P为三个译码字段，分别由三个控制位译码出多位。P字段中的Pl一P4是四个测试字位。其功能是根据机器指令及相应微代码进行译码，使微程序转入

8、相应的微地址入口，从而实现微程序的顺序、分支、循环运行。AR为算术运算是否影响进位及判零标志控制位，其为零有效。B字段中的RS_B、RD_B、RI_B分别为源寄存器选通信号、目的寄存器选通信号及变址寄存器选通信号，其功能是根据机器指令来进行三个工作寄存器R0、R1及R2的选通译码。四．实验步骤1按照基本模型机的同路框图设计微程序流程图数据通路图：微程序流程图的控制台部分：6PC->ARPC+1RAM->BUSBUS->IRP1SW->R0PC->ARPC+1PC->ARPC+1PC