数字电子课程设计报告

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1、数电课程设计报告学院：交大电信学院班级：电信701姓名：李清实验一：半加器1.原理电路图：2.将半加器原理电路图进行封装：实验二：全加器1.原理电路图：2.选择File下拉菜单中的NewProjectWizard，新建一个工程。3.点击图中的next进入工作目录。4.在栏目中设定新项目所使用的路径；在名称栏目中输入新项目的名字:q_adder，点击Next按钮。对设计文件进行编译在Processing菜单下，点击StartCompilation命令，对刚才的q_adder进行编辑。编译结束后，点击确定按钮。5仿真（检查逻辑正确的情况下）建立仿真文件：实验三：计数

2、器的电路设计1.相应参数的介绍和应该注意的东西：待测频率信号clk通过一个与门进入74390的第1个计数器的时钟输入端1CLKA，与门的另一端由计数使能信号enb控制：当enb='1'时允许计数；enb='0'时禁止计数。计数器1到4位输出q[3]、q[2]、q[1]和q[0]并成总线表达方式即q[3..0]，由图2.4.12左下角的OUTPUT输出端口向外输出计数值，同时由一个4输入与门和两个反相器构成进位信号进入第2个计数器的时钟输入端2CLKA。第2个计数器的4位计数输出是q[7]、q[6]、q[5]和q[4]，总线输出信号是q[7..4]。这两个计数器的

3、总的进位信号，即可用于扩展输出的进位信号由一个6输入与门和两个反相器产生，由cout输出。clr是计数器的清零信号。2.原理电路图的连接：3.输出逻辑波形图：（1）（2）详细逻辑波形图：实验四.频率计数器1.建立一个新的原理图编辑窗口，然后连接好逻辑电路图后存盘（文件名可取pli.bdf）,最后为此建立一个工程。电路图如下2.逻辑波形图：实验五：时序控制电路设计1.逻辑电路图的连接：2.经过调试查错后仿真的逻辑电路图：实验六.频率计顶层电路设计1.电路图的连接：2.当电路按上述的方法连接好后经过仿真后逻辑波形图：七．数字电子课程设计的总结：1.经过这次数字电子课

4、程设计让我进一步巩固了课本上所学的知识，我也很感兴趣，很喜欢这门课程上所学和所用。与此同时，我也更深一层的了解我们这课堂上所学的书本知识在日常生活和工作上怎样用！2.通过这次的课程设计的应用，我也深深的感到自己还有很多的不足：不管是在知识理论上还是在知识的灵活应用上。我应该在以后的学习生活上更加注意，更加努力!!3.我认为只有在扎实的掌握课本上理论知识才有可能达到知识灵活应用于工作上。内部资料仅供参考9JWKffwvG#tYM*Jg&6a*CZ7H$dq8KqqfHVZFedswSyXTy#&QA9wkxFyeQ^!djs#XuyUP2kNXpRWXmA&UE9

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