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1、《dsp第七讲》PPT课件第二章硬件结构2.10在片外围电路缓冲同步串行口BSP概述具有一个自动缓冲单元(ABU)ABU利用独立于CPU的专用总线，允许串口对存储器进行不依赖于CPU的读写操作BSP的串行接口部分是一种增强型的标准串口BSP组成框图第二章硬件结构2.10在片外围电路缓冲同步串行口BSP自动缓冲操作过程自动缓冲工作于ABU和ABU的2K字存储器块之间。自动缓冲模式下，在传送每一个字的转换过程中不会产生中断，只有当发送和接收数据达到半满边界时才会发生中断。2K字存储器块之内，可以使用AXR，ARR及BKX和BKR编程来分配缓冲区的起始地址和缓冲区的大小。起始地址可以指定2

2、K字缓冲区的任意一个位置第二章硬件结构2.10在片外围电路缓冲同步串行口BSP循环寻址BKX/RARX/RARHARL0…01…BBATBA缓冲区当前位置ARHBKLARHBKL>>1ARH0…0下半部开始缓冲区顶部上半部分缓冲区底部下半部分第二章硬件结构2.10在片外围电路缓冲同步串行口BSP自动缓冲操作过程归纳ABU执行对缓冲存储器的访问。操作过程中，相应地址寄存器自动增加，直到缓冲区的底部；到底部后，地址寄存器内容恢复到缓冲存储区顶部如果数据到了缓冲区的一半或底部，就会产生中断，并刷新XH/XL。如果选择禁止自动缓冲功能，当数据过半或到达缓冲区底部时，ABU会自动停止缓冲功能第

3、二章硬件结构2.10在片外围电路多通道缓冲串行口McBSP概述多通道缓冲串口的硬件部分是基于标准串口的。具有如下特征：全双工通信双缓冲发送和三缓冲接收数据存储器，允许连续数据流可以直接与工业标准的编解码器、模拟接口芯片、其他串行A/D、D/A器件连接并进行通信具有外部移位时钟发生器及内部频率可编程移位时钟多达128个发送和接收通道数支持8、12、16、20、24和32位字长第二章硬件结构全双工通信双缓冲发送和三缓冲接收数据存储器，允许连续数据流可以直接与工业标准的编解码器、模拟接口芯片、其他串行A/D、D/A器件连接并进行通信具有外部移位时钟发生器及内部频率可编程移位时钟多达128个

4、发送和接收通道数支持8、12、16、20、24和32位字长利用m律或A律的压缩扩展通信可选的高位或低位先发送的8位数据发送帧同步和时钟信号的极性可编程。可编程的内部时钟和帧发生器可以直接与各种帧调节器及IOM-2、IIS兼容器件、SPI器件进行接口第二章硬件结构2.10在片外围电路多通道缓冲串行口McBSP结构图第二章硬件结构2.10在片外围电路多通道缓冲串行口McBSPMcBSP的寄存器McBSP的子地址寻址STM#0,SPSA0STM#0040h,SPSD0McBSP的配置通过3个16位(总体配置)寄存器来配置:SPCR1SPCR2PCR接收和发送控制寄存器RCR[1,2]XCR

5、[1,2]采样率发生寄存器多通道控制寄存器接收和发送通道屏蔽控制寄存器第二章硬件结构2.10在片外围电路多通道缓冲串行口McBSPMcBSP的配置SPCR1(串行接口控制寄存器1)151413121110~876543210DLBRJUSTCLKSTPABISDXENAResRINTMRSYNCERRRFULLRRDY/RRST数字循环返回(回送)模式接收符号扩展及判别模式:影响DRR[1,2]00:右对齐,高位填001:右对齐,高位符号扩展10:左对齐,低位填011,保留时钟停止模式接收中断模式:00:由RRDY和ABIS模式下的帧结束信号驱动01:由块结束或多通道操作下的帧结束信

6、号驱动10:由新的帧同步信号产生11:由RSYNCERR产生接收同步错误第二章硬件结构2.10在片外围电路多通道缓冲串行口McBSPMcBSP的配置SPCR2(串行接口控制寄存器2)15~109876543210保留FressSoftXINTM/GRST/FRSTXSYNERR/XEMPTYXRDY/XRST帧同步发生器复位采样率发生器复位发送中断模式发送同步错误第二章硬件结构2.10在片外围电路多通道缓冲串行口McBSPMcBSP的配置PRC(引脚控制寄存器)15~141312111098保留XIOENRIOENFSRMFSXMCLKXMCLKRM发送通用IO模式位,仅当SPCR2

7、的/XRST=0时有效.接收通用IO模式位,仅当SPCR1的/RRST=0时有效.接收帧同步模式位:0:外部帧同步信号1:片内采样率发生器产生帧同步信号发送帧同步模式位:0:外部帧同步信号1:采样率发生器的帧同步模式位决定帧同步模式发送时钟模式位:0:由外部时钟驱动1:由内部采样率发生器驱动SPI模式下(CLKSTP非零):0:McBSP为从器件,CLKX由系统的SPI主器件驱动,CLKR由内部CLKX驱动1:McBSP为主器件,CLKX驱动她的接收时钟和