(Multisim数电仿真)半加器和全加器.docx

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1、⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯最新料推荐⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯实验3.5半加器和全加器一、实验目的：1．学会用电子仿真软件Multisim7进行半加器和全加器仿真实验。2．学会用逻辑分析仪观察全加器波形：3．分析二进制数的运算规律。4.掌握组合电路的分析和设计方法。5．验证全加器的逻辑功能。二、实验准备：组合电路的分析方法是根据所给的逻辑电路，写出其输入与输出之间的逻辑关系(逻辑函数表达式或真值表)，从而评定该电路的逻辑功能的方法。一般是首先对给定的逻辑电路，按逻辑门的连接方法，逐一写出相应的逻辑表达式，然后写出输出函数表达式，这样写出的逻辑函

2、数表达式可能不是最简的，所以还应该利用逻辑代数的公式或者卡诺图进行简化。再根据逻辑函数表达式写出它的真值表，最后根据真值表分析出函数的逻辑功能。例如：要分析如图3.5.1所示电路的逻辑功能。WXY&&&&&&&&&&&&ABCD图3.5.11.写输出函数Y的逻辑表达式：WAABABB..........................................3.5.1XWWCWCC.........................................3.5.2YXXDXDD..........................................

3、3.5.31⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯最新料推荐⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯2.行化：WAABABBABAB....................................................3.5.4XWCWCABCABCABCABC....................5.5⋯..3.YXDXDABCDABCDABCDABCDABCDABCDABCDABCD...........................⋯...3.5.63.列真表：表3.5.1：ABCDY00000000110010100110010010101

4、0011000111110001100101010010111110001101111101111104.功能明：是一个奇路。入量的取中，有奇数个1有出，否无出。合路的目的就是根据的，通写出它的真表和函数表达式，最找到个路的器件,将它成最的路。例如：半加器路。1.行抽象：如果不考的来自低位的位将两个1位二制数相加，称半加。A、B是两个加数，S是它的和，Ci是向高位的位。根据二制数相加的律，可以写出它的真表如表3.5.2所示。2⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯最新料推荐⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯表3.5.2：输入输出ABSCi0000011010101

5、1012.写出逻辑函数式：SABABAB................................................3.5.7CiAB3.选定器件的类型：可选异或门来实现半加和；可选两片与非门(或一片与门)实现向高位的进位。如图3.5.2所示。AS=1BCi&&图3.5.2三、计算机仿真实验内容：1.测试用异或门、与门组成的半加器的逻辑功能：(1).按照图3.5.3所示，从电子仿真软件Multisim7基本界面左侧左列真实元件工具条中调出所需元件：其中，异或门74LS86N从“TTL”库中调出；与门4081BD_5V从“CMOS”库中调出。指示灯从电子仿真

6、软件Multisim7基本界面左侧右列虚拟元件库中调出，X1选红灯；X2选蓝灯。3⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯最新料推荐⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯图3.5.3(2).打开仿真开关，根据表3.5.3改变输入数据进行实验，并将结果填入表内。表3.5.3：输入输出ABSCi000110112.测试全加器的逻辑功能：(1).从电子仿真软件Multisim7基本界面左侧左列真实元件工具条中“CMOS”库中调出或门4071BD_5V、与门4081BD_5V；从“TTL”库中调出异或门74LS86D，组成仿真电路如图3.5.4所示。图3.5.44⋯⋯⋯⋯⋯⋯⋯

7、⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯最新料推荐⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯⋯(2).打开仿真开关，根据表3.5.4输入情况实验，并将结果填入表内。表3.5.4：输入输出ABCi1SCi0000010100111001011101113.用逻辑分析仪观察全加器波形：(1).先关闭仿真开关，在图3.5.4中删除除集成电路以外的其它元件。(2).点击电仿真软件Multisim7基本界面右侧虚拟仪器工具条中的“WordGenerator”按钮，如图3.5.5(左图)所示，调出字信号发生器图标(右图)“XWG