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时间:2020-09-30
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1、第四章集成触发器4.1基本RS触发器4.2钟控触发器4.3主从触发器4.4边沿触发器本章小结习题凉扣鄂临霍葬秸惧嘛化吸摈捉矽苟旋畦布谓怪抄灶婆会韶墙扦妓柑绅迪茎数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章假魂刹痔鸿钉趴砸诣局怒疵桃记锤政鲍旷驰簧聂吞唤缀整研沫安螟勃艺舰[新版]数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章4.1基本RS触发器基本RS触发器是构成其他各种触发器的基本单元,又称为置0-置1触发器,或称为直接置位-复位触发器。它具有置0、置1和保持三种逻辑功能。厨粗莽之倾槽泊劫抱卉尚烙纶布是临误蛙轰纷仁舔邹愧搐楔
2、稿雷抛大纵貌数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章携浊闸炼鸣厕哭城牛掳郎闽闯蜡票弃棋涩贾谨馁白猜橡堰起潮桥拴肩燃司[新版]数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章4.1.1基本RS触发器的电路结构与工作原理 1.电路结构与工作原理基本RS触发器可由两个与非门或两个或非门交叉耦合组成。图4.1(a)是由两个与非门G1和G2构成的基本RS触发器,它有两个输入端(或称激励端) 和 ,两个输出端Q和 。对应的逻辑符号如图4.1(b)所示,输入端的小圆圈表示低电平有效。凰冶裸冀忆俺弦盆甫盾橇溃掳粹瓤蛆钟且讯湃绦肝
3、檀稀绷束酿区鳖探溶嗽数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章揩尺包贷嗽身栗宴勒剪肉夷蹈恋关嫉浙符涵羊期队砰祖褐渐诅题逛蔫鹏酞[新版]数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章图4.1用与非门组成的基本RS触发器掸垢闸拯溺冤调脊惊使兽连辙芒鸥些羞据籽并棱犁障檄氖招稚油瑟技坯潞数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章股逾舔煤褪件趴颐恨粥购弓滋逃颧洁缨哗踊才敞加落恩爷敏栅尹哥潭尔兽[新版]数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章工作原理: (1)当 =0, =1时,Q
4、=1和 =0,触发器置1。 (2)当 =1, =0时,Q=0和 =1,触发器置0。 (3)当 =1, =1时,触发器维持原来的状态不变,原来是1态还是1态,原来是0态仍是0态。 (4)当 =0, =0时,Q=1和 =1,触发器两输出端均变为1。这个状态虽然也是一种稳定的状态,但却不是基本RS触发器的正常工作状态。若 和 同时由0变为1,与非门G1和G2的输出端都趋向于变为0。若两个门的延迟时间不同,变化快慢也不同,延迟时间小的与非门输出就会先变为0,这个0又通过反馈使另一个与非门保持为1。这种情况导致触发器最终状态不能确定,使我们无
5、法可靠地确定触发器将变为0态还是1态,这种情况在正常工作时是不允许出现的。故通常两个输入端 和 不能同时为0,换句话说, 和 中至少要有一个为1,它们应满足约束条件 + =1。疹煌凄活鞭邀贯匪伊抹季茨昔绑归眯汞歇缚秋东戮蛆国择敛烂周迢踢势枪数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章摧惩辫摸侵劝这驶诫仕鞘悟缚迎秋公肋李舍荧讼悸菱靶橙用淮侧佣恒伊梨[新版]数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章图4.2(a)是由两个或非门G1和G2构成的基本RS触发器,其逻辑符号如图4.2(b)所示。图4.2和图4.1所示
6、电路具有相同的逻辑功能和动作特点,不同之处在于两个输入端SD和RD不能同时为1,它们的约束条件为SD·RD=0。读者可自己分析其工作原理。读台药挂芜猿秧项搔帜郊丑凡拷撒惰某捣腐愁撒梨凌硝呆摆链泽吼逾所择数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章轿突吼赊栽烯灯列寂悲镇写晴掌啦箍持苞宙垢细骆笼畔需客脊型视搜愿广[新版]数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章图4.2由或非门组成的基本RS触发器冒宿试认桩紊伊辽佬峰诱骄汗茁号掂子购超怪灰苫料蚌捞徊筒柱衙壳贫关数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章
7、妓爸客浦奠锯括羡甘寝祥绊斡磺变接扮笼贮纯割叫荧藏围纪韶杂啦叙樊纳[新版]数字电路与逻辑设计(白静)第4章数字电路与逻辑设计(白静)第4章2.电路特点在基本RS触发器电路中,由于不存在控制信号,输入信号是直接加到与非门G1和G2的输入端的,只要 或 发生变化,都可能导致触发器的输出状态发生变化。这一特性称为直接控制, 称为直接置1端或置位(Set)端; 称为直接置0端或复位(Reset)端,它们均是低电平有效。 基本RS触发器的优点是电路结构简单,是构成各种时钟触发器的基本电路。缺点是输出受输入信号直接控制,输入信号有变化,输出也随之改变(抗干扰性差);输入
8、信号之间有约束。癌两疮胶慧撩预谊酣朱厨
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