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时间:2020-10-04
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1、第一讲VHDL编程基础1.1概述1.2VHDL程序基本结构1.3VHDL语言要素1.1概述1.1.1常用硬件描述语言简介VHDLVerilogHDLABEL源于美国国防部的VHSIC源于集成电路的设计源于可编程逻辑器件的设计1.2VHDL程序基本结构1.2.1VHDL程序设计举例1)或门的逻辑描述LIBRARYIEEE;--IEEE库的使用说明USEIEEE.STD_LOGIC_1164.ALL;ENTITYOR2IS--实体OR2的说明PORT(A,B:INSTD_LOGIC;C:OUTSTD_LOGIC);ENDENTITYOR2;--实体OR2的结
2、构体ART1的说明ARCHITECTUREART1OFOR2ISBEGINC<=AORB;ENDARCHITECTUREART1;2)半加器的逻辑描述--IEEE库的使用说明LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;--实体H_ADDER的说明ENTITYH_ADDERISPROT(A,B:INSTD_LOGIC;CO,SO:OUTSTD_LOGIC);ENDENTITYH_ADDER;--实体H_ADDER的结构体ART2的说明ARCHITECTUREART2OFH_ADDERISBEGINSO<=AXORB;CO<
3、=AANDB;ENDARCHITECTUREART2;1.2.2VHDL程序的基本结构1.2.3库库(LIBRARY):用来存储预先完成的程序包和数据集合体的仓库。语句格式:LIBRARY库名;种类:IEEE库、STD库、WORK库、VITAL库用法:a.USE库名.程序包名.项目名;b.USE库名.程序包名.ALL;例:LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;1.2.4实体(ENTITY)1.实体语句结构实体说明单元的常用语句结构如下:ENTITY实体名
4、IS[GENERIC(类属表);][PORT(端口表);]ENDENTITY实体名;实体是对设计实体与外部电路进行接口描述,是设计实体经封装后对外的一个通信界面。3.PORT端口说明书写格式:PORT(端口名:端口模式数据类型;{端口名:端口模式数据类型});端口名:实体的每一个对外通道的名字端口模式:数据流动方式(4类)数据类型:数据的表达格式(主要2类)1.2.5结构体(ARCHITECTURE)结构体是用于描述设计实体的内部结构以及实体端口间的逻辑关系。两个层元素说明部分功能描述部分结构体构造语句格式:ARCHITECTURE结构体名OF实体名IS
5、[说明语句]BEGIN[功能描述语句]ENDARCHITECTURE结构体名;结构体说明语句:对结构体的功能描述语句中将要用到的信号(SIGNAL)、数据类型(TYPE)、常数(CONSTANT)、元件(COMPONENT)、函数(FUNCTION)和过程(PROCEDURE)等加以说明的语句。功能描述语句:功能描述语句结构可以含有五种不同类型(块语句、进程语句、子程序调用语句、信号赋值语句和元件例化语句)的,以并行方式工作的语句结构。而在每一语句结构的内部可能含有并行运行的逻辑描述语句或顺序运行的逻辑描述语句。1.3VHDL语言要素1.3.1VHDL文
6、字规则VHDL文数值标识符数字型字符串型位串型下标整数文字实数文字数制文字物理量文字1数字型文字整数文字:整数都是十进制的数,如:5,678,0,156E2(=15600),45_234_287(=45234287)实数文字:实数也都是十进制的数,但必须带有小数点,如:1.335,88_670_551.453_909(=88670551.453909),1.0,44.99E-2(=0.4499)以数制基数表示的文字:用这种方式表示的数由五个部分组成。SIGNALd1,d2,d3,d4,d5,:INTEGERRANGE0TO255;d1<=110#170#
7、;--(十进制表示,等于170)d2<=16#FE#;--(十六进制表示,等于254)d3<=2#1111_1110#;--(二进制表示,等于254)d4<=8#376#;--(八进制表示,等于254)d5<=16#E#E1;--(十六进制表示,等于2#1110000#,等于224)物理量文字(VHDL综合器不接受此类文字)。如:60s(60秒),100m(100米),k(千欧姆),177A(177安培)2字符串型文字(1)文字字符串(2)数位字符串"ERROR","BothSandQequalto1","X","BB$CC"B:二进制基数符号,表示二进
8、制位0或1,在字符串中的每位表示一个Bit。O:八进制基数符号,在字符串中的每一
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