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时间:2020-09-01
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1、三种FPGA综合工具的比较刘睿恒(2000/9/8)在使用FPGA做数字电路设计的流程中,综合是其中非常重要的一个步骤。同样的设计源代码,无论是VHDL或VerilogHDL,采用不同的综合工具综合会产生不同的结果。通过使用LeonardoSpectrumLevel3,Synplify6.0以及SynopsysExpress3.4三种综合工具对大小两类设计进行综合,并将综合得的网表送Quartus布局布线,分析两个步骤的结果后得到如下结论:1.针对较小的设计(1000LCs以下),三者综合后的结果是最高频
2、率差别较大,但经过Quartus布局布线后的结果差别并不太大;2.针对较大的设计(1000LCs以上),三者综合后的结果是最高频率差别较大,经过Quartus布局布线后的结果差别较大。下表为结果数据:LeonardoSpectrumLevel3Synplify6.0SynopsysExpress3.4CPLCs397409424Pre-fittingClock(MHz)134.86082Post-fittingClock(MHz)103.89495CPandVTLCs320832483549Pre-fit
3、tingClock(MHz)102.345.863.3Post-fittingClock(MHz)76.770.963.3根据上述的分析,无论对较大的或是较小的设计,采用LeonardoSpectrumLevel3综合的结果最好,相应进行布局布线的结果也最好。另,使用LeonardoSpectrumLevel3时,某些选项的设置需要注意:1.在选择综合策略时,选择Hierachy会提高综合后的速度;2.在指定好器件后,在窗口TechnologyàTechnologySettingàWire中选择apex2
4、0e_lab_default会得到最好的综合结果;3.在窗口OptimizeàAdvancedSettings中,不可选择“Donotusewiredelayduringdelaycalculations”和“Breakcombinationalloopsstaticallyduringtiminganalysis”两项。
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