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时间:2020-08-29
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1、精品文档目录目录.................................................0第一篇实验类.....................................1第一章通信原理基础实验............................2实验一CPLD可编程数字信号发生器实验..............2实验二各种模拟信号源实验........................5实验三抽样定理与PAM调制解调实验...............12实验四脉冲编码调制PCM与时分复用实验...........15实验五FSK(ASK)调
2、制解调实验.....................23实验六二相BPSK(DPSK)调制解调实验.............28附录实验实测波形...............................36第二篇上机类....................................420欢迎下载。精品文档第一篇实验类1欢迎下载。精品文档第一章通信原理基础实验实验一CPLD可编程数字信号发生器实验一、实验目的1.熟悉各种时钟信号的特点及波形;2.熟悉各种数字信号的特点及波形。二、实验仪器1.RZ8621D实验箱1台2.20M双踪示波器1台三、实验电路的工作原理(一)
3、、CPLD可编程模块二电路的功能及电路组成图1-1是CPLD可编程模块的电路图。CPLD可编程模块(芯片位号:U101)用来产生实验系统所需要的各种时钟信号和数字信号。它由CPLD可编程器件ALTERA公司的EPM240(EPM7128或者是Xilinx公司的XC95108)、下载接口电路(J101)和一块晶振(JZ101)组成。晶振用来产生16.384MHz系统内的主时钟。本实验要求参加实验者了解这些信号的产生方法、工作原理以及测量方法,才可通过CPLD可编程器件的二次开发(本实验箱提供专门的开发模块)生成这些信号,理论联系实践,提高实际操作能力。(二)、各种信号的功用及波
4、形1.12脚输入16.384MHz主时钟,方波。由晶振JZ101产生的16.384MHz时钟,经电阻R111,从12脚送入U101进行整形,然后分频、产生各种信号输出。2.27脚,输出2.048MHz时钟,方波。3.100脚,输出1.024MHz时钟,方波。4.6脚,输出64KHz时钟,方波。5.2脚,输出32KHz时钟,方波。6.1脚,输出16KHz时钟,方波。7.33脚,输出32KHz伪随机码。8.5脚,输出2KHz伪随机码。9.69脚,输出8KHz的窄脉冲同步信号,供PCM(一)编码模块用(时隙可变)。10.70脚,输出8KHz的窄脉冲同步信号,供PCM(二)编码模块用
5、(时隙可变)。8KHz的窄脉冲同步信号,可通过编程来改变它们的时序和脉冲宽度,学生可通过薄膜键盘选择,供PCM(一)模块、PCM(二)模块使用电原理示意图见如图1-1所示,由CPLD芯片U101、下载接口电路J101、一块晶振JZ101及外围一些电容电阻组成(有兴趣的同学,可以到网上搜索相关原器件的详细资料)。注:本实验平台中所有数字信号都是由同一个信号源JZ101分频产生,所以频率相同2欢迎下载。精品文档或者频率成倍数关系的数字信号,都有相对固定的相位关系。U101EPM7128SLC84-10(84)VCCGND333688634152376JZ101R11216.384
6、MHz100262TCK1VCCCLKI/OE2/GCLK2NNOOOOOOTCK12SYSCLOCK183IIIIIIII17GNDIN/GCLK1CCCCCCCCIO3484CCCCCCCC28PN32R1111IN/OE1VVVVVVVVIO45100INPUT/GLCRIOHDB3PN4857LCDRWIOIOHDB3CLK4958CSLCDIOIOPCM1F85060DB0IOIOPCM2F85161DB1IOIOPCMXCLK5263DB2SYSCLOCK1IOIOPAMCLK5464DB3IOIOPCMX5565DB4IOIOLCDRS5667DB5IOIO86
7、8DB6IOIO969DB7IOIO1070PSKTDATAIOIO1173PSKCLKIOIO1274C1024IOIO1575FSK32KIOIOC20481676FSK16KIOIOJC1477FSKCLKIOIONOISE1879FSKDATAIOIOSC2K20MAX7128SPLCC-84P-1080CVSDRCLKIOIO2181CVSDTCLKVCCIOIOTIME32PN2233CSLCD1IOIOWMDATA2434LCDRW1IOIOWMCLK2535LCDRS1R103R104R
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