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时间:2020-08-11
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1、7.2随机存取存储器(RAM)7.2.1静态随机存取存储器(SRAM)7.2.2同步静态随机存取存储器(SSRAM)7.2.5RAM7.2.3动态随机存取存储器(DRAM)7.2.4存储器容量的扩展7.2随机存取存储器(RAM)7.2.1静态随机存取存储器(SRAM)1.SRAM的基本结构及输出CEOEWE=1XX高阻CEOEWE=00X输入CEOEWE=010输出CEOEWE=011高阻SRAM的工作模式工作模式CEWEOEI/O0~I/Om-1保持(微功耗)1XX高阻读010数据输出写00X数据输入输出无效011高阻2.SRAM存储单元静态SRAM(StaticRAM)双稳态存储单元
2、电路列存储单元公用的门控制管,与读写控制电路相接Yi=1时导通本单元门控制管:控制触发器与位线的接通。Xi=1时导通来自列地址译码器的输出来自行地址译码器的输出2.SRAM存储单元静态SRAM(StaticRAM)T5、T6导通T7、T8均导通Xi=1Yj=1触发器的输出与数据线接通,该单元通过数据线读取数据。触发器与位线接通(a)地址控制的读操作(b)片选控制的读操作3.SRAM的读写操作及定时图读操作定时图写操作定时图7.2.2同步静态随机存取存储器(SSRAM)SSRAM是一种高速RAM。与SRAM不同,SSRAM的读写操作是在时钟脉冲节拍控制下完成的。寄存地址线上的地址寄存要写入
3、的数据ADV=0:普通模式读写ADV=1:丛发模式读写=0:写操作=1:读操作寄存各种使能控制信号,生成最终的内部读写控制信号;2位二进制计数器,处理A1A0ADV=0:普通模式读写=0:写操作WE=1:读操作WE普通模式读写:地址直接送到地址译码器,不受丛发控制逻辑电路影响,按外部给定地址进行读(写)操作。ADV=1:丛发模式读写丛发模式读写:地址寄存器不接受外部新地址,在其原有的地址上,由丛发计数器加1产生新地址。因此,可产生4个不同的地址。若超过4个CP后,ADV仍为1,则丛发计数器循环计数。地址总线让出。在由SSRAM构成的计算机系统中,由于在时钟有效沿到来时,地址、数据、控制等
4、信号被锁存到SSRAM内部的寄存器中,因此读写过程的延时等待均在时钟作用下,由SSRAM内部控制完成。此时,系统中的微处理器在读写SSRAM的同时,可以处理其他任务,从而提高了整个系统的工作速度。SSRAM的特点:1、DRAM存储单元T存储单元写操作:X=1=0T导通,电容器C与位线B连通输入缓冲器被选通,数据DI经缓冲器和位线写入存储单元如果DI为1,则向电容器充电,C存1;反之电容器放电,C存0。-刷新R行选线X读/写输出缓冲器/灵敏放大器刷新缓冲器输入缓冲器位线B7.2.3动态随机存取存储器(DRAM)读操作:X=1=1T导通,电容器C与位线B连通输出缓冲器/灵敏放大器被选通,C中
5、存储的数据通过位线和缓冲器输出T/刷新R行选线X输出缓冲器/灵敏放大器刷新缓冲器输入缓冲器位线B每次读出后,必须及时对读出单元刷新,即此时刷新控制R也为高电平,则读出的数据又经刷新缓冲器和位线对电容器C进行刷新。7.2.4存储器容量的扩展位扩展可以利用芯片的并联方式实现。···CE┇A11A0···WED0D1D2D3WECEA0A114K×4位I/O0I/O1I/O2I/O3D12D13D14D15CEA0A114K×4位I/O0I/O1I/O2I/O3WE1.字长(位数)的扩展---用4KX4位的芯片组成4KX16位的存储系统。7.2.4RAM存储容量的扩展2.字数的扩展—用8K8
6、位的芯片组成32K8位的存储系统。RAM1D0D7A0A12CE1芯片数=4RAM1D0D7A0A12CE1RAM1D0D7A0A12CE1RAM1D0D7A0A12CE1系统地址线数=15系统:A0~A14A13~A14?2000H2001H2002H┇3FFFH4000H400H4002H┇5FFFH6000H6001H6002H┇7FFFH0000H0001H0002H┇1FFFH芯片:A0~A1232K×8位存储器系统的地址分配表各RAM芯片译码器有效输出端扩展的地址输入端A14A138K×8位RAM芯片地址输入端A12A11A10A9A8A7A6A5A4A3A2A1A0对应的
7、十六进制地址码Ⅰ00000000000000000000000000010000000000010┇11111111111110000H0001H0002H┇1FFFHⅡ01000000000000000000000000010000000000010┇11111111111112000H2001H2002H┇3FFFHⅢ10000000000000000000000000010000000000010┇11111111111114
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