二进制运算电路解析课件.ppt

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1、二进制运算电路半加器和全加器的运算逻辑半加器全加器集成多位加法器芯片串行进位加法运算超前进位集成4位加法器74LS283全加器的应用数值比较器1分为不考虑低位来的进位和考虑低位进位两种情况半加器全加器两个1位二进制数相加的过程2不考虑低位进位，将两个1位二进制数A、B相加的逻辑运算半加器的真值表逻辑表达式逻辑图1000C011110101000SBA半加器的真值表C=AB1.半加器（HalfAdder）半加器和全加器31110111010011100101001110100110010100000CiSiCi-1BiAi全加器真值表全加器进行加数、被加数和低位来的进位信号的相加2.全加器（

2、FullAdder）4逻辑图全加器逻辑图与实现电路实现电路5两个半加器构成一个全加器611011001+011010011两个二进制数相加时，也分为不考虑低位来的进位和考虑低位进位两种情况。同时必须考虑各个位的进位两个4位二进制数相加的过程7集成多位加法器芯片1.串行进位加法器----采用四个1位全加器组成在电路上如何实现两个四位二进制数相加？A3A2A1A0+B3B2B1B0低位的进位信号送给邻近高位作为输入信号任一位的加法运算必须在低一位的运算完成之后才能进行串行进位加法器运算速度不高。874LS283逻辑图9Si=Ki⊕Ci-1Ci=Gi＋PiCi-1S0=K0⊕C-1=A0⊕B0⊕

3、C-1本位和信号的产生S1=K1⊕C0=A1⊕B1⊕C0S2=K2⊕C1=A2⊕B2⊕C1S3=K3⊕C2=A3⊕B3⊕C210Si=Ki⊕Ci-1Ci=Gi＋PiCi-1C0=G0+P0C-1C1=G1+P1C0=G1+P1G0+P1P0C-1C2=G2+P2C1=G2+P2G1+P2P1G0+P2P1P0C-1C3=G3+P3C2=G3+P3G2+P3P2G1+P3P2P1G0+P3P2P1P0C-1进位信号的产生112.超前进位集成4位加法器74LS28374LS283逻辑框图74LS283引脚图123.超前进位加法器74LS283的应用例1用两片74LS283构成一个8位二进制数加

4、法器在片内是超前进位，而片与片之间是串行进位。138421码输入余3码输出1100例2用74LS283构成8421BCD码转换为余3码的码制转换电路8421码余3码000000010010001101000101+0011+0011+0011CO14补码和反码的关系式:N补=N反+1。反码和补码这里只讨论数值码，不包括符号位原码自然二进制码反码将原码中的所有0变为1，所有1变为0后的代码。反码与原码的一般关系式：N反=（2n1）N原补码N补=2nN原原码：000101反码：111010111111补码：111011例3*利用加法器完成减法运算15加补码完成减法运算1）AB

5、0的情况。1010000100补码和反码的关系式:N补=N反+1进位反相借位2）AB<0的情况。01100借位11100进位反相0101-000101000001-0101-0100结果表明，在A–B0时，借位信号为0，所得的差就是差的原码。在A–B<0时，借位信号为1，所得的差是差绝对值的补码。16由加补码完成减法运算的减法器电路17数值比较器1数值比较器的逻辑功能2集成4位数值比较器74LS85集成数值比较器74LS85的功能数值比较器的位数扩展181数值比较器的逻辑功能输入输出ABFA>BFA

6、1位二进制数A、B进行比较数值比较器完成对两个二进制数A、B进行大小比较真值表逻辑表达式逻辑图1位数值比较器的逻辑图19先从高位比起，高位不等时，即可区别数值的大小当高位相等，再比较低位数，比较结果由低位决定2.多位数值比较器的设计原则2074LS8574LS85的引脚图74LS85比较器不仅能完成两个4位二进制数的大小比较，还能扩展为更多位数的数值比较74LS85的示意框图3.集成4位数值比较器74LS8521输入输出A3B3A2B2A1B1A0B0IA>BIABFAB3××××××HLLA3B2×××××HLL

7、A3=B3A2B1××××HLLA3=B3A2=B2A1B0×××HLLA3=B3A2=B2A1=B1A0