DC-DC电路Layout设计说明.doc

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1、DC-DC电路Layout设计说明1、DC-DC变换器是一个较强的电磁场干扰源，通常其EMI频谱范围自开关频率延伸至100MHz以上。为了减小电容性耦合和磁场环路耦合，必须将DC-DC变换器远离其它电路，尤其是小信号模拟电路。2、输入电容、旁路电容应该尽量靠近DC-DC芯片放置。旁路电容必须尽量靠近DC-DC芯片的输入电源引脚，输入电容可以放置在距离DC-DC芯片大约1 inch范围内。3、由于肖特基二极管一端连接DC-DC芯片的SW引脚，该引脚的信号为矩形波，若布线过长，走线的寄生电感就会很容易拾取到噪声，附加在SW信号中，形成噪声

2、尖峰。肖特基二极管的布局基本要点是紧靠IC放置，并采用短且宽的线直接连接DC-DC芯片的SW引脚和GND引脚。4、反馈采样电阻尽量靠近DC-DC芯片FB引脚。反馈走线要尽可能短，但是要远离噪声源比如电感和二极管，有时为了避开噪声源，走线走得长一些也是必要的。