可编程通用阵列逻辑.ppt

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1、8.2.0可编程阵列逻辑器件(PAL)简介8.2.1GAL器件的基本结构8.2.2输出逻辑宏单元OLMC8.2可编程通用阵列逻辑(GAL)6.4.3GAL的编程应用1.PAL结构8.2.0可编程阵列逻辑器件(PAL)简介1.PAL结构8.2.0可编程阵列逻辑器件(PAL)简介可编程与阵列输入端输入/输出端输出三态门输入缓冲器或门不可编程AnBnCnAnBnCn－1AnBnCn－1AnBnCn－1AnBnAnCn－1BnCn－12.PAL实现全加器逻辑函数8.2.0可编程阵列逻辑器件(PAL)简介(1)生产厂家对PAL器件的命名，前面

2、一般还有厂家的标志；(2)代表制造工艺：空白代表TTL，C代表CMOS;(3)代表PAL器件的最大阵列输入数；(4)代表输出电路类型。(5)代表最大的组合输出端数目或最大的寄存器数目。(6)表示器件功耗级别、速度等级，封装形式等信息。PAL器件的命名8.2.0可编程阵列逻辑器件(PAL)简介在PAL基础上增加触发器构成GAL；GAL既可以实现组合逻辑功能又可以实现时序逻辑功能8.2.0可编程阵列逻辑器件(PAL)简介组成:8个输入缓冲器8个输出/反馈缓冲器8个三态输出缓冲器8个输出逻辑宏单元1个时钟输入CLK缓冲器1个输

3、出使能缓冲器☆1个可编程的与阵列8.2.1GAL器件的基本结构输出逻辑宏单元（OLMC）结构D触发器或门异或门PTMUXOMUXTSMUXFMUX1个D触发器锁存或门的输出状态，使GAL可构成时序逻辑电路4个多路开关PTMUX：控制来自与阵列的第一乘积项TSMUX：选择输出三态缓冲器的选通信号FMUX：决定反馈信号的来源OMUX：控制输出信号是否锁存1个异或门用于控制输出信号的极性8.2.2输出逻辑宏单元（OLMC）输出逻辑宏单元（OLMC）结构8.2.2输出逻辑宏单元（OLMC）（1）乘积项多路开关PTMUX：AC0和AC1（n）

4、至少有一个为0时，第一与项成为或门的输入；否则地电平作为或门的输入；（2）输出多路开关OMUX：AC0AC1(n)等于10时，输出为DFF-Q（3）三态多路开关TSMUX：AC0AC1(n)选择三态控制信号11第一与项10OE01地00Vcc（4）反馈多路开关FMUX：AC0AC1(n)／AC1(m)选择反馈信号来源10Q端11本级输出端01邻级输出00地OLMC的工作模式控制信号SYN：共有同步信号；AC0：共有信号；AC1(n)：本级独立信号；AC1(m)：上（下）级独立信号；TSMUX输出低电平；三态缓冲器为高阻态；FMUX选

5、择来自邻级的输出信号接到与逻辑阵列的输入SYN=1AC0=0AC1(n)=1OLMC的工作模式专用输入模式8.2.2输出逻辑宏单元（OLMC）简化后的模式图参见P.313图8.2.8(a)TSMUX输出高电平；三态缓冲器为工作态；OMUX选择异或门输出；FMUX选择地电平反馈（无反馈可被借用）SYN=1AC0=0AC1(n)=0OLMC的工作模式专用输出模式8.2.2输出逻辑宏单元（OLMC）简化后的模式图参见P.313图8.2.8(b)TSMUX选择第一与项；三态缓冲器受第一与项控制；OMUX选择异或门输出；FMUX选择本级输出信

6、号反馈或本端口输入信号SYN=1AC0=1AC1(n)=1OLMC的工作模式反馈组合输入／输出模式8.2.2输出逻辑宏单元（OLMC）简化后的模式图参见P.313图8.2.8(c)TSMUX选择OE输出；三态缓冲器受OE控制；OMUX选择DFF-Q输出；FMUX选择DFF-/Q反馈；SYN=0AC0=1AC1(n)=0OLMC的工作模式寄存器输出模式8.2.2输出逻辑宏单元（OLMC）简化后的模式图参见P.313图8.2.8(d)SYN=0AC0=1AC1(n)=1OLMC的工作模式时序输入／输出模式TSMUX选择第一与项；三态缓冲

7、器受第一与项控制；OMUX选择异或门输出；FMUX选择本级输出信号反馈或本端口输入信号8.2.2输出逻辑宏单元（OLMC）简化后的模式图参见P.313图8.2.8(e)功能SYNAC0AC1(n)XOR(n)输出极性备注专用输入101_________1、11脚为数据输入，三态门不通专用组合型输出10001低电平有效高电平有效1、11脚为数据输入；三态门总是选通；所有输出都是组合型组合型输出11101低电平有效高电平有效1、11脚为数据输入；三态门由第一乘积项选通；所有输出都是组合型的组合型输入/输出01101低电平有效高电平有效1

8、脚CK、11脚OE；本级宏单元组合型，其余宏单元至少有一个是寄存器型寄存器型输出01001低电平有效高电平有效1脚=CK、11脚OE；本级宏单元寄存器型GAL16V8宏单元的5种组态小结8.2.2输出逻辑宏单元（OLMC）GAL器件的