硬件描述语言VHDL大总结.doc

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1、VHDL大总结一、填空题1.两种标识符短、扩展2.4种基本数据类型常量、变量、信号、文件3.常量说明格式constant常数名:数据类型：=表达式；4.三种数据变换方法？函数转换、常数转换、类型标记5.四种运算操作符？逻辑、关系、算术、并置6.如何启动进程?(1).必须包含一个显示的敏感信号变量(2).或者包含一个wait语句7.五种基本结构？库(library)、包集合(package)、实体(entity)、结构体(architecture)、配置(configuration)8.信号与变量代入？(1).<=(2).:=9.列举可编程逻辑器件?P

2、ROMàPLAàPALàCPLDàFPGAàEPROMàEEPROMàGAL10.数据类型整数、位、位矢量、符号、布尔量、时间、错误等级、标准逻辑11.四种端口模式？IN—OUT—INOUT—BUFFER12.三种子结构描述语句？BLOCK—PROCESS—SUBPROGRAMS1.结构体三种描述方式寄存器传输（RTL）--数据流、结构描述、行为描述2.标识符规则？(1).不以数字靠头(2).下划线不连续(3).不与保留字重复(4).下划线前后必须有英文字母或者数字(5).最后一个不能使用下划线（连字符）3.扩展标识符12@+4.赋值？(1).信

3、号、变量可以多次赋值(2).常量只能定义时赋值（进程内部，子函数内部）5.高阻、不定态？'Z'------------'X'6.进程位置？结构体内部7.变量位置?进程内部---包内部----子程序内部8.进程执行机制？敏感信号发生跳变9.优先级？if语句之间具有不同优先级10.时序电路的去驱动信号？时钟11.时序电路在何时发生变化？时钟信号的边沿12.两种状态机？(1).moore-----f(现状)(2).mealy-----f(现状，输入)1.什么有九值逻辑标准逻辑（STD_LOGIC）2.定义信号a，4位标准逻辑向量?SIGNALA:STD_L

4、OGIC_VECTOR(3DOWNTO0);3.定义变量b，整型，范围0到9SIGNALB:TNTEGERRANGE0TO9;4.空操作？NULL5.CPLD与FPGA?(1).基于乘积项技术—内带存储(2).基于查找表技术—需要外部扩展存储，比如扩展EEPROM6.IF语句三种类型？(1).门闩（shuan）控制(2).二选一控制(3).多选一控制7.常用库与包集合？LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_ARITH.ALL;USEIEEE.STD_LOGIC_UNSIGNE

5、D.ALL;8."/="的功能？在条件判断时判断操作符两端不相等9.串行与并行？(1).赋值语句—并行(2).IF语句------串行一、判断题1.缺少库文件LIBRARYIEEE2.缺少包集合USEIEEE.STD_LOGIC_1164.ALL1.实体定义的分号问题port(aaa;bbb;ccc);或者port(aaa;bbb;ccc);2.带入语句问题(1).信号---<=(2).变量---:=3.引号问题？(1).字符----''(2).字符串----""4.末尾分号问题(1).ENDCASE;(2).ENDPROCESS;5.PROCESS

6、必须赶上敏感信号？包含WAITON语句可以不列出6.VHDL与C语言没差别？(1).运行基础—CPU+RAM;逻辑、触发器组成的数字电路(2).执行方式---串行；并行(3).验证方式---变量值；时序逻辑关系7.进程之间传递用信号，非变量8.默认值数值型变量默认为0----------不要加引号（位变量）9.类型定义?typewris(wr0,wr1,wr2);定义的是类型需要为该类型定义对象才可以赋值10.设计方法?(1).传统------------自下至上(2).VHDL----------自上至下1.层次设计？高层次可以调用低层次2.进程语

7、句数量一个程序可以多个进程语句3.运算符优先级NOT>乘法>正负>关系>逻辑4.signalsel:integer?right5.进程内和进程外？原则上不一致，在没有敏感信号的前提下，可以认为一致6.定义实体至少包含一条portmap?false7.时间效率?状态机比计数器更有效，更紧凑一、简答题1.名称映射与位置映射？(1).名称：COM1:U1PORTMAP(A<=N1，B<=N2，C<=N3);(2).位置：PORT(A,B:INBIT;C:OUTBIT);引用时：U2：AND2PORTMAP(NSEL,D1，AB);2.调用库里面包含的元件的

8、方法？(1).COMPONENT(2).PORTMAP3.信号与变量的区别？(1).信号延时赋值，变量立即赋