实验三 数字频率计的设计.doc

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1、第页专业班级学号姓名成绩实验三数字频率计的设计一、实验目的：1、掌握十进制计数器的设计。2、掌握VHDL元件例化与调用方法。3、掌握时序控制器的设计。4、加深掌握VHDL程序设计方法和仿真测试、硬件测试方法。二、实验设备：1、计算机1台2、EDA实验箱1台3、导线若干三、实验原理：四、实验内容：程序清单：LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;USEIEEE.STD_LOGIC_UNSIGNED.ALL;ENTITYpljISPORT(fx,clk:INSTD_LO

2、GIC;led:OUTSTD_LOGIC_VECTOR(6DOWNTO0);sel:bufferSTD_LOGIC_VECTOR(1DOWNTO0));ENDENTITYplj;ARCHITECTUREbehavOFpljIS第页SIGNALcnt,q:STD_LOGIC_VECTOR(15DOWNTO0);SIGNALcnt1:STD_LOGIC_VECTOR(10DOWNTO0);SIGNALq4:STD_LOGIC_VECTOR(3DOWNTO0);SIGNALen,clr,lock:STD_LO

3、GIC;BEGINen<=cnt1(10);clr<=(NOT(cnt1(10)))AND(cnt1(9))AND(cnt1(8));lock<=(NOT(cnt1(10)))AND(not(cnt1(9)))AND(cnt1(8));PROCESS(fx,clr)--countfx;clrenfxBEGINIFclr='1'THENcnt<=(others=>'0');ELSIF(fx'EVENTANDfx='1')THENIFen='1'THENIFcnt(3downto0)<9THENcnt(3d

4、ownto0)<=cnt(3downto0)+1;ELSEcnt(3downto0)<="0000";IFcnt(7downto4)<9THENcnt(7downto4)<=cnt(7downto4)+1;ELSEcnt(7downto4)<="0000";IFcnt(11downto8)<9THENcnt(11downto8)<=cnt(11downto8)+1;ELSEcnt(11downto8)<="0000";IFcnt(15downto12)<9THENcnt(15downto12)<=cnt

5、(15downto12)+1;ELSEcnt(15downto12)<="0000";ENDIF;ENDIF;ENDIF;ENDIF;ENDIF;ENDIF;ENDPROCESS;PROCESS(clk)--count1024hzBEGINIF(clk'EVENTANDclk='1')THEN第页cnt1<=cnt1+1;sel<=sel+1;ENDIF;ENDPROCESS;PROCESS(lock)--cnt->lockBEGINIF(lock'EVENTANDlock='1')THENq<=cnt

6、;ENDIF;ENDPROCESS;PROCESS(sel)--q->q4decidedbyselBEGINCASEselISWHEN"11"=>q4<=q(3downto0);WHEN"10"=>q4<=q(7downto4);WHEN"01"=>q4<=q(11downto8);WHEN"00"=>q4<=q(15downto12);WHENothers=>null;ENDCASE;ENDPROCESS;进程2：--将1位十六进制Q4转换为7段LED显示（程序略）ENDbehav;五、实验结果描述：

7、FX输入1Hz显示0001FX输入2Hz显示0002FX输入4Hz显示0004