PCB设计FAQ集锦!学习做PCB的同学精读.pdf

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1、PCB设计的好坏直接决定了产品开发的质量和周期，它已成为产品设计链中的一个关键环节。在社会化分工越来越细的今天，PCB设计已逐渐成为一门独立的学科。随着高速设计时代的来临，PCB设计已经从以前简单的摆器件、拉线发展到一门以电工学为基础，综合电子、热、机械、化工等多学科的专业了。本文就PCB设计人员关注的问题结合专家的精辟解答予以讨论，并从理论和实际经验双重角度深度剖析与PCB相关的各种问题的实质及处理方法。Q1：pcb设计中需要注意哪些问题？A1：PCB设计时所要注意的问题随着应用产品的不同而不同。就象数字电路与仿真电路要注意的地方不尽相同那样。以下仅概略的几个要注意的原则。1、PCB层叠的

2、决定；包括电源层、地层、走线层的安排，各走线层的走线方向等。这些都会影响信号品质，甚至电磁辐射问题。2、电源和地相关的走线与过孔(via)要尽量宽，尽量大。3、不同特性电路的区域配置。良好的区域配置对走线的难易，甚至信号质量都有相当大的关系。4、要配合生产工厂的制造工艺来设定DRC(DesignRuleCheck)及与测试相关的设计(如测试点)。其它与电气相关所要注意的问题就与电路特性有绝对的关系，例如，即便都是数字电路，是否注意走线的特性阻抗就要视该电路的速度与走线长短而定。Q2：在高速PCB设计时我们使用的软件都只不过是对设置好的EMC、EMI规则进行检查，而设计者应该从那些方面去考虑E

3、MC、EMI的规则呢怎样设置规则呢？我使用的是CADENCE公司的软件。A2：一般EMI/EMC设计时需要同时考虑辐射(radiated)与传导(conducted)两个方面。前者归属于频率较高的部分(>30MHz)后者则是较低频的部分(<30MHz)。所以不能只注意高频而忽略低频的部分。一个好的EMI/EMC设计必须一开始布局时就要考虑到器件的位置,PCB迭层的安排,重要联机的走法,器件的选择等,如果这些没有事前有较佳的安排,事后解决则会事倍功半,增加成本。例如时钟产生器的位置尽量不要靠近对外的连接器,高速信号尽量走内层并注意特性阻抗匹配与参考层的连续以减少反射,器件所推的信号之斜率(sl

4、ewrate)尽量小以减低高频成分,选择去耦合(decoupling/bypass)电容时注意其频率响应是否符合需求以降低电源层噪声。另外,注意高频信号电流之回流路径使其回路面积尽量小(也就是回路阻抗loopimpedance尽量小)以减少辐射。还可以用分割地层的方式以控制高频噪声的范围。最后,适当的选择PCB与外壳的接地点(chassisground)。Q3：线路板设计如果考虑EMC，必定提高不少成本。请问如何尽可能的答道EMC要求，又不致带太大的成本压力？A3：PCB板上会因EMC而增加的成本通常是因增加地层数目以增强屏蔽效应及增加了ferritebead、choke等抑制高频谐波器件的

5、缘故。除此之外，通常还是需搭配其它机构上的屏蔽结构才能使整个系统通过EMC的要求。以下仅就PCB板的设计技巧提供几个降低电路产生的电磁辐射效应。1、尽可能选用信号斜率(slewrate)较慢的器件，以降低信号所产生的高频成分。2、注意高频器件摆放的位置，不要太靠近对外的连接器。3、注意高速信号的阻抗匹配，走线层及其回流电流路径(returncurrentpath)，以减少高频的反射与辐射。4、在各器件的电源管脚放置足够与适当的去耦合电容以缓和电源层和地层上的噪声。特别注意电容的频率响应与温度的特性是否符合设计所需。5、对外的连接器附近的地可与地层做适当分割，并将连接器的地就近接到chassi

6、sground。6、可适当运用groundguard/shunttraces在一些特别高速的信号旁。但要注意guard/shunttraces对走线特性阻抗的影响。7、电源层比地层内缩20H，H为电源层与地层之间的距离。Q4：在高速PCB设计时为了防止反射就要考虑阻抗匹配，但由于PCB的加工工艺限制了阻抗的连续性而仿真又仿不到，在原理图的设计时怎样来考虑这个问题？另外关于IBIS模型，不知在那里能提供比较准确的IBIS模型库。我们从网上下载的库大多数都不太准确，很影响仿真的参考性。A4：在设计高速PCB电路时，阻抗匹配是设计的要素之一。而阻抗值跟走线方式有绝对的关系，例如是走在表面层(mic

7、rostrip)或内层(stripline/doublestripline)，与参考层(电源层或地层)的距离，走线宽度，PCB材质等均会影响走线的特性阻抗值。也就是说要在布线后才能确定阻抗值。一般仿真软件会因线路模型或所使用的数学算法的限制而无法考虑到一些阻抗不连续的布线情况，这时候在原理图上只能预留一些terminators(端接)，如串联电阻等，来缓和走线阻抗不连续的效应。真正根本解决问题的方法还是布线时