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1、智力抢答器的设计姓名：弥耀轩学号：3707电本班一.课题说明在许多比赛活动中，为了准确．公正，直观地判断出第一抢答着，通常设置一台抢答器，通过数显．灯光及音响等多种手段指示出第一抢答者．同时，还可以设置计时．计分．犯规奖惩记录等多种功能．二．设计要求１．设计一个４组参加的智力竞赛抢大计时器．每组设置一个抢答按钮供抢答者使用．２．电路具有第一抢答信号的鉴别和锁存功能．在主持人将系统复位并发出抢答指令，当有某一组参赛者首先按下抢答开关时，数码管显示相应组别并伴有声响．此时，电路应具备自锁功能，使别组的抢答开关不起作用．３．电路具有回答问题时间控制功能．要求回答问题时间小于等于１００s（显示为０～
2、９９），时间显示采用倒计时方式。当达到限定时间时，发出声响以示报警。三．设计思路根据设计要求可知，系统的输入信号有：各组的抢答按钮d1.d2.d3.d4,主持人按钮host,系统时钟信号clk,数码管的片选信号；首先按下按钮的组别信号sel,声音信号sound,倒计时显示信号q[6.0].为实现设计要求，电路由抢答鉴别模块、锁存模块、转换模块、倒计时模块、片选信号产生模块、３选１模块、显示译码模块和一些门电路组成。总体框图如图１６—１所示。四.设计文件Feng.vhdLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYFENGISPORT(CP,CLR:
3、INSTD_LOGIC;Q:OUTSTD_LOGIC);ENDFENG;ARCHITECTUREFENG_ARCOFFENGISBEGINPROCESS(CP,CLR)BEGINIFCLR='0'THENQ<='0';ELSIFCP'EVENTANDCP='0'THENQ<='1';ENDIF;LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYSELISPORT(CLK:INSTD_LOGIC;a:OUTINTEGERRANGE0TO7);ENDSEL;ARCHITECTURESEL_ARCOFSELISBEGINPROCESS(CLK)VARIABL
4、EAA:INTEGERRANGE0TO7;BEGINIFCLK'EVENTANDCLK='1'THENAA:=AA+1;ENDIF;A<=AA;ENDPROCESS;ENDSEL_ARC;ENDPROCESS;ENDFENG_ARCSel.vhdLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYSELISPORT(CLK:INSTD_LOGIC;a:OUTINTEGERRANGE0TO7);ENDSEL;ARCHITECTURESEL_ARCOFSELISBEGINPROCESS(CLK)VARIABLEAA:INTEGERRANGE0TO7;BEGI
5、NIFCLK'EVENTANDCLK='1'THENAA:=AA+1;ENDIF;A<=AA;ENDPROCESS;ENDSEL_ARC;Lockb.vhdLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYLOCKBISPORT(D1,D2,D3,D4:INSTD_LOGIC;CLK,CLR:INSTD_LOGIC;Q1,Q2,Q3,Q4,ALM:OUTSTD_LOGIC);ENDLOCKB;ARCHITECTURELOCK_ARCOFLOCKBISBEGINPROCESS(CLK)BEGINIFCLR='0'THENQ1<='0';Q2<='0';Q
6、3<='0';Q4<='0';ALM<='0';ELSIFCLK'EVENTANDCLK='1'THENQ1<=D1;Q2<=D2;Q3<=D3;Q4<=D4;ALM<='1';ENDIF;ENDPROCESS;ENDLOCK_ARC;Ch41a.vhdLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYCH41AISPORT(D1,D2,D3,D4:INSTD_LOGIC;Q:OUTSTD_LOGIC_VECTOR(3DOWNTO0));ENDCH41A;ARCHITECTURECH41_ARCOFCH41AISBEGINPROCESS(D1,D2,D
7、3,D4)VARIABLETMP:STD_LOGIC_VECTOR(3DOWNTO0);BEGINTMP:=D1&D2&D3&D4;CASETMPISWHEN"0111"=>Q<="0001";WHEN"1011"=>Q<="0010";WHEN"1101"=>Q<="0011";WHEN"1110"=>Q<="0100";WHENOTHERS=>Q<="1111";ENDCASE;ENDPROCESS;EN
