Verilog有限状态机设计.ppt

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1、第8章Verilog有限状态机设计8.1VerilogHDL状态机的一般形式8.1.1为什么要使用状态机（1）高效的顺序控制模型。（2）容易利用现成的EDA优化工具。（3）性能稳定。（4）设计实现效率高。（5）高速性能。（6）高可靠性能。8.1VerilogHDL状态机的一般形式8.1.2一般有限状态机的结构1.说明部分2.主控时序过程8.1VerilogHDL状态机的一般形式8.1.2一般有限状态机的结构3.主控组合进程8.1VerilogHDL状态机的一般形式8.1.2一般有限状态机的结构4.

2、辅助进程接下页8.1VerilogHDL状态机的一般形式8.1.2一般有限状态机的结构4.辅助进程接上页8.1VerilogHDL状态机的一般形式8.1.2一般有限状态机的结构4.辅助进程8.1VerilogHDL状态机的一般形式8.1.3状态机设计初始控制与表述（1）打开“状态机萃取”开关。8.1VerilogHDL状态机的一般形式8.1.3状态机设计初始控制与表述（1）打开“状态机萃取”开关。8.1VerilogHDL状态机的一般形式8.1.3状态机设计初始控制与表述（2）关于参数定义表述（3

3、）状态变量定义表述8.2Moore型有限状态机的设计8.2.1ADC采样控制设计及多过程结构型状态机8.2Moore型有限状态机的设计8.2.1ADC采样控制设计及多过程结构型状态机8.2Moore型有限状态机的设计8.2.1ADC采样控制设计及多过程结构型状态机8.2.1ADC采样控制设计及多过程结构型状态机接下页接上页8.2Moore型有限状态机的设计8.2.1ADC采样控制设计及多过程结构型状态机8.2Moore型有限状态机的设计8.2.1ADC采样控制设计及多过程结构型状态机8.2Moor

4、e型有限状态机的设计8.2.2序列检测器之状态机设计接下页8.2Moore型有限状态机的设计8.2.2序列检测器之状态机设计接上页8.2Moore型有限状态机的设计8.2.2序列检测器之状态机设计8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计接下页8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计接上页8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计接下页8.3Mealy型有限状

5、态机的设计8.2.2序列检测器之状态机设计接上页8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计8.3Mealy型有限状态机的设计8.2.2序列检测器之状态机设计8.4SystemVerilog的枚举类型应用8.5状态机图形编辑设计方法8.5状态机图形编辑设计方法8.5状态机图形编辑设计方法8.5状态机图形编辑设计方法8.5状态机图形编辑设计方法8.

6、5状态机图形编辑设计方法8.5状态机图形编辑设计方法接下页8.5状态机图形编辑设计方法接上页8.5状态机图形编辑设计方法接下页8.5状态机图形编辑设计方法接上页8.6状态编码8.6.1直接输出型编码8.6状态编码8.6.1直接输出型编码8.6状态编码8.6.1直接输出型编码8.6状态编码8.6.1直接输出型编码8.6状态编码8.6.1直接输出型编码8.6状态编码8.6.1直接输出型编码8.6状态编码8.6.2宏定义命令语句`define8.6状态编码8.6.3顺序编码8.6状态编码8.6.4一位热

7、码状态编码8.6状态编码8.6.5状态编码设置1.用户自定义方式2.用属性定义语句设置8.6状态编码8.6.5状态编码设置2.用属性定义语句设置8.6状态编码8.6.5状态编码设置3.直接设置方法8.6状态编码8.6.5状态编码设置3.直接设置方法8.7非法状态处理8.7非法状态处理8.7.1程序直接导引法8.7非法状态处理8.7.2状态编码监测法8.7.3借助EDA优化控制工具生成安全状态机8.8硬件数字技术排除毛刺8.8.1延时方式去毛刺8.8硬件数字技术排除毛刺8.8.1延时方式去毛刺8.8

8、硬件数字技术排除毛刺8.8.2逻辑方式去毛刺8.8硬件数字技术排除毛刺8.8.2逻辑方式去毛刺8.8硬件数字技术排除毛刺8.8.3定时方式去毛刺8.8硬件数字技术排除毛刺8.8.3定时方式去毛刺习题8-1举二例说明，有那些常用时序电路是状态机比较典型特殊形式，并说明它们属于什么类型的状态机（编码类型，时序类型和结构类型）。8-2用mealy机类型，分别写出ADC0809和序列检测器的状态机。习题8-3根据图8-32（a）所示的状态图，分别按照图8-32（b）和图8-32（c）写出对