EDA技术及应用-Maxplus.ppt

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1、FPGA原理及应用原理图输入设计方法3.11位全加器设计向导3.1.1基本设计步骤步骤1：为本项工程设计建立文件夹注意：文件夹名不能用中文，且不可带空格。为设计全加器新建一个文件夹作工作库文件夹名取为My_prjct注意，不可用中文！步骤2：输入设计项目和存盘图3-1进入MAX+plusII，建立一个新的设计文件使用原理图输入方法设计，必须选择打开原理图编辑器新建一个设计文件图3-2元件输入对话框首先在这里用鼠标右键产生此窗，并选择“EnterSymbol”输入一个元件然后用鼠标双击这基本硬件库这是基本硬件库中的各种逻辑元件也可在这里输入元件名，如2输入与门AND2，输出引脚：OUTPUT图

2、3-3将所需元件全部调入原理图编辑窗连接好的原理图输出引脚：OUTPUT输入引脚：INPUT将他们连接成半加器图3-4连接好原理图并存盘首先点击这里文件名取为：h_adder.gdf注意，要存在自己建立的文件夹中步骤3：将设计项目设置成工程文件(PROJECT)图3-5将当前设计文件设置成工程文件首先点击这里然后选择此项，将当前的原理图设计文件设置成工程最后注意此路径指向的改变注意，此路径指向当前的工程！步骤4：选择目标器件并编译图3-6选择最后实现本项设计的目标器件首先选择这里器件系列选择窗，选择ACEX1K系列根据实验板上的目标器件型号选择，如选EP1K30注意，首先消去这里的勾，以便使

3、所有速度级别的器件都能显示出来图3-7对工程文件进行编译、综合和适配等操作选择编译器编译窗消去Quartus适配操作选择此项消去这里的勾完成编译！步骤5：时序仿真(1)建立波形文件。首先选择此项，为仿真测试新建一个文件选择波形编辑器文件(2)输入信号节点。图3-8从SNF文件中输入设计文件的信号节点从SNF文件中输入设计文件的信号节点点击“LIST”SNF文件中的信号节点图3-9列出并选择需要观察的信号节点用此键选择左窗中需要的信号进入右窗最后点击“OK”图4-9列出并选择需要观察的信号节点(3)设置波形参量。图3-10在Options菜单中消去网格对齐SnaptoGrid的选择(消去对勾)

4、消去这里的勾，以便方便设置输入电平(4)设定仿真时间。图3-11设定仿真时间选择ENDTIME调整仿真时间区域。选择60微秒比较合适(5)加上输入信号。图3-12为输入信号设定必要的测试电平或数据(6)波形文件存盘。图3-13保存仿真波形文件用此键改变仿真区域坐标到合适位置。点击‘1’，使拖黑的电平为高电平(7)运行仿真器。图3-14运行仿真器选择仿真器运行仿真器(8)观察分析半加器仿真波形。图3-15半加器h_adder.gdf的仿真波形(9)为了精确测量半加器输入与输出波形间的延时量，可打开时序分析器.图3-16打开延时时序分析窗选择时序分析器输入输出时间延迟(10)包装元件入库。选择菜

5、单“File”→“Open”，在“Open”对话框中选择原理图编辑文件选项“GraphicEditorFiles”，然后选择h_adder.gdf，重新打开半加器设计文件，然后选择如图3-5中“File”菜单的“CreateDefaultSymbol”项，将当前文件变成了一个包装好的单一元件(Symbol)，并被放置在工程路径指定的目录中以备后用。选择实验电路结构图6引脚对应情况实验板位置半加器信号通用目标器件引脚名目标器件EP1K30TC144引脚号1、键8：aPIO13272、键7bPIO12263、发光管8coPIO23394、发光管7soPIO2238步骤6：引脚锁定选择引脚锁定选项

6、引脚窗此处输入信号名此处输入引脚名按键“ADD”即可注意引脚属性错误引脚名将无正确属性！再编译一次，将引脚信息进去选择编程器，准备将设计好的半加器文件下载到目器件中去编程窗步骤7：编程下载(1)下载方式设定。图3-18设置编程下载方式在编程窗打开的情况下选择下载方式设置选择此项下载方式步骤7：编程下载(1)下载方式设定。图4-18设置编程下载方式(2)下载。图3-19向EF1K30下载配置文件下载（配置）成功！步骤8：设计顶层文件(1)仿照前面的“步骤2”，打开一个新的原理图编辑窗口图3-20在顶层编辑窗中调出已设计好的半加器元件(2)完成全加器原理图设计，并以文件名f_adder.gdf存

7、在同一目录中。(3)将当前文件设置成Project，并选择目标器件为EPF10K10LC84-4。(4)编译此顶层文件f_adder.gdf，然后建立波形仿真文件。图3-21在顶层编辑窗中设计好全加器(5)对应f_adder.gdf的波形仿真文件，参考图中输入信号cin、bin和ain输入信号电平的设置，启动仿真器Simulator，观察输出波形的情况。(6)锁定引脚、编译并编程下载，硬件实测此全加器的逻辑功