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时间:2020-01-23
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1、14.1双稳态触发器第14章触发器和时序逻辑电路14.2寄存器14.4由555定时器组成的单稳态触发器和无稳态触发器14.3计数器14.5应用举例本章要求1.掌握R-S、J-K、D触发器的逻辑功能及不同结构触发器的动作特点;2.掌握寄存器、移位寄存器、二进制计数器、十进制计数器的逻辑功能,会分析时序逻辑电路;3.学会使用本章所介绍的各种集成电路;4.了解集成定时器及由它组成的单稳态触发器和多谐振荡器的工作原理。第14章触发器和时序逻辑电路时序逻辑电路:由触发器和门电路组成,其输出状态不仅决定于当时的输入状态,而且与电路原来的状态有关,具有记忆功能。如寄存器,计数器等
2、。触发器是时序逻辑电路的基本单元门电路是组合逻辑电路的基本单元组合逻辑电路:主要由门电路组成,其输出状态完全由当时的输入变量的组合状态决定,与电路的原状态无关。如加法器,编码器,译码器等。概述返回1、时序逻辑电路:含有双稳态触发器的逻辑电路称为时序逻辑电路,简称时序电路。下一页上一页下一节返回3、双稳态触发器分类:●按逻辑功能分类:RS触发器、JK触发器、D触发器、T触发器……●按触发方式分类:电平触发、主从触发、边沿触发……●按结构分类:基本触发器、主从触发器、维持阻赛触发器。2、触发器:具有记忆能力的基本单元电路,分为单稳态触发器、双稳态触发器、无稳态触发器(多
3、谐振荡器)。特点:1.有两个稳定状态“0”态和“1”态;2.能根据输入信号将触发器置成“0”或“1”态;3.输入信号消失后,被置成的“0”或“1”态能保存下来,即有记忆功能。双稳态触发器:是一种具有记忆功能的逻辑单元电路,它能储存一位二进制码。14.1双稳态触发器14.1.1RS触发器1.基本RS触发器Q&G1&G2逻辑图SRQ图形符号这种触发器有两个稳定状态:(1),称为复位状态(0态);(2),称为置位状态(1态);基本RS触发器的逻辑式基本R-S触发器状态表逻辑符号RD:直接置“0”端(复位端)SD:直接置“1”端(置位端)QQSDRDSDRDQ100置001
4、1置111不变保持00同时变1后不确定功能低电平有效基本RS触发器的波形图Q不定状态不定状态不定状态逻辑符号SRQQRSRSQ11101初始状态Q010001011010011不定不定11翻转[例题]根据输入波形画出输出波形。下一页上一页下一节返回2.可控RS触发器SRQ图形符号S1SR1RC1CP&G3&G4Q&G1&G2RSCP逻辑电路当CP=0时R,S输入状态不起作用。触发器状态不变当CP=1时触发器状态由R,S输入状态决定。可控RS状态表00SR01010111不定Qn+1QnQn—时钟到来前触发器的状态Qn+1—时钟到来后触发器的状态逻辑符号QQSRCPS
5、DRDCP高电平时触发器状态由R、S确定跳转CPRSQ不定可控RS触发器的工作波形图(初态Q=0)例:画出可控RS触发器的输出波形。假设Q的初始状态为0。CPRSQSet使输出全为1CP撤去后状态不定Reset例:画出可控R-S触发器的输出波形RSCP不定不定可控R-S状态表CP高电平时触发器状态由R、S确定QQ0100SR01010111不定Qn+1Qn存在问题:时钟脉冲不能过宽,否则出现空翻现象,即在一个时钟脉冲期间触发器翻转一次以上。CP克服办法:采用JK触发器或D触发器00SR01010111不定Qn+1QnQ=SQ=R1.电路结构从触发器主触发器反馈线CP
6、CP1互补时钟控制主、从触发器不能同时翻转RSC从触发器QQQSDRDC主触发器JK14.1.2JK触发器2.工作原理主触发器打开主触发器状态由J、K决定,接收信号并暂存。从触发器封锁从触发器状态保持不变。01CPCP011RSC从触发器QQQSDRDC主触发器JK10状态保持不变从触发器的状态取决于主触发器,并保持主、从状态一致,因此称之为主从触发器。从触发器打开主触发器封锁0C01CP0101RS从触发器QQQSDRDJKCP主触发器010CP高电平时触发器接收信号并暂存(即主触发器状态由J、K决定,从触发器状态保持不变)。要求CP高电平期间J、K的状态保持不变
7、。CP下降沿()触发器翻转(主、从触发器状态一致)。CP低电平时,主触发器封锁,J、K不起作用1RS从触发器QQQSDRDJKCP主触发器01CP01CP0103、逻辑功能分析(1)J=1,K=1设触发器原态为“0”态翻转为“1”态110110101001主从状态一致状态不变011RS从触发器QQQSDRDJKCP主触发器状态不变CP01010设触发器原态为“1”态为“?”状态J=1,K=1时,每来一个时钟脉冲,状态翻转一次,即具有计数功能。(1)J=1,K=1跳转1RS从触发器QQQSDRDJKCP主触发器01CP010(2)J=0,K=1设触发器原态为“1”
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