数字电路实践2

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1、任务二计数器设计任务要求：设计一个8进制计数器，并在显示屏上显示数字0〜7。任务分析：8进制计数器是时序电路的设计内容。显示数据为组合电路设计内谷。图纸要求：图纸格式为A4纸、横向、毫米为单位，显示栅格和标题栏，符号标准用欧洲标准(DIN),图纸背景选择口底彩面。任务步』设计8进制计数器计数器的主要功能是对输入的CP脉冲进行计数。本设计采用同步加法计数的时序电路。随着计数脉冲CP的不断输入，触发器状态按规律进行计数。1、触发器状态关系：从十进制的角度来说应该是0t1t2t3t4t5t6t7t0总共8种状态，反复计数。8种状态写成二进制的关系应该是用三位二进制来表示000

2、t001t010t011t100t101t110t111t000。这样需要三个JK触发器(一个触发器一个输出Q端，来一次JK脉冲触发器输出就翻转一次，可以计数)。假设三个JK触发器的输入分别为OJOK、1J1K、2J2Ko输出为QzQiQoo2、根据要求列出触发器状态表计数CPQ2nQ；QonQ2n+1Q；+1Qon+1进位位c00000010100101002010011030111000410010105101110061101110711100013、利用逻辑转换仪可以得到电路的状态方程E00000000000100100020100003011100410010

3、05101100611010071110FGFGABC^+AC*e2进位位C=Q；Q；Q；e/,+1根据得到的方程，对应JK触发器的状态方程Q^=JQ^KQn得到丿严K严Q,J讦K2=Q；Q,4、画出电路图（1）在元件库中选择三个JK触发器74LS112D做记忆元件，选取方波发牛器Q-It①$做吋钟脉冲信号。方波发牛-器VI设置电压为5V,频率为100HZoL

4、能端RS均接至高电平（接到电源VCC）。JK输入端按照分析所得方程接。逻辑与门选用7408J芯片。进位位端用灯来显示，计数满后指示灯亮。（4）三个JK触发器的时钟信号都接在方波发生器+端以构成同步计数。方波发生器VI设置电压为5V,频率为100H乙17DDDDD仪析分辑逻用OooooooooooooOLogicAnalyzer-XLA1Time(S)115.000m127.800m140.600m153.400m166.200m179.000m(6)29230Tenn5Tam6Tenn7Tam.8Tohl9Tenn10Tam11Tam12Tenn13Tam14Tenn

5、15Tenn16Clodt-kilClockQuaStopReset115.0msD0D2176.3ms000161.3msT1T2T1-T2ClockClocks/Div64Set...ExternalQualifier在三个触发器输出端分别接上探测针STriggerSet...Qualifier针的变化。（7）设计结论：输出信号的变化情况是000t001t010t011t100t101t110t111t000,符合设计要求。二、将输出的计数信号送到显示屏上显示。（1）显示电路（2）BCD码就是从触发器输出的信号，关键是选择译码器和显示器。KaneList.szvn.

6、szG.Disnjj（3）设计中信号是三位的，所以选用74LS48D芯片。显示器选用七DEbdNselnlUsxnCppo曾tHn.DISPUJCmpongtSIVII^SIG.COII.KMwtuf^cturtrG«»«r>cMod«lL«v«lLIFootprint:Function：Symbol(UM)段数码显示管粵L囿tr«fOAdvanced...tfelp（4）设计逻辑电路图。输入信号是三位，选用IC的输入端为4位，所以第4位（IC的第6脚）设计为接地端即“0”电位，因为0000和000、0001和001的结果是一样的。IC的第7、1、2脚分别接Q0、Q］、

7、Q2oIC的输出引脚经电阻（阻值为3.9K）分别接到显示器的A〜G脚。IC的功能端接高电平（电源VCC）。（5）电路图如下SE运行仿真程序调试，调试通过。三、附整体电路图四、设计心得: