数字电路与逻辑设计第五章

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1、第5章常用时序逻辑模块及其应用常用时序逻辑模块计数器寄存器基本原理管脚功能实际应用5.1计数器能对脉冲的个数进行计数的电路称计数器。把计数电路用集成工艺制造在一个芯片内，并引脚封装成集成模块计数器模块的分类按数的进制分按计数规律分按触发信号分按使用的开关元件分十进制计数器加法计数器减法计数器器可逆计数器（可加或减）同步计数器异步计数器TTL计数器CMOS计数器二进制计数器N进制计数器（除了二、十进制外的进制）5.1.2典型计数器模块1．74LS169同步计数可逆（可进行加或减法记数）二进制（四位二进制记数，0

2、000～1111，16种计数状态）同步预置数输入（在CP下可置0000～1111中的任意状态）动态进位输出（记数至1111时同时输出进位信号）74LS169VCC45671612389101112131415GNDENPENTV/DCLKLOAD0132DDDDRCO0132QQQQENPENTRCOV/DCLKLOAD0132DDDD0132QQQQ74LS169引脚图功能图输出置数输入控制输入V/ENP能使端，低电平有效GND电源负端LOAD预置数端，低电平有效。LOAD=0时有效，将d3～d0数置入计数

3、器ENT能使端，低电平有效，与ENP配合使用Q3～Q0数据输出端RCO动态进位输出端VCC电源正端加/减控制端，=1加法，=0减法V/V/CLK计数脉冲输入端D3～D0预置数输入端ENPENTRCOV/DCLKLOAD0132DDDD0132QQQQ74LS169输出置数输入控制输入输入输出ENP+ENTDV/LOADCLKD3D2D1D0Q3Q2Q1Q01×××××××保持原状态0×0↑d3d2d1d0d3d2d1d0011↑××××二进制加计数001↑××××二进制减计数74LS169无清零端。当预置数端

4、全接“0”，LOAD=0时即清“0”。当预置数端输入不同数时，可作为定值控制电路使用。两块以上串接使计数容量扩展。功能表ENPENTRCOV/DCLKLOAD0132DDDD0132QQQQ74LS169输出置数输入控制输入1．74LS90同步计数二、五、十进制异步清0、异步置9（不需CP触发即可置0000、置1001）74LS90VCC456712391011121314GNDNC012192RCPRCPNC0132QQQQ9102RR80132QQQQ÷51CP2CP01R02R91R92R÷274LS9

5、0引脚图功能图输出控制端0132QQQQ÷51CP2CP01R02R91R92R÷274LS90功能说明：置数功能：当R01=R02=1，R91·R92=0，使计数器清零，即将Q3Q2Q1Q0=0000当R01·R02=0，R91=R92=1，使计数器置9，即将Q3Q2Q1Q0=1001。二进制计数（模二）功能：即÷2电路，也称2分频，由CP1输入，Q0输出。五进制计数（模五）功能：即÷5电路，也称5分频，由CP2输入，Q3Q2Q1输出。十进制计数（模十）功能：即÷10电路，也称10分频，由CP1输入，CP2

6、接Q0，Q3Q2Q1Q0输出8421十进制数；由CP2输入，CP1接Q3，Q0Q3Q2Q1输出5421十进制数。输入输出说明R01R02R91R92CP1CP2Q3Q2Q1Q0110×××0000异步清011×0××0000异步置00×11××1001异步置9×011××1001异步置9×0×0↓0二进制计数由Q0输出×00×0↓五进制计数由Q3Q2Q1输出0××0↓Q08421码十进制计数由Q3Q2Q1Q0输出0×0×Q3↓5421码十进制计数由Q0Q3Q2Q1输出0132QQQQ÷51CP2CP01R02

7、R91R92R÷274LS903．74LS163同步计数加法计数器二进制（四位二进制记数，0000～1111）同步预置数输入（在CP触发下可置0000～1111中的任意数）同步清零输入（在CP触发下可使Q3Q2Q1Q0=0000）74LS163VCC45671612389101112131415GNDENPENTCLRCLKLOAD0132DDDDRCO0132QQQQENPENTRCOCLRCLKLOAD0132DDDD0132QQQQ74LS163引脚图功能图功能说明：当CLR=0时，使计数器同步清零。E

8、NPENTRCOCLRCLKLOAD0132DDDD0132QQQQ74LS163当CLR=1，LOAD=0时，使计数器同步置数，将d3d2d1d0输入计数器。当CLR=LOAD=1且使能端ENP=ENT=1时，计数器同步计数。当CLR=LOAD=1且使能端ENP、ENT中至少有一个为0时，计数器保持状态不变。ENPENTRCOCLRCLKLOAD0132DDDD0132QQQQ74LS163000