《论文_定时电路的设计(定稿)》

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1、定时电路的设计(论文)摘要：根据定时电路的设计要求，我们把该电路的工作过程分为三步进行：首先设置需要定时的时间；然后启动定时计数器开始计时，计时釆用倒计时的方式工作，同时显示倒计时的时间；最后当定时结束时产生报警信号，用发光二极管指示定时结束。关键词：分频器、时钟计数器、时钟振荡器、数码显示器、定时控制电路系统的功能描述：②系统组成及基本原理。定时电路原理图如图1所示，该屯路由振荡器、计数器、时间显示、定时控制、定时时间设置几个部分组成。定时时间设置。时间设置电路可实现分的设置。由于采用减计数方式，设置的时间就是需要的定时时间。分的设

2、置有两个过程：计数开始前为人工预置定时时间的分，此时Sl=o,A13导通,A14断开，人工预置的时间分钟通过A13数据总线驱动器的D6〜DO送入A9、A10计数器的数据端。计数开始时，S1=1,A13断开，人工预置的分钟数据就不能通过A13送入A9、A10分计数器的数据端。在减计数的过程中，分计数器从59减到Oo由于A14的使能端接A9的借位端，当A9、A10分计数器减到0时，A14导通使A9、A10自动设置到59o计数、显示、分频。计数器是整个定时系统的主要部分。由4块十进制加减计数器74LS168构成减法计数器。分和秒计数器的模值

3、都是60。计数器的输出通过数码管驱动译码器A3〜A6去驱动共阴极数码管显示时间，显示的时间值为分、秒。计数器的计数时钟频率为1Hz,由晶体振荡器产生的32.768Hz时钟，经过A17、A18两片计数器2的15次方分频得到。定时启动和定时控制。设置好定时时间的分值后，拨动开关S1接地(Sl=0),D触发器(A15)的2=1,设置的时间值送入计数器并显示。S1再拨到UCC时(Sl=l),减计数定时开始。当时间值减到全0时，A15的CLK端产生上升沿，使Q=0,显示器全灭，发光二极管VI亮。该电路的定时结束指示电路也可以根据需要改成不同形式

4、的控制方式，如控制继电器的通断、定时发声报警、定时产生启动信号等等。实验电路图1三・芯片功能1.54/74LS244三态八缓冲器/线驱动器/线接收器（3S，两组控制）244为三态输出的八组缓冲器和总线驱动器，其主要屯器特性的典型值如下型号tPLHtphlPd54LS241/74LS241引出端符号:1A1〜1A4,2A1〜2A，/1G/2G1Y1〜1Y4,2Y1〜2逻辑图:25812ns1Y12A41812118910功能农:InputsOutputGAYLLLLHHHXZ61G1A12Y41A22Y31A32Y21A42Y1GNOl

5、lOmW2.74LS168十进制同步加/减计数器168为可预置的十进制同步加/减计数器，共有54S168/74S168,54LS168/74LS168两种线路结构形式。其主要电特性的典型型号值如下:型号fcPDPD54168/74S16855HZ500mW54LS168/74LS16835HZlOOmW168的预置是同步的。当置入控制端（PE..）为低电平时，在CP上升沿作用下，输出端（Q0〜Q3）与数据输入端（P0〜P3）相一致。168的计数是同步的，靠CP同时加在4个触发器上而实现。当CEP和CET为低电平时，在CP±升沿作用下Q

6、0〜Q3同时变化，从而消除了异步计数器屮岀现的计数尖峰。当计数方式控制（U/D）为低电平时进行减计数。CEP和CET的跳变不受CP状态的限制。168有超前进位功能。当计数溢出时，进位输出端（TC）输出一个低电平脉冲，其宽度为：加计数时为Q0的高电平部分；减计数时为Q0的低电平部分。利用CEP、CET、TC端，在不外加门电路的情况卜•，可级联成N位同步计数器。168有独立的时钟电路，在CP出现前，即使CEP、CET、PE和U/D发生变化，电路(P:减U/D-CP-P0-P1-P2-P3—CEP-5D-1234567816一％C15-fc

7、14-0013-Q112■•-02U/D〉时钟输入端F有效）po〜出端U/D加/模式选择PFCEPC^Tu/uActiononRisingClockEdgeLXXLoad(Pn—*Or.)HLHCountUp(Increment)HLLCountDown(Decrement)HXXNoChar>9e(Hold)HHXNoChar>ge(Hold)CET•LS16BModeSelectTable1.54/7408四2输入与门08为四组2输入端与门（正逻辑）,共有54/7408>54/74S08、54/74LS08三种线路结构型式，其主要

8、屯特性的典型值如下：A2B?T2GMD引脚线如图1所10计数器正常T彳CR加电4040功能表:输入输出状态CPCRt0保持00保持10计数C（任意值）1所有输出端为0四.元器件列表元器件如下所示:元器件名称数量（个）共阴