数字电路与逻辑设计B试题B卷

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1、fa報导——II那题号—二三四五六七八九总分得分评卷人试卷类型：(B)考试专业、年级：计科、软件、网络、物联网、安全、自动、测控、电气12级与非一与非表达式为;其反函数F=对偶式尸=。(反函数和对偶式根据规则直接写)高电平噪声容限卩册=Vo年月日西安邮电大学课程考试试题(B卷)考试用(2013——2014学年度第二学期)课程名称：数字电路与逻辑设计B一、填空题(共20分，每空1分)1.(33.2)8=()2=()16={)10=()8421BCD=()余3BCD2.逻辑函数F=AB+AC+BC的最小项表达式为F(A,B,C)=Zw()，3.逻辑代数中，三种基木的

2、逻辑运算是、和o4.某TTL与非门的标准输入高电平VH=3.6伏，标准输入低电平Vn=0.3伏,关门电平Voft-1.2V,开门电平Von=2.0V,则低电平噪声容限％二Y，5.一个初始状态为010的模值为8的同步递加计数器经过22个CP脉冲后，其状态为O6.一个16选一的数据选择器，其地址输入端有个。7.若要使J・K触发器的Q网=0",其输入端J=,K=&数字逻辑电路分为和二、判断题(正确的打丁，错误的打X,共5分，每小题1分)1.()因为逻辑表达式A+B+AB=A+B成立，所以AB=0成立。2.()所有的TTLfJ电路的多余输入端可以悬空，相当于接1。3.(

3、)组合逻辑电路在某个时刻的输出不仅和当时的输入有关，还取决于电路以前的状态。4.()RS触发器的约束条件RS=0表示不允许出现R=S=0的输入。5.()同步二进制计数器的电路比异步二进制计数器复杂，所以实际应用屮较少使用同步二进制计数器。B——&—r100k1图1三、选择题(共20分，每小题2分)1.TTL或非门电路如图1所示，输出F=A.0B.1C.ABD.A+B2.对于D触发器，若要Qn+l=Qn,应使输入D=A.0B.1C.QD.Q3.把一个八进制计数器与一个四进制计数器级联可得到进制计数器。A.4B.8C.32D.124.电路如图2所示，74283为四位

4、二进制全加器，管脚A4A3A2AKB4B3B2B1B0分别为被加数、加数，管脚SUM4SUM3SUM2SUM1为本位和，管脚CIN为低位向本位的进位，管脚COUT为本位向高位的进位，外接信号Mo分析电路，下列说法正确的是A.M=0,SUM4SUM3SUM2SUM1为1001,B.M=0,SUM4SUM3SUM2SUMI为1001,C.M=l,SUM4SUM3SUM2SUM1为0001,A.M=l,SUM4SUM3SUM2SUM1为0001,煞5.电路如图3所不，该电路是A.一位全加器B.一位全减器C.一位数值比较器D.以上答案都不对6.电路如图4所示,A.574

5、U874161和74138的功能表见试卷最后，该计数器的模值为B.6C・7D.8ycLLJI1TI■)c?•AiRD讪At¥53W3PNT74138Y-ld1NPYsdCLR1-Y3>CLKRCC{STcY-l3图4躱7.74194构成的电路及其功能表如图5所示该电路是A.可以自启动的环形计数器B.不可以自启动的环形计数器C.可以自启动的扭环形计数器D.不可以自启动的扭环形计数器0CP筒人输IIIciRSIsoSRSI.CLKQaQhQn0XXXXX0000111XXkABcr>1010XAk0•A1011XJI1Qa"Qn110X0Jk•KQtp01I0X

6、1A'•nT31100XXX悚丁4IN4俺贬图5&在函数F=AC+B万的真值表中，F=1的状态有个A.2B.4C・6D.79.以下电路中，是时序逻辑电路。A.寄存器B.数值比较器C.全加器D.数值比较器10.电路如图6所示，该计数器的模值为—A.12B.10C.7D.5CP图6（5分）（5分）（5分）（5分）四、化简题（共10分，每小题5分）1.用代数法将函数F=A（B㊉C）+ABC+ABC化简为最简与或式。2.用卡诺图化简函数F（A,B,C,D）=》m（1,3,7,9,11,13,15）+Zd（0,5,8）五、组合逻辑电路如图7所示，要求如下：（共20分）1.

7、分析该电路，写出输出函数表达式，列出真值表；2.用最少的与非门重新实现该电路，画出逻辑图；3.用3线线译码器74138重新实现该电路，画岀逻辑图;4.用4选1数据选择器重新实现该电路，画出逻辑图图7t申S聯嵐畔咻綁——口—躱六、电路如图8所示，分析该电路。要求写出激励函数表达式、状态转移方程、列完整状态转移表、画状态转移图，说明该电路是否有自启动性。设触发器的初始状态均为0,画Q、Q2、Qs波形。（15分）CPcp—n_n_n_n_n_n_n_n_QiQ2Qs图8七、用一片74161设计一个状态从0000开始的模12计数器。完成以下要求。74161的逻辑符号和功

8、能表见试卷最后。（共10