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1、目录第一章绪论错误!未定义书签。1.1摘要错误!未定义书签。1.2关键词误!未定义书签。1.3引言错误!未定义书签。第二章时序逻辑电路错误!未定义书签。2.1时序逻辑电路的基本概念错误!未定义书签。2.2时序逻辑电路的组成错误!未定义书签。2.3时序电路的基木单元错误!未定义书签。2.4时序逻辑电路的表示方法错误!未定义书签。第三章时序逻辑电路的分析错误!未定义书签。3.1时序逻辑电路的分析方法错误!未定义书签。3.2同步时序逻辑电路的分析错误!未定义书签。3.3异步吋序逻辑电路的分析错误!未定义书签。第四章时序逻辑电路的设计错误!未定义书签。
2、4.1设计同步时序逻辑电路的一般步骤错误!未定义书签。4.2同步时序逻辑电路设计举例错误!未定义书签。第五章总结错误!未定义书签。时序逻辑电路的设计第一章绪论1・1摘要：时序逻辑电路设计是《数字电子技术》课程中一个难度大、综合性高的部分,它综合了组合逻辑电路和时序逻辑电路的内容。在进行状态机设计时，随着输入逻辑变量的增加，状态数FI将呈指数倍急剧增加，这会使整个设计变得复杂且容易出错。以一个延时开关控制器的设计为例，提出了一种状态机输入变量简化的方法，降低了设计过程的复杂程度。1.2关键词：吋序逻辑电路、延吋开关、状态机化简、D触发器1.3引言
3、：1•时序逻辑电路的分析和设计是自动化、电气、通信、电子等电类专业必须掌握的重要专业基础，是《数字电子技术》的核心内容、学习的重点和难点。只有通过对它的研究与实践，才能真正具有设计数字电路的能力。2.设计吋序逻辑电路可分以下几个步骤(1)根据设计要求，建立原始状态表或状态图。(2)对原始状态表或状态图进行化简。(3)对化简后的原始状态表或状态图，进行状态分配和编码，得到二进制编码形式的状态表或状态图。(4)选定触发器类型，根据电路的状态确定所需的触发器的个数；根据状态表导出状态方程和输出方程，再推出驱动方程。(5)根据输出方程及驱动方程设计出逻
4、辑电路图。(6)判断电路能否自启动，如不能，需重新设计。以上是基本步骤，实际屮有时可以简化。3.同步时序逻辑电路的设计方法可按以下几个步骤进行：设计要求;原始状态图;最简状态图;状态分配;选定触发器类型，求出状态方程、驱动方程和输出方程;画逻辑电路图并检查能否自启动。通过对延时开关电路这一具体实例的设计，对时序逻辑电路设计的一般规律、原则、方法及步骤作了探讨和研究。1.时序逻辑电路简称时序电路，其结构特点是由存储电路和组合电路两部分组成，或通俗地说由触发器和门电路组成，时序电路的状态是由存储电路来记忆的，因而在时序逻辑电路中，触发器是必不可少的
5、，而组合逻辑电路在有些时序电路中则可以没有。第二章时序逻辑电路2.1时序逻辑电路的基本概念J组合逻辑电路——组合电路数字逻辑屯路［时序逻辑电路——吋序电路厂功能上：任何时刻的稳定输出，不仅与该时刻输入有关，还与电路原状态有关，即时序逻辑电路<与以前的输入有关。<结构上：由组合电路和存贮电路组成。2.2时序逻辑电路的组成模型X
6、Xn时序电路输入组合电路内部:薪人Iyiyr［存储电路!输出I存储电路存储电路］输入：二、时序电路分类1.按有无统一时钟脉冲分同步一一有统一CP,状态变更与CP同步。异步一一无统一CP,状态变更不同步，逐级进行2.按输出
7、信号特点分米里型一一输岀信号不仅与存贮状态有关,述与外部输入有关。莫尔型一一输出信号仅与存贮状态有关。3.按通用性功能分典型吋序一一移存器、计数器、序列信号发生/检测器一般时序一一任意时序逻辑命2.3时序逻辑电路的基本单元一、基本触发器的基本特点1.具有两个稳定状态，用来表示逻辑状态0和1,或二进制数的0和1。2.在一定触发器信号作用下，可以置成1态或0态。r电路结构：基本RS、同步RS、主从触发器、维持阻塞、CMOS边沿3.触发器种类YL逻辑功能：RS触发器、D触发器、JK触发器、T触发器二、基本RS触发器1•逻辑功能:触发器状态不变易=0舄
8、=1Q=lQ=o触发器置1，并保持拆=0兀=oQ=Q=1触发器状态失去互补且当输入信号同时消失，即同时变为1时，触发器状态不定2.基本RS触发器特性表©说明0000011*r不允许010101111110100100to11110101保持三、同步触发器指触发器按一定的时间节拍动作，即触发器的翻转时刻受时钟脉冲的控制。时钟脉冲(ClockPulse)简称CP1•同步RS触发器2.4时序逻辑电路的表示方法一、时序逻辑电路的框图表示X(xl,x2,…，xn)Q(ql,q2,…,qm)Y(yl,y2,…,yj)Z(zl,z2,…，zk)时序电路的外部
9、信号或称输入变量；内部输入，或称记忆元件的状态输出函数;时序电路的外部输出；内部输出，或称存储电路的激励函数。"小0输出方程Z=G[X,0]驱动方程或
