采用高速16位ADC的无线基站设计挑战

采用高速16位ADC的无线基站设计挑战

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时间:2019-09-22

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1、采用高速16位ADC的无线基站设计挑战随看通信接收机灵活度越來越人,多标准/多运营商的无线电需要更宽的数字化带宽,因此单个频率信道上功率的降低和带内阻塞信号出现概率的增加进而要求具备更高的灵敏度。因此,数模转换器的噪声和失真效果十分关键。本文将讨论把数模转换器集成在基站应川过程屮所面临的性能方面的上要挑战,重点是转换器的驱动和记时。如图1所示,某基站应用屮的高灵敏度屮频(IF)采样了系统通常包括•个高速ADC,一个精密时钟解决方案和一个数控可变增益放人器(DVGA),由自动增益控制(AGC)环路实现其增益

2、控制。数控可变增益放人器同时作为ADC的缓冲/驱动接口和增益模块,用来消除输入信号较小时ADC噪声带來的影响。时钟解决方案提供了一种nJ以将数据转换为数字形式的低噪声釆样时钟。SimplifiedReceiverABPF■F*DCV141JClockingSolutionAGCISOdIFSamplingReceiverSubsystem图1带冇通信接收机的中频采样子系统框图将DVGA和ADC进行级联时带來的诸多挑战需要认真对待以确保相关性能的实现。这些挑战包括:降低由DVGA引入的失真;确保由DVGA至

3、ADC接口的信号完整性;降低所连接ADC输入端的切换噪声;降低DVGA噪声的影响;利川ADC的全输入动态范围。前三个挑战与子系统的失真性能有关,并且限制了信号通道的无杂散动态范围(SFDR)oDVGA的谐波失M,lIlADC输入切换引入的信号独立充电反冲,接口阻抗不匹配和倍号反射等都会导致频谱中岀现虚假信息,进而干扰有用频段。后两个挑战与子系统的信噪比(SNR)性能密切相关。由于DVGA噪声降解和转换器全输入范围无法充分利用而引入过量噪声将总接损失SNR,造成功率的浪费。以上儿种挑战相互依存,各有折衷。这

4、些挑战大多可以利用一个高性能DVGA來解决,并可以在DVGA和ADC之间插入一个阻抗匹配的怎分髙阶带通滤波器,从而对DVGA加以补偿。滤波器抑制了DVGA的谐波失真,限制了DVGA的噪声带宽,很人程度减小了ADC接口上与阻抗有关的信号完整性问题。不幸的是,阻抗匹配的高阶滤波器在实践中往往具有较高的插入损失,并口対于元件不匹配和PCB寄半干扰较为敏感。滤波器阶数与损失Z间的关系在DVGA和ADC接口的设计屮是一个重要的权衡指标。当信号接近DVGA功率轨道时,提高DVGA的输出信号摆动将会降低DVGA的谐波失

5、真和三阶输出交调截取点OIP3。另外,带通滤波器的谐振特性不能苗效地抑制来口于典型流水线ADC输入切换信号相关脉冲式的充电反冲,li'u这种流水线ADC对于大幅度信号十分重要。这样-•种滤波器接口解决方案在新型的SP16160CH1RB了系统设计板中以不对称TI儿配带通滤波器的形式呈现。如图2所示,该滤波器提供了四阶高频衰减以实现40dB-一.级谐波(H2)衰减,在普通中频IF频带内的通带波纹小于0.5dBoLCT匹配提供了阻抗转换功能,可以实现较小的通带衰减,并保持DVGA输入源电阻和负载电阻之间的阻抗

6、匹配。这种结构只需要将电容元件和多数串联电感进行并联,因此对于PCB寄生干扰极不敏感,并且能够真止付诸实践。通过在滤波器LC库小对于电容的经验性选择,可以缓解ADC的充电反冲,而滤波器LC库则同时具备怎分和普通模式两种排列分布。在本设计方案屮,通过源电阻阻值的降低,通带衰减由5dB缩小至OdB。衰减性能改进的同时无法实现完芙的阻抗匹配,但却使DVGA能够得到较小输出幅度的ADC全范囤参考值。FilterProfih0200400FrequencyDlHz]LMH6517ion25QADC16DV1&0Vi

7、n♦图2DVGA和ADCZ间的带通滤波器接口对丁较大的输入信号而言,ADC输入时钟的质量对丁•限制系统实现信噪比SNR十分关键。时钟的边缘抖动会彩响ADC的定期采样时间,并增加信号噪声。公式(1)给出了在出现抖动的情况下可以实现的最大信噪比,fin是输入信号频率,J是rms抖动,是以最大电平基准分贝dBFS为测屋单位的输入信号幅度,这样即使较小的信号幅度也能出现较人的负值。该公式有三个耍点:一是相比更高的频率,抖动更能降低信噪比SNR;二是信号越人,抖动对于信噪比SNR的限制影响越明显:三是可以通过降低整

8、体抖动来提供信噪比SNR。以上这些结果对于基站接收器应用十分关键,采用小频IF采样接收机获得的屮频IF较高,范围一般是100〜250MHZo虽然有用频率信道中的功率町能很小,但是接收路径中的ADC仍然必须将人范围的阻塞信号进行数字化处理,因此对于灵敏度的要求很高。如公式1所示,这些应用中的高输入频率和大范围阻塞信号加重了时钟的抖动效果。为了减小时钟的整体抖动,必须了解时钟噪声的频谱内容和待降低相位噪声的口标特定频谱区域。“近载

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